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MP5610图像处理开发板用户手册 1人参与	明德扬FPGA科教 2022-12-15 17:14	1 295	big_gun 2022-12-15 17:42
5702开发板用户手册 4人参与	明德扬FPGA科教 2022-12-6 11:21	3 267	明德扬FPGA科教 2022-12-15 17:13
如何实现单片机与CPLD通讯 4人参与	purpose_857 2022-12-15 13:52	4 255	R_myself 2022-12-15 15:09
FPGA I/O 引脚，输入管脚带有上拉电阻 2人参与	dragongfly 2022-12-15 09:38	2 264	架海梁心 2022-12-15 13:13
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CPLD资源占用请教 2人参与	we_happiness 2022-12-14 15:57	2 269	Tdongxue 2022-12-14 17:19
FPGA的DDS正弦信号发生器的设计和实现 5人参与	Taio 2019-10-11 09:59	5 397	kasis 2022-12-14 17:01
FPGA测量脉冲的上升时间，如何提高精度 3人参与	hfiwioq 2022-12-14 14:00	3 211	replace 2022-12-14 15:28
EPM7128STC100-15 供电电压是多少？是否用外扩 EEPROM? 2人参与	dragongfly 2022-12-14 10:11	2 222	niubility 2022-12-14 13:35
用到 8 路输入的时钟和输据（每路时钟都是不同频/相的）, 要求任选4路采样 2人参与	STGing 2022-12-14 10:35	2 295	风吹过后 2022-12-14 13:29
SDRAM复位方式 1人参与	ArthurKing 2022-12-13 20:50	1 227	starskyuu 2022-12-14 09:29
FPGA端存数据到SDRAM，arm从SDRAM读数据 3人参与	qian211111 2022-12-13 13:57	3 253	elephant_ 2022-12-13 15:13
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怎样才能在设计时更好的使用 VHDL? 2人参与	STGing 2022-12-13 10:51	2 292	风吹过后 2022-12-13 13:16
关于Verilog波形的一个疑问 2人参与	purpose_857 2022-12-12 13:59	2 274	hfiwioq 2022-12-12 15:23
用FPGA控制AD采样，在输出结果不接入单片机处理的情况下，怎样才能看到AD采样的结... 2人参与	whatever_ 2022-12-12 11:02	2 305	fuu65iwi 2022-12-12 13:20
简谈基于FPGA的千兆以太网设计 4人参与	FPGA技术江湖 2022-2-17 16:18	4 385	瞪郜望源_21 2022-12-9 15:39
fpga io口逻辑电平，比如高电平，低电平是多少啊？怎么确定呢？如何判断该io口有没... 2人参与	I_believe 2022-12-9 13:55	2 281	R_myself 2022-12-9 15:22
1 个 EAB 等于多少个 LE? 2人参与	STGing 2022-12-9 10:33	2 318	niubility 2022-12-9 13:26
FPGA上电瞬间IO管脚输出的高电平怎么消除？ 3人参与	unfaithful2021 2022-12-9 09:44	3 858	fuu65iwi 2022-12-9 13:23
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