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基于MIL—STD．1553B协议的远程终端的FPGA实现 3人参与	A-Lin 2019-8-29 13:56	3 363	zyyysu 2022-9-7 15:12
用Verilog如何实现这个要求？ 4人参与	purpose_857 2022-9-7 13:47	4 133	li205212021 2022-9-7 15:02
RK3308B是属于CPLD吗？ 4人参与	fanA 2022-9-7 13:15	4 124	oponi 2022-9-7 15:00
基于虚拟仪器与FPGA的多类型信号模拟器设计 2人参与	STGing 2022-9-7 11:06	2 158	Ele_insect 2022-9-7 14:21
基于FPGA的高速数据传输系统设计与实现 3人参与	dragongfly 2022-9-7 11:01	3 124	jack_are 2022-9-7 14:13
基于USB3.0和FPGA的传动误差检测系统的设计 3人参与	dragongfly 2022-9-6 09:50	3 108	瞪郜望源_21 2022-9-7 12:00
高级FPGA设计结构、实现和优化 3人参与	House 2019-6-12 09:00	3 281	瞪郜望源_21 2022-9-7 12:00
为什么CPLD分频后输出波形不规则 4人参与	T_Ching 2022-9-6 13:40	4 154	hgaj 2022-9-6 16:11
基于FPGA与DDR2的ADC采样数据缓冲器设计 2人参与	House 2019-6-12 07:00	2 300	雷北城 2022-9-6 15:57
基PLD对FPGA数据加密 2人参与	Taio 2019-6-11 10:37	2 283	雷北城 2022-9-6 15:56
用Verilog如何实现这个要求？ 3人参与	wp2022abc 2022-9-6 10:19	3 147	R_myself 2022-9-6 13:33
CPU正在中断处理的函数是否会被高优先级的打断? 3人参与	jf_www 2022-9-6 11:04	2 142	fuu65iwi 2022-9-6 13:28
基于FPGA的快速脉冲数据采集及处理系统设计 2人参与	STGing 2022-9-6 09:59	2 209	big_gun 2022-9-6 13:09
cpld串口波特率具体怎么算？ 3人参与	BGo 2022-8-29 16:02	3 139	wucl114 2022-9-6 10:23
FPGA 在一个时钟周期可以读取多个RAM数据吗？ 4人参与	dream123 2022-9-2 10:59	4 271	wucl114 2022-9-6 10:12
如何用Verilog语言使得FPGA输出一个时钟信号 4人参与	your_I 2022-9-5 11:18	4 191	kid_wang1990 2022-9-6 09:02
FPGA扩展一个串口需要多少FPGA资源 3人参与	hfiwioq 2022-9-2 15:32	3 150	wucl114 2022-9-5 17:50
请问一个FPGA复位问题？ 3人参与	fuu65iwi 2022-9-5 16:12	3 145	wucl114 2022-9-5 17:43
求cpld：5m160ze64的元件库，Altium Designer可以打开的 2人参与	fanA 2022-9-5 16:28	2 147	on1e 2022-9-5 17:22
CCD图像的颜色插值算法研究及其FPGA实现 2人参与	A-Lin 2019-7-10 07:00	2 222	雷北城 2022-9-5 15:38
BP神经网络图像压缩算法乘累加单元的FPGA设计 2人参与	A-Lin 2019-7-10 09:00	2 225	雷北城 2022-9-5 15:35
基于FPGA的模糊控制器管理蔗糖提取 2人参与	Diabloa 2019-7-7 09:00	2 299	雷北城 2022-9-5 15:33
FPGA/SOPC开发快速入门教程 3人参与	STGing 2022-9-5 10:15	3 192	瞪郜望源_21 2022-9-5 15:21
如何把100M正弦波信号(幅度<15dbm)转换成方波信号以便输入CPLD/FPGA分频 3人参与	fanA 2022-9-5 13:28	3 208	mqerew 2022-9-5 15:03
基于FPGA双线性插值实现的视频图像缩放显示 2人参与	dragongfly 2022-9-5 10:12	2 163	Terran 2022-9-5 13:38