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LUT实现移位寄存器的疑问？ 2人参与	dragongfly 2022-10-20 10:11	2 182	tick_tock 2022-10-20 14:29
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FPGA内部问题，RAM以及加法器相关 4人参与	whatever_ 2022-10-17 13:50	4 172	6940 2022-10-19 17:19
quartus II仿真出错了，不知道怎么解决？ 2人参与	BGo 2022-10-19 15:44	2 179	rergr 2022-10-19 16:29
程序下到FPGA不能正常工作 3人参与	whatever_ 2022-10-19 13:42	3 173	someone 2022-10-19 15:28
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基于FPGA的CAN总线控制器SJA1000软核的设计 11人参与	Diabloa 2019-1-16 10:25	12 705	xjb123 2022-10-19 08:54
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verilog怎么用红外遥控控制LED闪烁？ 2人参与	chanfu 2022-10-18 15:59	2 178	lahhse 2022-10-18 16:47
FPGA 逻辑在线仿真正确但烧入EPCS后却无反应，求高手分析 2人参与	purpose_857 2022-10-18 13:49	2 195	we_happiness 2022-10-18 15:09
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ISE 综合时，能用一个LUT替代深度不大于16位的移位寄存器吗？ 4人参与	STGing 2022-10-18 10:49	4 252	Dollche 2022-10-18 14:39
JTAG PROGRAMER下载程序到芯片，总是出现错误 2人参与	dragongfly 2022-10-18 10:11	2 135	tick_tock 2022-10-18 13:50
FPGA里面的加法器需不需要CLK信号触发? 4人参与	someone 2022-10-18 11:07	4 226	I_believe 2022-10-18 13:47
基于 USB 和 FPGA 的多功能数据采集系统 5人参与	Taio 2019-6-21 07:00	5 324	瞪郜望源_21 2022-10-18 11:56
FPGA动态部分重构的研究及位流信息重构的实现 4人参与	Taio 2019-6-13 11:22	4 347	瞪郜望源_21 2022-10-18 11:55
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想用单片机配置CPLD EMP240 需要控制CPLD 的那几个引脚啊？ 3人参与	T_Ching 2022-10-17 11:26	3 144	oponi 2022-10-17 14:50
由于现在的设计基本上都是同步设计, 那么 PAD TO PAD CONSTRAINT 在什么情况下使用？ 3人参与	dragongfly 2022-10-17 10:27	3 176	风吹过后 2022-10-17 14:35