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基于SRAM和DRAM结构的大容量FIFO的设计与实现 2人参与	Taio 2019-5-14 10:11	2 352	雷北城 2022-7-6 15:48
我这个流水灯左移再右移为什么只有一次，不是有while循环吗？ 5人参与	we_happiness 2022-7-6 13:12	5 213	purpose_857 2022-7-6 14:14
用CPLD芯片EMP1270（3.3.V供电）通过ULN2003驱动继电器，CPLD与2003之间直接接有问... 3人参与	lahhse 2022-7-6 11:06	3 110	Memory00 2022-7-6 14:06
Xilinx 7系列FPGA收发器架构十：RX模拟接收前端介绍与使用 2人参与	dragongfly 2022-7-6 10:14	2 205	big_gun 2022-7-6 13:59
一种基于FPGA的快速CRC算法及实现 3人参与	A-Lin 2019-7-12 13:28	3 248	youuuu 2022-7-6 08:26
cpld程序时序仿真正常，固化后结果完全不同，会是什么原因？ 2人参与	itch 2022-7-5 15:24	2 173	hgaj 2022-7-5 16:57
双模式CORDIC算法的FPGA实现 2人参与	A-Lin 2019-7-12 09:00	2 344	雷北城 2022-7-5 15:54
Protel DXP实例100个 2人参与	House 2019-1-9 07:00	2 375	小梁仔 2022-7-5 15:13
关于cpld 执行时间问题 3人参与	choose521 2022-7-5 11:18	3 172	ESCAPE 2022-7-5 14:33
Xilinx 7系列FPGA收发器架构九：TX时钟输出控制及驱动器结构 2人参与	dragongfly 2022-7-5 10:28	2 205	Ele_insect 2022-7-5 13:45
Verilog HDL程序设计实例详解 5人参与	dragongfly 2022-6-1 09:18	5 238	521li 2022-7-5 13:43
时钟的触发时序执行时间？ 2人参与	replace 2022-7-4 16:16	3 185	hfiwioq 2022-7-4 17:42
FPGA/CPLD对DSP 的数据线有没有影响？ 2人参与	oponi 2022-7-4 14:50	2 157	opipo 2022-7-4 16:23
基于DDS技术的数字移相信号发生器的设计及FPGA的实现 3人参与	A-Lin 2019-8-26 14:14	3 362	雷北城 2022-7-4 15:28
IEEE80211a的OFDM基带调制的FPGA实现 2人参与	A-Lin 2019-8-23 13:26	2 339	雷北城 2022-7-4 15:26
7月5日（周二）电巢直播《软硬件协同加速器设计方法及AMD Vitis 软件平台介绍》 1人参与	电巢直播 2022-7-4 10:06	1 170	rendezvous 2022-7-4 14:38
专用集成电路设计技术基础（电子科技大学出版社） 4人参与	A-Lin 2019-6-13 07:00	4 264	瞪郜望源_21 2022-7-4 11:59
Xilinx 7系列FPGA收发器架构八：TX Buffer/TX PRBS的结构及使用 2人参与	dragongfly 2022-7-4 10:01	2 248	架海梁心 2022-7-4 11:20
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现在驱动LCD显示屏,为什么一般都要加一个CPLD/FPGA啊? 2人参与	on1e 2022-7-1 16:04	2 135	hgaj 2022-7-1 17:54
Xiinx 7系列FPGA收发器架构七：FPGA收发器TX结构和功能 2人参与	dragongfly 2022-7-1 10:16	2 166	jack_are 2022-7-1 16:32
PLC和FPGA有啥区别，不都是可编程逻辑器件吗 2人参与	hfiwioq 2022-7-1 14:42	2 136	R_myself 2022-7-1 15:27
基于FPGA和AD9240的非制冷焦平面阵列数据采集电路实现 2人参与	A-Lin 2019-6-4 09:49	2 291	雷北城 2022-7-1 15:17
FPGA CPLD烧写错误？ 3人参与	twel2e 2022-7-1 13:29	3 121	ESCAPE 2022-7-1 14:59
fpga和stm32那个处理图像更快一些? 4人参与	nocturne 2022-7-1 10:10	4 174	duhe3hfu 2022-7-1 11:21