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EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › 关于cpld 执行时间问题
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关于cpld 执行时间问题

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choose521

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1#
发表于 2022-7-5 11:18 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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verilog中 比如always @(posedge clk)
1 o  M8 Z$ P0 P, Y" o( V4 jbegin
6 b7 o  ~. ?! _  A( F) f* ^: b. a......
7 i' X) Z" b7 R. }6 ?end
  H' G2 Z1 Z9 f5 a6 [实际begin end中的语句执行一次 要多少时间啊5 r+ W, {  e5 g) w

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oewqe

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2#
发表于 2022-7-5 13:18 | 只看该作者
这个好像要看进程里放的什么程序哦，在进程中程序是按顺序执行的吧。
+ }. q& B6 I6 u* r8 ?& x" R

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mqerew

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3#
发表于 2022-7-5 14:08 | 只看该作者
再看看别人是怎么说的% x- c8 b! e  B5 ]* ^) b4 ~

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ESCAPE

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4#
发表于 2022-7-5 14:33 | 只看该作者
一楼说的很不错3 p$ E/ Y, n( X$ }6 S  s3 Z) z

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