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cpld程序时序仿真正常,固化后结果完全不同,会是什么原因?

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发表于 2022-7-5 15:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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cpld程序时序仿真正常,固化后结果完全不同,会是什么原因?
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2#
发表于 2022-7-5 16:37 | 只看该作者
仿真提供的信号跟实际的输入信号不一样,建议用示波器或者逻辑分析仪观察输入信号的变化是否正常. s" j/ \1 y$ P: D

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3#
发表于 2022-7-5 16:57 | 只看该作者
根据IC的具体型号,一般规格书里面有说明需要注意的地方。5 `5 ~5 f  k; V+ T; f
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