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Xilinx 7系列FPGA收发器架构十:RX模拟接收前端介绍与使用

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发表于 2022-7-6 10:14 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 dragongfly 于 2022-7-6 10:28 编辑
" `" @0 F; S8 k) C( l% }0 n6 {, G( E3 M/ k2 j
通过本文可以学习以下内容:
1 U6 Y& d/ {5 }1.RX模拟接收前端(AFE)介绍与使用
+ m2 X0 [4 w( ^& I2.GTX/GTH RX管脚极性控制
6 i: Y3 E! W+ L- @' ^$ a
  l: I6 A! M7 l+ M: Q1.RX资源概述4 n0 g1 S- G, e4 D
GTX/GTH收发器的接收器(RX)资源包括PCS和PMA组件两部分,与TX类似,可以看做是TX结构的逆向。下图显示了RX结构框图:
4 D& F! L" W8 t3 B; A! w0 S
& I5 ~8 q. k! r- _: N4 Z按照GTX/GTH收发器RX接收信号处理顺序,RX主要包括以下关键模块:- _" |( `# a: E. X6 M3 R9 Z9 S1 u, r
1.RX模拟前端/ S& L8 z* a- [; b
2.RX OOB信号检测
7 x! N; k" W1 E+ N3.RX均衡器(DFE和LPM)
: Y; g/ I0 Z  Q' y" V' R& B4.RX时钟分频器(CDR)
) e7 p! f" _! ]' G1 E" G/ b5.RX接收串并变换(SIPO)& n$ o9 g, L- x
6.RX PBRS检测器% N9 V3 [: X+ A2 `2 b, P6 S
7.RX极性控制* Z% E$ e7 u. F0 ~
8.RX字节和字对齐0 s/ V+ a: v' Z, v0 a
9.RX 8B/10B解码器; s( H$ |1 T( e9 c
10.RX Buffer(缓冲器)
+ s" ]' G+ I$ M3 K, b11.RX状态控制* G" ?. T4 L' `1 d9 L/ F4 e/ [0 U% a" E
12.RX相位校准7 D; y, {$ m9 C2 T
13.RX变速模块(Gearbox)$ h. x4 c3 l7 b& v' H
14.FPGA RX接口
5 O% h6 j# ^* I3 e" A% ?: u3 R7 j* @4 _' v! u
2.RX模拟前端(AFE)
% H. V7 |' V" Z3 X2 C2.1功能概述0 g' j0 k9 n  U& H
RX模拟接收前端(AFE)是高速电流模式输入差分缓冲器,如图2所示。该缓冲器具有以下特性:) A" v# u' _% S( k4 \3 [: j" u9 S
-可配置的RX端接电压
! o0 _3 W' Q. S/ A; V-校准的端接电阻) a& u0 |% I/ l. a; _0 c6 Q9 {

+ z, |0 A, B0 K. S
7 V: i" d4 W# N1 M2.2 RX模拟接收端接使用模式5 N' Y" A9 L" E8 C, B# `; l( T
下图显示了我们在使用7系列FPGA收发器向导生成IP时有关RX端接配置选型。这些参数针对不同的串行收发器协议有不同的配置,本章节我们介绍如何进行这些参数配置。5 W2 i  o9 D. ^' x8 \3 j3 M

$ \  i9 a& u  ~' PRX端接针对不同的协议应用,有四种不同的使用模式,我们在进行如PCIe、SRIO、SFP+、XAUI等协议时,可以选择对应的配置模式。; T& h- T+ z, x0 G% ^

, p- o# C, `; ?" M更多详细内容请下载附件查看" n1 v& \5 I! T1 ?8 K9 G

6 v3 B+ g; K# I+ O/ H( v1 j

Xilinx 7系列FPGA收发器架构十:RX模拟接收前端介绍与使用.pdf

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该用户从未签到

推荐
发表于 2022-7-6 11:26 | 只看该作者
看你很久了,学习Thanks♪(・ω・)ノ

该用户从未签到

3#
发表于 2022-7-6 13:59 | 只看该作者
看一看,学习学习。
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