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12位编码器与FPGA采用rs232通信 2人参与	purpose_857 2023-2-6 13:56	2 254	aid4her 2023-2-6 15:23
怎么用与非门等设计出全加法器？ 2人参与	dragongfly 2023-2-6 10:20	2 465	架海梁心 2023-2-6 13:55
设计一个可预置初值的7进制循环计数器,15进制的也可以 2人参与	STGing 2023-2-6 10:44	2 221	zhi_hui_zhou 2023-2-6 13:47
为什么定义的指针使用时可以当作数组用？ 3人参与	someone 2023-2-6 10:39	3 192	Nain 2023-2-6 13:27
FPGA ------- SERDES高速系统(一) 14人参与	ulppknot 2019-7-1 16:14	14 924	fymbl 2023-2-4 20:27
串口程序不稳定 3人参与	fuu65iwi 2023-2-3 13:29	3 330	li205212021 2023-2-3 15:14
加上拉电阻后,TTL可驱动CMOS.上拉电阻用途？ 3人参与	dragongfly 2023-2-3 09:58	3 221	tick_tock 2023-2-3 13:19
CPLD实现I2C透传 3人参与	someone 2023-2-3 11:04	3 458	we_happiness 2023-2-3 13:19
用fpga画出CMOS电路的晶体管级电路图 2人参与	STGing 2023-2-3 10:23	2 333	风吹过后 2023-2-3 13:13
cpld IO口输入电阻 3人参与	nocturne 2023-2-2 15:32	3 271	we_happiness 2023-2-2 17:04
IC设计过程中将寄生效应的怎样反馈影响设计师的设计方案？ 4人参与	dragongfly 2023-2-2 09:46	4 378	风吹过后 2023-2-2 14:24
用fpga设计一个自动饮料售卖机 2人参与	STGing 2023-2-2 10:28	2 247	Terran 2023-2-2 13:22
逻辑功能求助 2人参与	elephant_ 2023-2-2 11:20	2 230	dream123 2023-2-2 13:20
AMEYA360报道：闭合系统用电机发动机中使用的电机 1人参与	Ameya360 2023-2-1 13:16	1 312	somethingabc 2023-2-1 16:48
讨论触发信号的在上下沿的采样方式？ 2人参与	R_myself 2023-2-1 15:28	2 260	I_believe 2023-2-1 16:38
Verilog 源代码与testbench直接的关系 3人参与	whatever_ 2023-2-1 14:09	3 334	dream123 2023-2-1 15:20
在fpga中画出Y=A*B+C的cmos电路图。 2人参与	STGing 2023-2-1 10:40	2 266	架海梁心 2023-2-1 13:28
画出cmos 2输入与门的晶体管级原理图，哪种输入对输出上升沿的响应更快 2人参与	dragongfly 2023-2-1 10:07	2 245	big_gun 2023-2-1 13:14
基于FPGA的DDR控制器的实现 10人参与	Taio 2019-1-20 07:30	10 724	234500317 2023-2-1 08:51
如何用fpga开发板驱动无线网卡通信？ 2人参与	someone 2023-1-31 16:09	2 298	we_happiness 2023-1-31 17:15
在EDA工程中CPLD和FPGA哪个延时更小？ 3人参与	Nain 2023-1-31 14:12	3 344	peerless2021 2023-1-31 15:29
怎么用一个二选一mux和一个inv（反相器）实现异或。 2人参与	STGing 2023-1-31 10:22	2 329	zhi_hui_zhou 2023-1-31 13:39
在FPGA中怎么画出晶体管级的电路 2人参与	dragongfly 2023-1-31 09:51	2 239	tick_tock 2023-1-31 13:14
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