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楼主: li_suny
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《Mentor SiP系统级封装设计与仿真》出版与技术答疑!

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16#
发表于 2012-10-12 11:25 | 只看该作者
顶一下楼主,厉害。

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17#
 楼主| 发表于 2012-10-12 15:49 | 只看该作者
zhongyiwaiting 发表于 2012-10-12 09:07
* ]2 Y% [1 _& y4 {8 y# N回复:
: M; ]* P# ]' U( u- g1 f% T如果是EE的设计,看是否是EE2005的网表流程,也会有这样的提示。EE2007以后基本不建议使用网表流 ...

" H, Y( w$ q* ~1 P9 R现在Mentor主推EE Flow,最新最好的功能首先在EE里实现,例如 Xtreme协同设计,埋阻埋容、柔性电路、盲埋孔自动布线、RF、键合线、腔体、芯片堆叠、SiP 封装设计等功能。
' H2 l# F: T& f7 @% Y# p 3 @7 D" ~. L$ [, Z
EN(Boardstation)太老了,比较难学,慢慢就会被放弃。- E6 p; H/ Y. v  Q3 E
Pads,主要还是面对低端用户,功能会有提升,但总会和EE拉开差距。

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18#
发表于 2012-10-12 16:46 | 只看该作者
li_suny 发表于 2012-10-12 15:49 % l8 k  {2 \% K* }' V( j
现在Mentor主推EE Flow,最新最好的功能首先在EE里实现,例如 Xtreme协同设计,埋阻埋容、柔性电路、盲埋 ...

+ e4 X8 T" ]( ]/ @3 i) T能否请帮忙看看15楼的问题?谢谢。

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19#
发表于 2012-10-13 08:40 | 只看该作者
很好,很强大!

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20#
 楼主| 发表于 2012-10-14 20:36 | 只看该作者
回复15楼。
) O2 f9 e+ u" |% z5 v( z- i) I8 I" D  y4 C+ A& s/ }" c
谢谢两位的回答。现在发现,以前的原理图是design capture设计的,但是EE7.9.3却没有这个工具,而DxDesigner打开design capture的一直有问题,不知道如何解决。
7 ^  ^0 i1 Z! P5 v  M  Z' U' VDxDesigner无法打开design capture的设计,需要转换,开始菜单 > 所有菜单 > Mentor Graphics SDD > Translators > DC2DX Translator,可以试一下。
7 x* }6 g7 w2 U4 b4 b顺便吐槽一下,EE这么高级的软件,使用上也不是很顺手。当然我是初学者。
: y* m' X; ^$ \; b& u! h( ?. a3 M比如 plane assignment,布线后看不到,后来是用了别的方法看到的。
& Y( J9 {& B4 B4 v& a正常应该是在布线模式下看得到,不知你用了何种方法看到的?
% t' V$ |) R; X0 j& h/ s  kdisplay太多选项,不小心选择了minus display后,无法恢复到以前的。%0 J8 s/ c5 x7 h3 e2 b0 |
最好保存显示设置Save Scheme,也方便以后调用。
' D3 e' C0 c6 k: Q' z
layer的颜色层指定后,不知为何有时候自己改变。
* D1 ~2 X: O# R3 S6 E有可能是Display Scheme变化造成的,调用自己保存的Scheme即可。  v* q% y7 t6 K" n/ r& \
还有比较不爽的是,无法让每个net name显示出来,所以要看net name的时候,要逐一选择。我比较习惯pin上能够显示net name,这样在布局规划的时候,比较直观。
  T6 ^- V- [) ]7 e# q# i这个功能目前确实没有哦
& G1 w" U3 F8 q4 D: L& W0 B4 m然后desing capture brower,high light whole net,居然不能跨页,模糊搜索也不尽人意,sigh。: X" ?# D7 x- X% i: W
Desing capture不太熟悉,我接触的时候基本就是DX了。' R: B" S+ g9 U5 ~! }

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21#
发表于 2012-10-15 09:20 | 只看该作者
本帖最后由 richardhjc 于 2012-10-15 09:26 编辑
, v9 N$ w3 r5 A  j' T. z
li_suny 发表于 2012-10-14 20:36
3 o6 {3 O" R8 H; H" w& }/ h回复15楼。  r8 F# R) A' `

6 U0 C' r5 ]% ^/ L1 n1 ~谢谢两位的回答。现在发现,以前的原理图是design capture设计的,但是EE7.9.3却没有这个工具 ...
( t% {, h. T7 E: H6 q

6 A$ w) k4 a4 R- Y( H  l+ x谢谢您的回答。
: H5 R8 F* e: Z! b$ Z( P  Y/ f
. ?" ]% {# \8 g比如 plane assignment,布线后看不到,后来是用了别的方法看到的。
* O5 t3 L- A$ G7 O0 w, K正常应该是在布线模式下看得到,不知你用了何种方法看到的?
/ ]. M' M0 G6 _$ B( r7 m刚好PCB中有手动分割的plane,右键就可以看到plane assignment了。但是菜单栏的一直是灰色的。

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22#
 楼主| 发表于 2012-10-15 23:53 | 只看该作者
菜单栏的plane assignment是灰色有一种原因是设计不同步,即原理图和PCB不一致造成的。

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23#
发表于 2012-10-16 08:54 | 只看该作者
li_suny 发表于 2012-10-15 23:53
$ P) y7 L! {& t) D4 E菜单栏的plane assignment是灰色有一种原因是设计不同步,即原理图和PCB不一致造成的。

& o/ g. N- B( E% f5 N$ @
: @$ b3 F+ e( n6 e$ h( m/ d明白了,那也许是原理图用DC设计的,所以无法同步的关系。 谢谢。
+ T& ^$ H8 L1 W' n另外请教一下,EE中有没有方便的方法可以查看PCB是否有环路的现象?

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24#
 楼主| 发表于 2012-10-16 13:15 | 只看该作者
richardhjc 发表于 2012-10-16 08:54 ' v/ N" A/ U/ n" w# g
明白了,那也许是原理图用DC设计的,所以无法同步的关系。 谢谢。
) d9 l/ ^. W3 X) n. R2 u另外请教一下,EE中有没有方便的方法 ...
$ l& w& @% I2 m

( \$ L- o5 _) b3 I; x5 ~* d8 V! V
布线设置里有prevent loops,DRC检查里也有相关选项,可配合使用

batch DRC.PNG (204.03 KB, 下载次数: 49)

batch DRC.PNG

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25#
发表于 2012-10-16 15:43 | 只看该作者
li_suny 发表于 2012-10-16 13:15
7 @$ Y; v) R# U" b, x! |布线设置里有prevent loops,DRC检查里也有相关选项,可配合使用
% E1 V  Y  e: ]- b. Y
十分感谢你的回答。

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26#
发表于 2012-10-17 11:34 | 只看该作者
li_suny 发表于 2012-10-16 13:15
+ f, X$ J) _" @" L& E$ k2 L: g布线设置里有prevent loops,DRC检查里也有相关选项,可配合使用

' U7 j7 f6 F' P4 x3 P  t1 ?Hi,li_suny!请问我在使用Expedition 7.9.3做add polygon的时候老是没有办法画直线如下图,是我在那里是指不对吗?新手,不好意思!

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27#
发表于 2012-10-17 12:47 | 只看该作者
画drawing的时候最好利用网格

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28#
发表于 2012-10-17 12:49 | 只看该作者
请教楼主,现在结合EE最好的仿真工具是ICX Pro还是Hyperlynx?哪个和CES结合更紧密?

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29#
 楼主| 发表于 2012-10-17 12:52 | 只看该作者
soul_winds 发表于 2012-10-17 11:34 0 W6 G) J/ }% _( ^) u
Hi,li_suny!请问我在使用Expedition 7.9.3做add polygon的时候老是没有办法画直线如下图,是我在那里是指 ...

. @2 _& d$ b& I
/ I' D( M8 g+ b9 B9 A建议你更改一下Drawing Grid 再试试。

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30#
 楼主| 发表于 2012-10-17 12:56 | 只看该作者
dzgking 发表于 2012-10-17 12:49 8 z0 R9 l/ v& n) ~+ q7 \0 [3 a
请教楼主,现在结合EE最好的仿真工具是ICX Pro还是Hyperlynx?哪个和CES结合更紧密?
) b' r- {! `# S5 d7 u* Z" D$ U
按理说ICX Pro和EE流程结合的更紧密,但现在Mentor主推的还是Hyperlynx,功能更全面也更好用。通过HyperLynx可生成约束模板CTE,然后再应用到CES。
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