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楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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661#
发表于 2011-11-14 19:50 | 只看该作者
你好,群主,我是刚用ORCAD画原理图,有个问题请教一下,我用ORCAD画完原理图后,导出表络表,在PADS LAYOUT中导入,导过来是没有任何出错报告,但是我发现有一些元件的一端没有连网络,我检查过原理图,连接是没有问题的,请问这是什么原因造成呢???

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原理图连接存在问题.PCB只是网表导进来后的体现.原理图和网表是怎么样的,导进来的PCB就是怎么样的.  发表于 2011-11-15 11:00

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662#
发表于 2011-11-14 21:47 | 只看该作者
请问楼主,PADS做的PCB资料,现在要求导入到CR5000软件中(给日本客户),要怎么样转?

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CR5000可导入pads的asc文件.  发表于 2011-11-15 11:00

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663#
发表于 2011-11-15 19:19 | 只看该作者
jing 发表于 2011-11-9 15:12
0 D, ?/ @  z6 U+ r楼主好厉害啊8 A( T0 A( B% x/ z
: J& i; v1 X, z- F
我想请问下   pads5.0 中PCB的pdf产看文件 怎么导出来啊

0 W3 m5 H+ [# f, E8 B4 ~. c{:soso_e100:} 谢谢楼主。。。。

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664#
发表于 2011-11-15 19:28 | 只看该作者
群主   帮我加下群啊    214676624   谢谢啦{:soso_e181:}

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665#
发表于 2011-11-15 19:40 | 只看该作者
大家好    我想请教下  pads layout 中如何用铜箔  写字呢   {:soso_e132:}    我修改别人的一块板子  pcb版本  日期 等等都是铜箔 ,我自己用copper写的时候   写的可难看了

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你想写什么字?可以放置text在top层.出光绘时记得选上.  发表于 2011-11-16 17:51

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666#
发表于 2011-11-16 00:48 | 只看该作者
请问楼主:
# d$ j& u) {7 `; N) lECO TO PCB时提示错误:Dangling Connections without a Net Name
2 E5 C9 y  J) R. l" x! o# n/ [# q0 e  O; b
_WR; f( t: e. q  }5 q/ |
CPU          X2500  Y4600
6 r2 l* K1 r5 ?/ I: S5 ?, c7 G' F% X7 Y( a8 d. R/ {5 e  h
Dangling Connections with a Net Name- e6 `8 R, J- W- n# p+ m

, X+ X3 S4 \3 I( N/ p3 [# a6 p9 ~_CS_RAM$ r8 t9 I& j6 f( u. Y& {7 Q
CPU          X6000  Y2200 + E6 D3 m4 b# M" [0 [0 q8 f/ c
CPU          X9000  Y3100 6 @- U1 n) P; r
CPU          X9400  Y5300
9 X2 B( _0 m( W: \: d2 t* k( B% G' t2 o3 l, g& G
是不是这两种错误不会影响网络连接?即对PCB不会有影响?

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不会影响.可以改一下网络名,以防万一  发表于 2011-11-16 17:51

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667#
发表于 2011-11-16 17:59 | 只看该作者
loveineda 发表于 2008-10-10 13:18 6 D0 J  ?' J5 k% f/ A; _6 J
初次使用PADS,出现如图中央的问题,左边的电容和右边FPGA不能正常连接!
& w' W% V8 Z! Z* G4 R! K( z# j! {9 r可能是我的走线比FPGA的管脚要粗 ...
: o$ R% U! w) t. z7 ?
走线是粗了!导致安全间距不符合!所以开DRP是连不上的!关掉可以!但是最好改细点!如果是滤波的,你可以从IC引进出来细点,然后加粗!
2 O" G. _6 S6 B' G, @
& ^; t# O0 b( N$ ^+ {) s

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668#
发表于 2011-11-16 20:37 | 只看该作者
本帖最后由 jimmy 于 2011-11-17 10:19 编辑
1 s7 d. b  v: G) U; D* _3 W8 b- I: H% t; j* @! v: T
一般那些网络需要包地,那些线要等长,数据线是否都有要求四线带1 地,
7 T. D3 Q+ U8 S7 p" p$ X这方面是否有详细的理论解释?
' `0 J, r9 y& W2 {; F9 p6 s如果需要包地,应注意那些事情,比如地线线宽是否有要求等
/ ]+ G! u! T+ j) y: Y
4 F1 R( S1 J% p7 `8 cjimmy回复:
, r% q7 y* {  t! W
1 H0 t( v& K, s! ?# `% `. F/ `1,时钟线,高速信号线,差分线,模拟线有空间的情况下需要包地.1 ]5 O  Y1 x# j3 n* t
( L! E9 R9 }& O) w0 x" E
2,有时序要求的线都要等长,如存储器的数据线,地址线,还有其他的并行总线.
' o$ W5 A  I- ?1 ^) `1 Y1 x/ q4 a3 X$ _' y8 X8 V
: ~8 x+ J* l  u. J; t' a

7 ?; D6 N3 j) ?5 v9 J另外,你指的数据线要求四线带1地是什么意思?: z& ^/ u: O8 N5 I# t, e5 h

1 x0 D3 U. z' c! n( v% w' E  ~3,如果需要包地,包地线的线宽最好在注意包地线离被包线的间距最好做到20mil或3w以上,然后包地线上要按一定的间距(100~200mil)打地过孔,以达到立体包地的效果.如果没有办法做到立体包地,还不如不包.只需要将线与线之间的间距拉开至少3w就可以.& D, W; I2 c& C1 G6 c6 w, I
: q" R! A1 ]* ^0 n1 L' _

4 [5 ]* J8 X* `! C4 T

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669#
发表于 2011-11-16 20:57 | 只看该作者
我做了一个封装,网络表显示有连接,但是一导入pads后,发现电源脚没有任何线连接上去,这个是怎么回事情?难道封装的原因?

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无图无真相.  发表于 2011-11-17 10:22

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670#
发表于 2011-11-17 09:22 | 只看该作者
jing 发表于 2011-11-15 19:40 " t/ }2 w3 L3 Y
大家好    我想请教下  pads layout 中如何用铜箔  写字呢       我修改别人的一块板子  pcb版 ...
) B  f; |- T/ e. k$ `
[attach]46133    不知道这个附件你能看到不    就是铺垌上的字的笔画部分是镂空的   
8 a: X" B% _" g
) I* o' ]) ]1 [+ }* \6 L; \2 Y% G* q6 q' T) Z% R% R

8 g* {* O/ U0 e顺便再问下   在布局中   创建族  有多大的意义呢        辛苦你了    谢谢啊               {:soso_e160:}

铜箔字.doc

46.5 KB, 下载次数: 37, 下载积分: 威望 -5

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打开后显示乱码/  发表于 2011-11-17 10:22

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671#
发表于 2011-11-17 13:35 | 只看该作者
jing 发表于 2011-11-17 09:22
% i0 f1 T# e1 M/ \4 o. \. ]/ X[attach]46133    不知道这个附件你能看到不    就是铺垌上的字的笔画部分是镂空的   

& h: o, D" e7 d2 m. c我是新手学画PCB呢    今天在书上看到簇   练了一上午   没觉得多大的用处   你能指导我一下学习的方向吗? {:soso_e100:}   

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簇没什么实际的用处.书上的只是详细给你介绍一下菜单的使用,无任何实际的指导价值.多向身边的PCB设计师交流和沟通.  发表于 2011-11-21 11:10

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672#
发表于 2011-11-17 19:03 | 只看该作者
求助楼主:router中set width如何自动出现上次设定值?
' k- m# ~0 x4 v" }6 b, A! w打开pads router,拉线,键入W,出现线宽设置小窗口,在"set width"后面输入线宽值,比如“5”,回车,则当前的线宽被设置成“5”。4 ]9 n3 C/ q* r2 Q
再次键入W,则"set width"后面自动出现上次输入的值“5”,不必手动再输入一次,直接回车即可,省了不少麻烦。1 O( ]+ l& v0 A
悲剧的是,有时候键入W,它不出现最近输入的线宽值,而是一片空白,像软件刚打开时一样。0 n0 {# P8 G& `9 E9 Y
更悲剧的是,我在另一电脑上,新装pads9.3,从来就不出现最近输入的线宽值。老版本在这个电脑上现象相同。
. |8 i- I; t/ F4 Q7 U请问这个现象如何解决?# T+ g3 m- r7 @5 R$ p! I$ a
多谢!

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没用过此功能.  发表于 2011-11-21 11:13

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673#
发表于 2011-11-17 21:09 | 只看该作者
gui_qu 发表于 2011-11-16 20:37
" N9 K6 ~5 T/ A/ B# Z一般那些网络需要包地,那些线要等长,数据线是否都有要求四线带1 地,
& T" |1 a- c: M/ ~# `# [这方面是否有详细的理论解释?1 H; F9 S/ I. H+ z# C( ?
如果需 ...

% c5 c, u* Y9 ^/ A! W. O0 H( e5 v非常谢谢jimmy回复,  z; L0 G( J! I9 b$ v/ j  I: q

  |! g. p# ^1 f0 v: y% W' _) U& O' Q# }; P. H8 B0 l6 b2 K8 K! H
4 K2 u+ K6 z7 n. z# u. o
另还有些疑问.请教.
+ F" V7 {" v" Y4 I& }* z. F1.包地原因,主要针对易受干拢的信号 ,还是针对易产生干拢的信号?或都是两种信号都要进入包地?
* a, c3 v/ i5 n- |1 w2.等长知道是时序要求才做的,但对那些线有时序要求,有时分不清,
2 @5 p; A) r+ ^+ j 如DDR的数据线与控制线是否要求等长?
+ K) E/ o: a" `; T5 _8 u, ?; ^9 g地址线与数据线是否要求等长?# I, W+ ]) d- X
或者是只要求成组的数据线等长?
$ O& A2 P1 f) Q5 @& b* X! K  v又或者只要求数据结的高8位等长,再低8位等长,高位与低位不等长?,
8 E# U2 b7 e, L) p/ A1 ~  T# h4 a. j
另还有一重要问题,5 m, J6 C- g/ c
通俗的说多少M频率的数据信号有时序要求,如是400M,800,还是1G.?8 C3 u3 [  D  B4 z4 F7 D

9 _0 |7 I* x; e" x一个实际的问题,如DDR数据线,最长的那根线有800MILS,但大多数线在400以内可以走通,
- T7 h7 @. B# L& ~2 M- c如果频率是800M,这个时候,走等长好还是不走等长好?
# x; L8 i0 O7 ?- e1 v
& f; r; Z; m4 }& W8 ^+ k% W/ j9 E另对于双DDR,或多DDR,如何等长?
2 A, G! a1 e' i1 t0 w/ B. ?0 r$ X, C& R( M( @( U4 w
3.以前经常有听到较多数据线时,如16根时,
) |  h4 Q) Q5 L1 K; y走4根线时要走一根地线,不要16根同时走,不知道是否正确,不知道具体是如何要求的?& a! G2 K! B6 n1 k9 F, {

: A9 k6 T* I& V9 x3 a. R
- r7 {0 n  G+ ^  Q  M  j: J% w9 l

3 ^- N& i5 T5 r* r% g

点评

1,有空间就包吧. 2,分不清有空间的话就全部作等长. 3,双DDR或多DDR,走星形或菊花链拓扑进行等长. 4,可以16根一起走.不能一起走的话,可能这16根里面有发送和接收,所以要将发送和接收分开. 如果有具体的原理图才行  发表于 2011-11-21 11:15
貌似这些都是原理的问题,不是pads技术的问题了  发表于 2011-11-18 11:22

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674#
发表于 2011-11-17 21:11 | 只看该作者
gui_qu 发表于 2011-11-17 21:09
5 S" G5 F5 |( {0 a; X' g' }' W非常谢谢jimmy回复,
" e1 ~6 L5 ]5 ^  f: K
再次麻烦,有些不好意思,
2 K; B( h9 y# t9 r) H" O" G但还是...........................
; u+ `# V* F1 s非常感谢.

该用户从未签到

675#
发表于 2011-11-17 23:14 | 只看该作者
Jimmy 大哥:/ L, t9 \$ ^  {) M, G  x* C
     你好,上次有看过你写的一篇关于《PADS Router 如何设置快捷打孔》的文章,
  P! N! x. I5 T" k$ T, t我也照着你的MCR文件 改成2层板的,在Router里是可以实现双击鼠键打孔,
% K0 \3 p) H' V- y; o不过,现在碰到一个问题,想请教下你:
' i. Y- t. ~  F# V* [    我按数字键1,孔类型改为“Current Via Type is set to Via1”  ,打的孔也是Via1的孔;
2 T8 c" S% n+ D: C, }我再按数字键2,孔类型改为“Current Via Type is set to Via2” ,打的孔却是Via1的属性的孔
# k4 H. t: p! e/ Q- q) X# O0 u0 ?不是我要求的,除非改下面的地方才能打Via2的孔 “Design Properties\Via Biasing”只保留Via2的勾 才行(开始下面这里全是勾上的)。2 i# j) w" [* W) A9 k$ H# Y9 E  G6 n
         # ~7 r+ d- |5 g& x8 |

2 g$ K0 G* j! B0 i; i( a/ P呵呵 说得有点哆嗦了,麻烦解答下,谢谢了!{:soso_e100:} (附上MCR文件)
1 p& E3 a$ Z: X$ Q( u5 C: N8 T

2层板实现快速打孔的问题.rar

58.69 KB, 下载次数: 20, 下载积分: 威望 -5

点评

同时双面板不需要设置为埋盲孔.  发表于 2011-11-21 11:16
你设置了钻孔层对了吗?  发表于 2011-11-21 11:12
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