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楼主: forevercgh
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【原创】理性认识SQ的时序仿真功能(不断更新中)_如需转载,请务必征得作者同意

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该用户从未签到

166#
发表于 2008-10-17 17:15 | 只看该作者
很热闹啊,看看

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167#
发表于 2008-10-20 16:04 | 只看该作者
期待SQ已经很久了

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168#
发表于 2008-10-20 16:40 | 只看该作者
学习中

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169#
发表于 2008-10-21 10:25 | 只看该作者
我没接触过仿真。。顶了各位再学习。。。。
) F9 g" {& k  ]5 L3 o. V不晓得你们所说的仿真是不是zuken里面有的那个什么ansoft,lightning,傳輸線分析一樣阿...都沒整過阿

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170#
发表于 2008-10-21 11:22 | 只看该作者
学习一下

该用户从未签到

171#
发表于 2008-10-21 15:16 | 只看该作者

回复 2# 的帖子

应该是 资料吧 ,瞅瞅 ,谢了 。

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172#
发表于 2008-10-26 09:42 | 只看该作者
正在学习SQ,楼主是强人啊!

该用户从未签到

173#
发表于 2008-10-27 21:00 | 只看该作者
问题一:版主在讲buffer delay时,图中的C点输出的是CLK还是Data?1 X, R6 D2 N' `$ I
             如果是Data,Data在Clk的参照下输出,所以有Logic delay。4 I7 A$ r# ]. @+ W, U8 H8 c' j/ t
             如果是clk,则C点输出的clk是由A点输入的clk处理得到的。* ?* v1 b1 G! ~) }( d" Z
             这样理解对吗?
6 q" I- k  U. K             A点输入的CLK是驱动信号吗?(晶振产生的clk或别的IC提供的clk)
5 N7 `" I9 `4 A0 D4 @9 i7 ]+ W            我们在用SQ仿真时,仿真图上只有buffer delay 没有Logic delay ,是这样吗?
% q$ K* P& ~/ R5 b! t. a            那logic delay 对我们没什么作用,是吧!) V6 h7 n* I2 \1 q9 J
问题二:版主说实际系统系统的load情形是不同于test load的。那么就要考虑到如何修正Tco的问题。3 m: I1 |! b% L: b: r$ l9 d3 Z
               1 |) L7 I6 C. S
我们将IBIS模型中的输出参数更改为实际的负载参数,就可以了吧?
; ]/ e4 B9 P: F5 N. O问题三:版主在37楼的图片中,buffer delay waveform 对应下图中的A点波行吗?driver waveform对应c点波形吗?
; r. ]6 f4 c' l& m9 I 4 ?& n4 a' B/ U7 ?  S- E* o$ Q2 x
谢谢版主回答!!!!   不胜感激,嘿嘿!!!

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参与人数 1贡献 +5 收起 理由
forevercgh + 5 积极讨论,要加分哈

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该用户从未签到

174#
 楼主| 发表于 2008-10-28 21:06 | 只看该作者
问题一:时钟同步系统中,C点为所有参考CLK的信号。当然不会是CLK- K) J3 J0 U3 Q9 c7 n8 J
问题二:有人提出过这种方法。我没去验证过,你不妨自己试试。不过,datasheet给的timing参数是test load参数。你即便在IBIS中修改了,也没意义啊,一样是要修正Tco。/ `& C6 @: r0 q/ g/ J' C+ }
问题三:C点
' S/ Q/ w$ s: P7 ~4 X9 T5 u3 ?! ^4 d: y" v/ S
大家多多讨论啊 : L3 M# P" ?5 h

+ L. }  T/ C2 e- P' e9 Y, X 我的都是 一面之词

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175#
发表于 2008-10-29 11:38 | 只看该作者
各位大大好腻害哦,呵呵,学习学习

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176#
发表于 2008-11-7 14:37 | 只看该作者
我也来报道学习了~

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177#
发表于 2008-11-8 22:32 | 只看该作者
学习了不少知识

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178#
发表于 2008-11-24 17:25 | 只看该作者

看看,谢谢!!

看看,谢谢!!

该用户从未签到

179#
发表于 2008-12-2 09:59 | 只看该作者

回复 1# 的帖子

谢谢,辛苦了

该用户从未签到

180#
发表于 2008-12-5 14:19 | 只看该作者
学习学习
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