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主板上这两部份电路为什么这样设计?

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发表于 2008-11-17 18:31 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
如下图所示为电脑主板一小部分:
! b9 G( D4 |9 N9 Z& h. L+ _( B                        1、为什么在电源+5V与+3V之间要跨接两个0603的小电容c544 和c545?
. w$ ^% t" N9 \3 }4 V5 ^                        2、右图VCCM是直流电压,U_MAA[0:2]是一些到CPU的地址线,但中间为什么会是电容C164 C158。。。?0 y) H$ u6 i: [7 w  y7 `6 `6 n
请问此种电路设计有什么用意,谢谢7 ~" f% E: K" n' W

0 ?7 v3 K* F- k; U: a  l
* K' d0 j6 x7 z$ h" @ ' Y2 d7 T1 n% A  @& T) G0 x6 [

& P8 _: S! \6 b- `7 ^[ 本帖最后由 adwordslai 于 2008-11-19 11:38 编辑 ]; r" `% Z/ k% f' @% t' f
5 y+ |+ G# n5 M* ~" P! m: d. }
补充内容 (2011-8-31 17:46):
' i. |, G7 {( C8 B! @4 y想BS偶的先看看7楼的斑斑回复, 不懂还很XZ呀。。。

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发表于 2010-10-3 14:20 | 只看该作者
我说说我的看法,根据 Eric Bogatin 信号完整信中 的观点 :高速信号的返回路径会选择阻抗最低的路径,这转化到回路电感最低的路径,即返回路径电流必将尽量靠近信号电流,频率越高,返回电流直接在信号电流下面这种效应就越明显。当信号频率高于10M时,绝得大多数返回电流都将直接在信号下方流动(信号下方要有完整平面)。当出现分割平面时,要是高速信号要跨越分割平面为了EMC,最好要在信号跨接区域跨接小电容,以提供高速信号的一个低阻抗路径,要是没有此低阻抗路径就必将增大返回路径的阻抗,当阻抗达到可以和空气的特征阻抗可以相比拟时,信号将以电磁波的形式发送出去,必将引起EMI。在下愚见,不知正确与否!

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发表于 2010-3-5 11:23 | 只看该作者
这叫缝合电容(stitch cap),在电源层被分割,而又作为参考平面时,就需要这样的电容,给高速提供回流路径。一般4对高速差分信号可以共用一个这样的电容,且电容放置在高速信号跨分割区域200mil以内。这是INTEL的设计指导上说的。

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发表于 2012-8-23 16:33 | 只看该作者
里面的内容,大家看看就理解第一种的意思了

在真實世界中的EMI控制(中文完整版).pdf

4.09 MB, 下载次数: 5203, 下载积分: 威望 -5

大家参考里面的内容,EMC方面的,很有帮助

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发表于 2009-12-13 20:33 | 只看该作者
电源之间跨接的电容能起到一定的抗干扰作用,只要布线良好的话,也可以不要的,

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发表于 2012-2-3 11:24 | 只看该作者
第一种大家基本说的对了,就是为高速跨分割平面时,提供信号回流路径的!
1 A  l& \, }# d+ H第二种,我认为是因为地址线是以vccm为参考的,在高速电路中,没有真正的地,只有参考平面和回流路径才有意义。所以滤波电容直接接到vccm上,而不是接到地上。如果以地为参考,那就接到地上了!

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发表于 2009-3-23 22:01 | 只看该作者
或许第一个问题真的如7楼斑竹所讲
6 j( m! T) V; H0 V/ f0 |; `) c可能两个电源共地,电源之间的电容提供回路,避免电源之间的干扰* s8 M9 v" Z5 M0 B& m/ _
$ Z- }! o+ D4 R" Q7 j+ I$ O
第二个问题有几种可能* W. @; Z3 \0 t$ Q
1、阻抗匹配的
% \4 a2 J3 m, H) C3 {' y" C) }2、滤除引脚上的高频噪声5 @7 \" z/ Y3 G  x9 b6 a! u
3、延长边沿时间5 B. P& ?2 U" I" B8 c0 j9 `& w. ^1 d

) `$ H8 L. [4 O' w- L- K9 B. u纯属个人臆断,请各位指教

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发表于 2009-3-13 10:24 | 只看该作者
我猜地址线需要被上拉,但是为了防止直流电平倒灌到CPU,所以用电容隔开~2 U- m3 ^9 H( L/ y* A6 X: G3 O! D
至于为什么要用22P,应该和地址线的速率有关

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发表于 2012-9-22 21:18 | 只看该作者
我理解地址线上的电容是端接电容,提高信号质量的,有空把电容去了量下信号,再把电容焊上量下信号。对比下信号结果就出来了。

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发表于 2012-8-23 16:31 | 只看该作者
C:\Users\Administrator\Desktop\2012-8-23 16-21-17C:\Users\Administrator\Desktop\2012-8-23 16-13-57
4 W6 c6 [3 ]9 L7 V* q+ B第一种在计算机等的主板上很常见,其实主要是考虑一个回流路径的问题,因为高速信号总是会有参考的回路平面的,当原来参考的平面中断而去参考其他平面时,为了较小回路阻抗,会加这样的104电容,主要还是电磁兼容方面的;第二种我就不晓得了,个人认为是阻抗的问题吧,哈哈,愚见。第一个问题,74楼回答的很好,在《在真实世界中的EMI控制(中文完整版)》书上有这样的理论介绍的,大家可参考。

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 楼主| 发表于 2011-8-31 17:41 | 只看该作者
本帖最后由 adwordslai 于 2011-8-31 17:44 编辑
: {7 a& t6 H. E" J5 Z
( k' U- Y- c0 `8 q哇塞,看了好多人要BS偶。。。没办法。。。谁叫7楼的斑斑不懂还态度XZ啊{:soso_e116:}

点评

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反对!: 5
XZ?看了几个楼层发现你也好不到哪去  发表于 2013-10-24 09:18

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12#
 楼主| 发表于 2008-11-19 22:03 | 只看该作者
怎么没人啊,专搞硬件电路的人呢,去哪啦

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13#
发表于 2008-11-20 19:35 | 只看该作者
没见过这种设计

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14#
 楼主| 发表于 2008-11-20 20:26 | 只看该作者
原帖由 chenlei2004 于 2008-11-20 19:35 发表
6 e3 W2 c0 l. V9 l$ k, i6 U. X2 o+ ~没见过这种设计
# x6 V2 c4 u: B, _$ ^% |4 x
这个可是电脑主板上的哦。。。谁见过?

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15#
发表于 2008-11-21 09:39 | 只看该作者
有没有设计电脑的大大解释一下啊?

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16#
发表于 2008-11-21 14:48 | 只看该作者
我也遇到过第二种的情况,迷惑% `! R+ Z" T4 }2 \7 g& b
请高手指点

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17#
发表于 2008-11-21 22:42 | 只看该作者
为什么跨接?!你看看PCB上两个电容的位置! 是不是跨接再分割的电源平面上! 再来问这问题

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18#
 楼主| 发表于 2008-11-21 23:04 | 只看该作者
原帖由 zyunfei 于 2008-11-21 22:42 发表
2 E. k; U4 `* ]: W为什么跨接?!你看看PCB上两个电容的位置! 是不是跨接再分割的电源平面上! 再来问这问题

. ^- D1 P7 F  m: K1 }老大,你没见过这种情况是不是?那第二种情况呢?

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19#
 楼主| 发表于 2008-11-22 17:58 | 只看该作者
以上已经搞懂了,也可以删贴,呵呵。。。上面几位会员(来加加人气谁知...)不清楚的尽可以去问斑竹大大哈。。。这是他的工作不会不耐烦的,除非他也不懂% d' W4 P$ U$ G! K1 Z
$ S% d3 c# v( D& z' j; l: }
[ 本帖最后由 adwordslai 于 2008-11-22 18:01 编辑 ]

点评

反对!: 5.0 支持!: 1.0
一句話…………不懂!^_^  发表于 2014-8-28 14:18
支持!: 1
搞懂了给我们解释一下呗。你说这是斑竹的工作?好像你理解不对吧.....你给我们解释一下吧,别卖关子  发表于 2012-11-24 18:27
反对!: 5
知道了还不说 BS  发表于 2012-11-14 15:14

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20#
发表于 2008-11-24 19:44 | 只看该作者
麻烦楼主 请解释一下为什么这么设计呢?我还不懂

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21#
发表于 2009-3-12 22:58 | 只看该作者
第二中设计是什么意思?

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22#
发表于 2009-3-13 13:24 | 只看该作者
我猜地址线需要被上拉,但是为了防止直流电平倒灌到CPU,所以用电容隔开~
4 X( T/ o: ~- J) Q$ `5 b9 s至于为什么要用22P,应该和地址线的速率有关
% m& y( z- K% I$ q* tbiershuai 发表于 2009-3-13 10:24
8 g5 U" _  ]* G% L
防止直流电平倒灌到CPU?还是不太明白,请具体讲解讲解

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23#
发表于 2009-3-15 13:25 | 只看该作者
你看图可以知道,上拉是在电容隔开以后!

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24#
发表于 2009-3-18 22:53 | 只看该作者
乱七八糟,没一个说得明白的,等待正解
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