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Cadence Allegro论坛今日: 27 |主题: 33998|排名: 5

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哇赛，allegro 24.1居然支持纯中文，不需要改环境变量。 10人参与	vimgcc 2025-3-6 11:30	20 1641	一路向南23 2025-3-31 17:30
Allegro关于铺铜的疑问 2人参与	elec32156 2025-3-21 14:28	3 430	elec32156 2025-3-31 09:42
孔电流计算参数温升是什么？ 3人参与	jinputou 2025-3-28 17:08	5 308	db-_- 2025-3-29 11:50
allegro怎么导出odb++文件（附上图片） 30人参与 ...2 3	蓝色的天口 2015-12-1 08:41	31 24440	Trump_Lan 2025-3-28 17:49
allegro16.6导出DXF不显示盘中孔 3人参与	QIQIQIQAQ灬 2025-3-27 11:44	4 347	QIQIQIQAQ灬 2025-3-28 16:34
ALLEGRO PCB 短路端子较多，就一个短路问题，但爆出过个短路DRC？. 3人参与	jinputou 2025-3-27 20:44	3 307	七彩雨 2025-3-28 15:47
下载的这个drc_walk.il skill工具不会使用，帮忙看看 3人参与	jinputou 2025-3-26 13:20	5 278	jinputou 2025-3-27 20:21
第3方网表导入没有找到元件封装？ 3人参与	way 2025-3-26 14:13	3 182	way 2025-3-27 11:52
ALLEGRO倒入DXF文件很多不规则弧线消失 8人参与	wxsl711 2015-8-12 20:42	9 2671	ice201007 2025-3-27 11:32
orcad 17.4图面边框显示过大 1人参与	每天学一点 2025-3-26 16:23	1 183	Getaway 2025-3-27 11:21
Allegro使用SigXplorer快速设置规则出现错误，求助	hz20120501 2025-3-26 17:56	0 74	hz20120501 2025-3-26 17:56
ALLEGRO PCB 短路端子较多，修改主板后DRC多出几个DRC，如何快速找到DRC位置？ 5人参与	jinputou 2025-3-25 19:10	7 1672	db-_- 2025-3-26 13:40
根据位号导入器件高度到PCB中 5人参与	zfd552487261 2025-3-5 18:07	14 380	zfd552487261 2025-3-25 16:52
Cadence原理图用滚轮缩放时光标乱跑，且不以光标为中心缩放 2人参与	elec32156 2025-2-23 09:52	2 508	larry5075 2025-3-25 14:37
capture内存泄漏问题 2人参与	hdjun 2025-3-24 08:10	2 1758	centem2015 2025-3-25 08:27
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allegro中为什么不能对routekeep in每层分别设置啊？ 7人参与	tangqianfeng 2025-2-20 13:40	10 558	姽婳涟翩 2025-3-21 17:40
Cadence PCB绘制中，异形尺寸如何标注？ 3人参与	Harley123 2025-3-17 13:51	3 343	kingweison 2025-3-21 15:43
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