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PORTRIGHT-L,PORTRIGHT-R等DRC错误 2人参与	bluskly 2023-3-20 16:14	2 539	bluskly 2023-3-20 21:18
orCAD Allegro PCB未响应白屏卡死 1人参与	ifisong01 2023-3-20 17:49	1 456	ggfhkl45 2023-3-20 18:04
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为啥出gerber时，在pastemask 层，会有底层和顶层重叠的器件 4人参与	panhaojie 2023-3-20 14:31	5 729	intX 2023-3-20 16:12
板子崩掉，打不开 7人参与	鬼卿y 2023-3-6 09:34	9 932	sphai 2023-3-20 14:15
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Cadance 17.4 丝印自动居中功能 2人参与	fanliqiang 2023-3-19 11:39	2 1976	451506709 2023-3-19 16:40
cadence16.6软件的问题 2人参与	chanfu 2023-3-17 15:59	2 334	koni 2023-3-17 20:29
请教一下负凹蚀 1人参与	tusili2022 2023-3-17 17:58	1 363	niubility 2023-3-17 18:03
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器件靠太近时能为啥不报错呢？求解~ 2人参与	leoyin 2023-3-15 11:31	3 745	leoyin 2023-3-17 02:53
485 232 还有can这种线需不需要使用差分布线规则 5人参与	风吹过后 2023-3-16 13:42	5 786	aarom 2023-3-16 23:52
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cadence APD/Sip 论坛里做封装设计的来举个手 14人参与	pjh02032121 2012-8-30 14:07	12 2236	胡椒盐 2023-3-16 21:13
Allegro封装高度，新手，请各位大侠帮忙 16人参与 ...2	风吹过后 2023-3-13 13:44	17 1701	lc1234 2023-3-16 17:04
请教一下，在走线时，走线的两头拐角处会有两个点一样的线，有办法能批量处理吗？ 3人参与	tangqianfeng 2023-3-14 17:17	4 535	layout1980 2023-3-16 11:36
关于cadence导出网表失败 2人参与	风吹过后 2023-3-15 13:52	2 353	Maskman 2023-3-15 16:03
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服用模块后奇怪的drc怎么消除 2人参与	ann_wz 2023-3-15 08:45	2 606	ann_wz 2023-3-15 11:19
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