发块PCB,请大神们帮忙看看有木有什么我忽略掉的问题存在,感激ing....

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花了10天不到的时间layout出来的,时间有点紧,大家帮忙指点指点...感谢中...{:soso_e183:}
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2012-11-12 13:16 上传

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清风拂面

Larry_11844 发表于 2012-11-13 09:35
6 z* m) W( A7 g% Q9 r$ z+ i) Q楼上说的也不完全对，就针对第五条吧，
首先没有看见板子上面的只做工艺，所以焊盘打孔不一定错。
其次 ...

0.4mm BGA基本上都是打在焊盘上的。
3 n& ?5 F* |. c' @5 k7 D1 E

Jovian

大神，能把你的板子的PCB发给我看看的吗？

lyh0739

我不懂，就看看高手点评

lap

板子时间方面还算可以，但是效果就不太理想了。下面是我个人的一些看法（只对事不对人）：
" g5 ]- @1 Z( o$ h* M" E1、整板阻抗没控制（不管是差分还是单端）。
4 [5 R  p! A( S! F2、主芯片与DDR之间拉的太远，且DDR根本没必要打盲孔。
( @" b* f9 q& d: Q; ^3、整板没有回流孔，我看你上面有的信号线有做包地处理，但没见到接地孔。最少也要满足λ/20 。且信号换层旁边没有地孔。这叫典型的，只管信号出去却不管信号回来问题。
4 e/ E0 J1 w# e( N* A4 @/ z4、焊盘的开窗值太大，一般设置在2.5mil即可。
5、丝印上焊盘。
, ]' h5 I, R# Y0 a3 V8 A; Q6、过孔上焊盘。
! P' P  [: P1 N/ w+ w7 h+ D7、过孔1.0mm孔径盘1.1mm不好加工。
8、DDR时钟串阻应该靠近主芯片而不是DDR。
0 D( b* O( ^6 U; C  x* Q) t9、电源载流问题没考虑，不管是过孔数量还是电源线的粗细。
* k1 }* I% d+ n" @. K10、器件与器件之间的距离太近。
11、拼板方式应该采用邮票孔加V-CUT方式。
$ g" J6 ^9 b) T8 H% R; `& N12、DDR的数据线和地址线过孔数量太多。
13、平面层改为负片。
; \3 U8 X2 q8 s6 o' u9 Q/ K等等.......在我们这边这样的板子是不允许打样的。

77991338

lap 发表于 2012-11-12 14:10
板子时间方面还算可以，但是效果就不太理想了。下面是我个人的一些看法（只对事不对人）：
1、整板阻抗没控 ...

谢谢指点...我试着改改看...

黑驴蹄子

偶来看看

黑驴蹄子

搞了半天是ARM11的三星6410
5 A8 D- H8 |% L" C  {这个封装有问题，不知道77哪里弄的封装，solder太大了
, L7 }$ N, H( s9 U盲孔全打BGA焊盘上了
. e1 M  s( b0 x& |1 `2 r, t! ^' p# s& i内电层用负片多方便。
' v9 N4 Q6 A( A" d: P6 d
$ h) r! ~/ |8 M) ?1 N我的机子卡，不看了

eeicciee

谁发张图片来看看呀？？公司下载不了

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黑驴蹄子 发表于 2012-11-12 15:06
& S1 S% r8 G* b6 O$ c/ l搞了半天是ARM11的三星6410
# {4 \- {& B1 ~" {这个封装有问题，不知道77哪里弄的封装，solder太大了
6 |% B% I) _& r盲孔全打BGA焊盘上了:l ...

这个不知道...我调用的库都是他们以前做核心板上面用过的6410的库...这个还真没注意到...我画的过程中两个solder层都没开...汗啊...

77991338

eeicciee 发表于 2012-11-12 15:10
% z( j* S: V/ z# J% m8 G6 x谁发张图片来看看呀？？公司下载不了

! `% C9 U) g& O* O6 `, F2 y* t. V" H
: y* v" d% H3 g$ |# h# z8 U3 G铜皮我隐藏了...嘿嘿...

eeicciee

77991338 发表于 2012-11-12 15:14
) ?: E. Z6 {8 |3 S6 Y) m& z! Y  N铜皮我隐藏了...嘿嘿...

2 X# T5 Z, G. {# x; D! H' VLZ的布局很整齐。
1 A  ~. ]0 g7 k不过lap提的问题很尖锐，也很正确。你要好好理解加油哟。

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eeicciee 发表于 2012-11-12 15:21
* Q, }' y7 D) S! sLZ的布局很整齐。
不过lap提的问题很尖锐，也很正确。你要好好理解加油哟。

" F' c6 f9 l$ o2 x0 L+ @
5 _  c7 K% \# g4 j9 J是呢...由于时间比较紧张...又是个项目中的模块拼凑起来做一个新的项目...光整理原理图检查原理图就花了我不少时间...所以在layout上面有的毛糙...很多地方都不是很注意...而且结构上也是个大麻烦啊...整的我手忙脚乱的好不容易搞出来了怕有些地方自己检查不到才发上来找大家帮我提提意见的...突然感觉EDA365很爽啊...人多力量大..看问题比较全面..省去我很多检查时间...嘿嘿

黑驴蹄子

77991338 发表于 2012-11-12 15:26
; E7 G: u1 e# t4 {: p$ U& Z是呢...由于时间比较紧张...又是个项目中的模块拼凑起来做一个新的项目...光整理原理图检查原理图就花了 ...

{:soso_e144:}

lap

- x8 W% B+ ^9 n& {5 Y/ P) [
% i$ K: y% ]: L! a2 u0 V$ P上传一张6410芯片扇孔图片。L1-L2盲孔板。
( M$ A  |# \' ^* ~, x! n7 k

77991338

lap 发表于 2012-11-12 16:47
; c" K. F# N$ O6 a7 n7 [上传一张6410芯片扇孔图片。L1-L2盲孔板。

0 T4 V8 r( W  x% u' {1 Y: n

77991338

lap 发表于 2012-11-12 16:47
) i/ `$ @- e# V/ N上传一张6410芯片扇孔图片。L1-L2盲孔板。

3 h' @- \) i/ e感觉比我的有条理很多啊...哎..还是经验不够啊...走线条理有点乱...

flyover

差分表层走得也太长了吧。，重要信号线要优先走内层，而且线间距也太小了。DDR的距离也太远了，丝印没必要全部框出去标把，而且丝印压着丝印了，电源孔什么的，打得有点密啊。一般同网络孔的间距是至少10mil。差分阻抗也不对。