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EDA365电子论坛网»电子社区 › 研发供应链讨论 › QA检查（免费服务） › 2017年11月5日QA检查报告节选
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2017年11月5日QA检查报告节选

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EDA365QA

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1#
发表于 2017-11-6 10:14 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.匹配电阻应该靠近连接器放置0 F5 I# }2 I$ k+ D6 T' d/ m
& P8 _6 F3 b- d$ q* ~

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发表于 2017-11-6 17:44 | 只看该作者
EDA365QA 发表于 2017-11-6 10:162 X0 e$ N% ^4 Z! x2 r
6.高速线不哟啊在挖空的隔离焊盘下方走线

, O/ ]/ C1 l1 r( C( r- Z你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。/ y  }4 ~2 ]" N& z  I

点评

ccccindy
我的理解是不能在挖空区域底下过 这样参考平面不完整 落在分隔区 走线应该完全落在参考平面上  详情 回复 发表于 2017-11-28 15:40
剑铮奇迹
不是器件，是差分过孔反盘，穿反盘导致那块参考不连续，这种情况是可以避免的  详情 回复 发表于 2017-11-7 15:58
EDA365QA
高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。  详情 回复 发表于 2017-11-7 09:03
Jamie_he2015
应该是，不要在两个过孔之间的挖空区走线  详情 回复 发表于 2017-11-6 18:54

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ccccindy

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发表于 2017-11-28 15:40 | 只看该作者
1023598725 发表于 2017-11-6 17:446 w% e. }7 \# X& O5 q$ w4 W
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
. e  k( F6 u$ P4 l. }' {: x. S- ?# b0 Q
我的理解是不能在挖空区域底下过  这样参考平面不完整  落在分隔区  走线应该完全落在参考平面上# M4 t! h& M% ~& o, V

2.jpg (69.57 KB, 下载次数: 6)

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1023598725
谢谢  详情 回复 发表于 2017-12-4 08:28

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fengyu6117
  • TA的每日心情
    怒
    2020-4-16 15:19

    • 签到天数: 5 天

    [LV.2]偶尔看看I
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    发表于 2017-11-8 09:56 | 只看该作者
    EDA365QA 发表于 2017-11-6 10:150 X( A5 y8 `! x9 |+ `4 {
    4.CAN没有按照差分走线

    # ]; H8 I- k" }8 TCAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。
    . S  \  N/ O& T# \/ m5 _

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    EDA365QA

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    2#
     楼主| 发表于 2017-11-6 10:14 | 只看该作者
    2.电源没有来源  z" U) B$ t+ c, U
    6 M9 h$ i$ V; `1 z; m/ B% C9 T

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    EDA365QA

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    3#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    3.网格部分应该是表层禁布, @8 _+ D4 s4 R: W( L6 I
    3 C% E8 n% t4 s) T

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    jiangriver
    为什么要禁止布线? 没听懂.  详情 回复 发表于 2017-11-7 19:02

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    EDA365QA

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    4#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    4.CAN没有按照差分走线
    % {) [# Z- Z* ^- x1 }5 l3 @' j+ U 3 C  H$ v& \8 |- J! O  b5 H

    点评

    fengyu6117
    CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。  详情 回复 发表于 2017-11-8 09:56
    LiuTao166462139
    can为什么要走查分呢  详情 回复 发表于 2017-11-7 15:49

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    EDA365QA

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    5#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    5.串口电容加粗处理
    & U; z7 {; a2 _! a6 m- |. Z& s- F 6 j5 @; t$ p0 K$ @

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    EDA365QA

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    6#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    本帖最后由 EDA365QA 于 2017-11-7 09:02 编辑 ! u" c5 Z% k4 p, m& e1 u) {

    2 _0 Y/ l/ R- H$ ^8 E( j6.高速线不能在挖空的隔离焊盘下方走线
    - O0 b8 u+ o" T3 V) Z$ z1 v
    & }% \; a5 r/ n  i

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    剑铮奇迹
    也不能说不能走线，完全可以把高速线neck模式不走4/4.改成3.9/3.5或者3.5/3.9，满足背钻要求，也可以穿的啊  发表于 2017-11-7 15:54
    1023598725
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。  详情 回复 发表于 2017-11-6 17:44

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    EDA365QA

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    7#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    7.此电源不需铺平面8 }# x' J' o- {, H' l

    ' w3 Y7 P- f  m, V9 [! C

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    8#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    8.开路
    $ q$ Z) e! a0 M$ b8 j
    : k+ ~, _" [4 j. `0 Q% a9 |' c' f

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    9#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    9.相邻走线层的走线重叠较多% f& b7 B, X# y+ w1 N! t% ~, h" m

    4 ^* A- I$ d0 N

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    10#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    10.485没有走差分
    $ {! O$ R7 D2 o! G   M! d0 J/ y% g0 R

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    Jamie_he2015
  • TA的每日心情
    郁闷
    2024-11-1 15:35

    • 签到天数: 2 天

    [LV.1]初来乍到
    12#
    发表于 2017-11-6 18:54 | 只看该作者
    1023598725 发表于 2017-11-6 17:444 U& A" b$ c2 }+ y( N$ P
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
    0 V/ H0 Z  W3 b! k3 l( O8 n
    应该是，不要在两个过孔之间的挖空区走线

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    谢谢。  详情 回复 发表于 2017-11-7 11:10

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    EDA365QA + 1 热心人！

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    15#
     楼主| 发表于 2017-11-7 09:03 | 只看该作者
    1023598725 发表于 2017-11-6 17:44! `' x6 e$ S- r1 p
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

    ( b1 I. f, [$ V4 S- Y高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。
    ) v4 c3 \# O- x" s

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    1023598725
    受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:10
    1023598725
    受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:09

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