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EDA365电子论坛网»电子社区 › 研发供应链讨论 › QA检查（免费服务） › 2017年11月5日QA检查报告节选
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2017年11月5日QA检查报告节选

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EDA365QA

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1#
发表于 2017-11-6 10:14 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.匹配电阻应该靠近连接器放置; X, o) ?$ d0 N, u% B" @

& ^; N! x9 ~9 v' B0 I6 @

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1023598725

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发表于 2017-11-6 17:44 | 只看该作者
EDA365QA 发表于 2017-11-6 10:167 y$ U) M' I2 B' U( ]% w) c
6.高速线不哟啊在挖空的隔离焊盘下方走线
2 d" Y0 {+ b9 F) f: t- y
你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。" P4 ^$ |* o7 ?; Y1 Q" @; z

点评

ccccindy
我的理解是不能在挖空区域底下过 这样参考平面不完整 落在分隔区 走线应该完全落在参考平面上  详情 回复 发表于 2017-11-28 15:40
剑铮奇迹
不是器件，是差分过孔反盘，穿反盘导致那块参考不连续，这种情况是可以避免的  详情 回复 发表于 2017-11-7 15:58
EDA365QA
高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。  详情 回复 发表于 2017-11-7 09:03
Jamie_he2015
应该是，不要在两个过孔之间的挖空区走线  详情 回复 发表于 2017-11-6 18:54

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ccccindy

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发表于 2017-11-28 15:40 | 只看该作者
1023598725 发表于 2017-11-6 17:44
+ J0 u# x1 e! h' |8 Q; {你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。
9 j0 l8 a) S$ p- o
我的理解是不能在挖空区域底下过  这样参考平面不完整  落在分隔区  走线应该完全落在参考平面上
3 M4 G6 v0 J8 U

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fengyu6117
  • TA的每日心情
    怒
    2020-4-16 15:19

    • 签到天数: 5 天

    [LV.2]偶尔看看I
    推荐
    发表于 2017-11-8 09:56 | 只看该作者
    EDA365QA 发表于 2017-11-6 10:15
    - \) R: p( h8 b& L# V* D4.CAN没有按照差分走线

    9 l" x# m  N' _% m) j; `CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。- ^: E  m9 S0 J3 K9 R' F7 K( A! i

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    EDA365QA

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    2#
     楼主| 发表于 2017-11-6 10:14 | 只看该作者
    2.电源没有来源
    2 `( v: N9 `0 k: ~ / |! V( P) w4 H0 c7 U2 `

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    EDA365QA

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    3#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    3.网格部分应该是表层禁布9 x6 Q0 R2 g- B0 V2 n9 H+ A* D
    + t7 w5 K8 z  x. r$ R! M

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    jiangriver
    为什么要禁止布线? 没听懂.  详情 回复 发表于 2017-11-7 19:02

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    EDA365QA

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    4#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    4.CAN没有按照差分走线, r/ B) y! Q4 Q# G3 O

    + A: @( d2 Q0 A. q1 t  u% {% V8 u% F

    点评

    fengyu6117
    CAN总线是差分，但是速度慢，要求不严格，做类差分就可以，阻抗没要求（貌似CAN可以传数字或模拟信号），差分等长不差太多就好。  详情 回复 发表于 2017-11-8 09:56
    LiuTao166462139
    can为什么要走查分呢  详情 回复 发表于 2017-11-7 15:49

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    EDA365QA

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    5#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    5.串口电容加粗处理* g, |- j  B6 q! H
    , F0 Q( ?& V7 B) e" ~0 I0 q

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    EDA365QA

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    6#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    本帖最后由 EDA365QA 于 2017-11-7 09:02 编辑
    3 P3 P& W, @' l" L; u  W
    * e% o- d& f" s' s/ v6.高速线不能在挖空的隔离焊盘下方走线: D* w6 b6 j. R* e/ d( Q0 Y6 d

    : n5 ?$ p, F5 X) [4 f+ c

    点评

    剑铮奇迹
    也不能说不能走线，完全可以把高速线neck模式不走4/4.改成3.9/3.5或者3.5/3.9，满足背钻要求，也可以穿的啊  发表于 2017-11-7 15:54
    1023598725
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。  详情 回复 发表于 2017-11-6 17:44

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    EDA365QA

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    7#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    7.此电源不需铺平面( z4 c4 ~1 V7 t- M4 n! _! d
    4 y1 }  M9 e8 a1 n2 Z

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    EDA365QA

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    8#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    8.开路- p: {& p* E5 E) Q

    5 h7 ]- r1 J# }

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    EDA365QA

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    9#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    9.相邻走线层的走线重叠较多
    5 D9 Y# H* |# \# x( m& w4 q 7 G1 N# r+ M5 X! T+ g3 \

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    10#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    10.485没有走差分+ b. b, X  W4 E2 \( N) W% y7 ?

    4 L' t5 r8 C9 `/ q

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    Jamie_he2015
  • TA的每日心情
    郁闷
    2024-11-1 15:35

    • 签到天数: 2 天

    [LV.1]初来乍到
    12#
    发表于 2017-11-6 18:54 | 只看该作者
    1023598725 发表于 2017-11-6 17:44/ ~3 i6 h5 L3 S, P  h
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

    * H' v3 H% l0 p3 {应该是，不要在两个过孔之间的挖空区走线

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    1023598725
    谢谢。  详情 回复 发表于 2017-11-7 11:10

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    EDA365QA + 1 热心人！

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    EDA365QA

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    15#
     楼主| 发表于 2017-11-7 09:03 | 只看该作者
    1023598725 发表于 2017-11-6 17:444 Y4 X+ I: c/ q- X
    你好，请问是不能在器件下方走线吗？看不太懂这张图，求解释谢谢。

    / }' `7 O% `; K$ E/ k高速线要保证完整的参考平面，现在有些走下两个孔之间的反焊盘了。
    : x: M( G( k6 @0 _1 h, G4 v

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    1023598725
    受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:10
    1023598725
    受教了，谢谢版主。  详情 回复 发表于 2017-11-7 11:09

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