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2017年11月5日QA检查报告节选

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1#
发表于 2017-11-6 10:14 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
1.匹配电阻应该靠近连接器放置9 ~- j" S! C! W1 q; \$ [( y+ N, }

" E: L  z5 W5 A  V0 {* A1 G$ J- `

该用户从未签到

推荐
发表于 2017-11-6 17:44 | 只看该作者
EDA365QA 发表于 2017-11-6 10:16. P3 H4 [- ]2 n% f4 A4 r
6.高速线不哟啊在挖空的隔离焊盘下方走线
0 ^- P3 w  u" D9 W0 [1 e
你好,请问是不能在器件下方走线吗?看不太懂这张图,求解释谢谢。: P$ ]5 E) O* L. T, M

点评

我的理解是不能在挖空区域底下过 这样参考平面不完整 落在分隔区 走线应该完全落在参考平面上  详情 回复 发表于 2017-11-28 15:40
不是器件,是差分过孔反盘,穿反盘导致那块参考不连续,这种情况是可以避免的  详情 回复 发表于 2017-11-7 15:58
高速线要保证完整的参考平面,现在有些走下两个孔之间的反焊盘了。  详情 回复 发表于 2017-11-7 09:03
应该是,不要在两个过孔之间的挖空区走线  详情 回复 发表于 2017-11-6 18:54

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发表于 2017-11-28 15:40 | 只看该作者
1023598725 发表于 2017-11-6 17:44
; z& c3 G- I* ^% _, Z你好,请问是不能在器件下方走线吗?看不太懂这张图,求解释谢谢。
6 k' Q$ w; ?6 C6 P* @/ r
我的理解是不能在挖空区域底下过  这样参考平面不完整  落在分隔区  走线应该完全落在参考平面上
4 m: b8 |9 p( p( X

2.jpg (69.57 KB, 下载次数: 3)

2.jpg

点评

谢谢  详情 回复 发表于 2017-12-4 08:28
  • TA的每日心情

    2020-4-16 15:19
  • 签到天数: 5 天

    [LV.2]偶尔看看I

    推荐
    发表于 2017-11-8 09:56 | 只看该作者
    EDA365QA 发表于 2017-11-6 10:15
    ' G/ p4 A* x3 C; a3 z4.CAN没有按照差分走线

    . u* C+ |: T, t1 i; O9 I, V5 ?% wCAN总线是差分,但是速度慢,要求不严格,做类差分就可以,阻抗没要求(貌似CAN可以传数字或模拟信号),差分等长不差太多就好。9 m+ p4 v0 `+ X

    该用户从未签到

    2#
     楼主| 发表于 2017-11-6 10:14 | 只看该作者
    2.电源没有来源
    3 ]0 A8 r- h! n" [ ; H; ^" G. A& \% k

    该用户从未签到

    3#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    3.网格部分应该是表层禁布* R- [! ^3 j/ @' F: H
    / h- e- p; e8 z; ]+ ?. X  e

    点评

    为什么要禁止布线? 没听懂.  详情 回复 发表于 2017-11-7 19:02

    该用户从未签到

    4#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    4.CAN没有按照差分走线
    4 D9 H( `  f) @* @. c 6 J6 S- @4 v* v2 Q4 f

    点评

    CAN总线是差分,但是速度慢,要求不严格,做类差分就可以,阻抗没要求(貌似CAN可以传数字或模拟信号),差分等长不差太多就好。  详情 回复 发表于 2017-11-8 09:56
    can为什么要走查分呢  详情 回复 发表于 2017-11-7 15:49

    该用户从未签到

    5#
     楼主| 发表于 2017-11-6 10:15 | 只看该作者
    5.串口电容加粗处理. U' e. A. d" P5 P- W  E3 y

    , m1 k" A- R+ J8 X& [

    该用户从未签到

    6#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    本帖最后由 EDA365QA 于 2017-11-7 09:02 编辑 + y) C. j. u& p0 S% `7 v( Y+ @

      l) Y, ]" m2 s. H3 w6.高速线不能在挖空的隔离焊盘下方走线; i  a8 e- q5 k, l& @1 H" C

    3 k3 j/ f" H& r7 D# h+ z' ]

    点评

    也不能说不能走线,完全可以把高速线neck模式不走4/4.改成3.9/3.5或者3.5/3.9,满足背钻要求,也可以穿的啊  发表于 2017-11-7 15:54
    你好,请问是不能在器件下方走线吗?看不太懂这张图,求解释谢谢。  详情 回复 发表于 2017-11-6 17:44

    该用户从未签到

    7#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    7.此电源不需铺平面
    . A" z( p7 Q2 E5 m) x 5 a8 X2 m4 e5 F! \; ?7 E

    该用户从未签到

    8#
     楼主| 发表于 2017-11-6 10:16 | 只看该作者
    8.开路
      c) x7 e- ~3 @1 A( |  B 4 ]' [; _, D# }. ~! J

    该用户从未签到

    9#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    9.相邻走线层的走线重叠较多  \- U- F7 Q5 V  _. Z8 g) w

    8 r( O6 p! P# R9 _' C

    该用户从未签到

    10#
     楼主| 发表于 2017-11-6 10:17 | 只看该作者
    10.485没有走差分5 P9 u/ K% e/ p# \7 j
    ; E$ T0 |; [6 k0 c5 o
  • TA的每日心情
    郁闷
    2024-11-1 15:35
  • 签到天数: 2 天

    [LV.1]初来乍到

    12#
    发表于 2017-11-6 18:54 | 只看该作者
    1023598725 发表于 2017-11-6 17:44  P  S; ~$ Q/ `
    你好,请问是不能在器件下方走线吗?看不太懂这张图,求解释谢谢。
    - z6 ~" a+ I* u. O0 N# k+ P+ T% R
    应该是,不要在两个过孔之间的挖空区走线

    点评

    谢谢。  详情 回复 发表于 2017-11-7 11:10

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    参与人数 1威望 +1 收起 理由
    EDA365QA + 1 热心人!

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    15#
     楼主| 发表于 2017-11-7 09:03 | 只看该作者
    1023598725 发表于 2017-11-6 17:44$ t, @- F) T7 t6 Q* B9 Z+ X
    你好,请问是不能在器件下方走线吗?看不太懂这张图,求解释谢谢。

    * ?/ H  o" R' W高速线要保证完整的参考平面,现在有些走下两个孔之间的反焊盘了。
    ; K. u. a0 e! T% E' l) h

    点评

    受教了,谢谢版主。  详情 回复 发表于 2017-11-7 11:10
    受教了,谢谢版主。  详情 回复 发表于 2017-11-7 11:09
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