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自己叠了个22层板 板厂说不合理 请高手指正

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1#
发表于 2015-9-10 17:34 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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如图
$ j, J2 |  b% d7 A) E% w0 D: K

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 楼主| 发表于 2015-9-11 17:18 | 只看该作者
本帖最后由 65770096 于 2015-9-11 17:24 编辑 " e" ~! }( y: w
cloudy19880824 发表于 2015-9-11 16:12: N  V, `, W% }' U# v' X
恩,是的,即便用3.8的介电常数这个阻抗还是到不了90欧。- @6 U' i8 L9 r7 u
当然了,如果只有G02作为参考曾,G04不作为参 ...
7 o1 l6 A8 F3 l6 D) F7 @0 Q
只参考g02不参考g04有100欧姆这个是理论值吗?只是计算的时候选择不同的模型?: r0 c* u* F  p. A$ t" C
例如下图这种?能不能把你计算的模型和数值截图看看,只参考g02的和两面都参考的这两种的。' k6 u) O- ?. i9 C, W$ c
板子上实际的情况哪条线的阻抗是多少不应该是一个固定的值吗?信号线不是和他的上下面都会有关系的吗?9 K) Z1 G5 J( f7 l

* h0 m( g  Q+ U! |
- U  G. J# h. `% {/ `- b) b8 D8 H" s

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 楼主| 发表于 2015-9-10 18:08 | 只看该作者
本帖最后由 65770096 于 2015-9-10 18:10 编辑
( m! p  Y# J4 i+ v( I0 ^
ibe3250 发表于 2015-9-10 18:04
7 A5 x/ i# V7 n: l1 m1 k. \. X叠层没问题,是不是加工厂没有22层的叠加或阻抗的控制能力.LZ曝料下

+ {* K5 \( u+ ~6 |8 v是不是我的top和g02 g02和g03之间都用的pp的问题?应该是top和g02之间pp然后依次是core-pp-core这样下去  到最后g21和bottom之间用pp?
5 U6 Y1 ~: \# e' n6 _) O0 x4 f一般的常规板子的压合是不是应该只有top bottom用pp  中间的都是core-pp-core这样的?例如上面的22层的 对称的板子  中间两层电源
. }) }$ }% v  Q1 j3 q8 G5 B: r7 V- R6 R3 X9 {8 C$ B

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发表于 2015-9-14 12:39 | 只看该作者
65770096 发表于 2015-9-14 10:44
. e0 N# d" s: Y/ P! ?7 ~/ J, Q第一张图第二张图的区别在哪  不是都参考的下面的平面吗?而且上面都没东西啊,我之前问过有人说是走线梯 ...
! o, q% F7 q+ D; ~" O/ S9 P
对的,两个图的区别就是一个是参考G02,一个参考G04,因为铜箔是附着在core上的,腐蚀的时候从上向下,所以肯定是宽的一面是core,由于SI9000都把参考层放在了下面,只是通过梯形的方向来区分就好
4 S8 L, h2 H7 W' V2 L

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5#
发表于 2015-9-10 17:43 | 只看该作者
不合理能具体点吗?过于笼统不好分析 / w3 L) X2 z8 G7 o7 Q

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6#
 楼主| 发表于 2015-9-10 17:47 | 只看该作者
就说不合理,我也搞不清楚。22层 2.2mm厚的板子  叠层顺序就是上面的那样,你能看出来哪不好吗?

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7#
发表于 2015-9-10 22:10 | 只看该作者
走线太细,间距太开,差分线都快赶上单端了

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那判定差分还是单端是不是应该有个标准,比如间距大于多少,或线宽的范围?  详情 回复 发表于 2015-9-11 09:33

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8#
发表于 2015-9-11 00:03 | 只看该作者
确实有一些不符合常规。如果不是HDI板的话,一般G02到S03使用的是core,这样比较方便些。至于其他的应该问题都不大。另外有可能是楼上讲的,你问的板厂做不了这个板子

点评

常规的做法是不是top bot用的是pp 其他都是core 然后用pp连在一起?  详情 回复 发表于 2015-9-11 09:34

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9#
 楼主| 发表于 2015-9-11 09:33 | 只看该作者
True 发表于 2015-9-10 22:10
. n' }8 \* u4 m走线太细,间距太开,差分线都快赶上单端了

8 p3 ^( O1 [; }& _: A那判定差分还是单端是不是应该有个标准,比如间距大于多少,或线宽的范围?$ z1 R. V" J: w% w

点评

间距大,差分线的耦合很弱了,线宽这么细,阻抗会差得很。 线宽这么细,损耗也非常大。标准倒没有看到, 还有 PP在上下层,还要买铜泊。  详情 回复 发表于 2015-9-11 11:23

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10#
 楼主| 发表于 2015-9-11 09:34 | 只看该作者
菩提老树 发表于 2015-9-11 00:039 \1 ~( F) K1 w1 ]0 k
确实有一些不符合常规。如果不是HDI板的话,一般G02到S03使用的是core,这样比较方便些。至于其他的应该问 ...

1 f9 s  }7 _& n9 r3 T: b常规的做法是不是top bot用的是pp  其他都是core 然后用pp连在一起?
8 A: i% I' @5 Y, ~; O$ M6 k

点评

没错,确实如你所说,但是你现在的却不是那样的  详情 回复 发表于 2015-9-11 12:48

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11#
发表于 2015-9-11 11:23 | 只看该作者
65770096 发表于 2015-9-11 09:33
3 q8 j% m6 t( Z4 ^5 y那判定差分还是单端是不是应该有个标准,比如间距大于多少,或线宽的范围?

% y$ H4 t% R" K% i间距大,差分线的耦合很弱了,线宽这么细,阻抗会差得很。 线宽这么细,损耗也非常大。标准倒没有看到, 还有  PP在上下层,还要买铜泊。

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12#
发表于 2015-9-11 12:48 | 只看该作者
65770096 发表于 2015-9-11 09:34
6 K6 m; r1 X+ C& L+ j2 L% ]( P常规的做法是不是top bot用的是pp  其他都是core 然后用pp连在一起?
# @/ V$ z% V+ b0 }
没错,确实如你所说,但是你现在的却不是那样的

点评

非常感谢!  详情 回复 发表于 2015-9-11 13:00

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13#
 楼主| 发表于 2015-9-11 13:00 | 只看该作者
菩提老树 发表于 2015-9-11 12:48: U, l5 u7 C" f) @& M; m3 R
没错,确实如你所说,但是你现在的却不是那样的
$ H# G% M$ V  P. `. u) C
非常感谢!
4 G# Y) ]* n# y. {  y; O

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14#
发表于 2015-9-11 15:01 | 只看该作者
确实感觉这个线宽和线距,在当前的叠层下无法达到100欧的阻抗,大概也就80欧左右吧

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你们都是polar算的吗?  详情 回复 发表于 2015-9-11 15:59

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15#
 楼主| 发表于 2015-9-11 15:59 | 只看该作者
cloudy19880824 发表于 2015-9-11 15:01
0 F* z2 S4 b$ j& [% Q确实感觉这个线宽和线距,在当前的叠层下无法达到100欧的阻抗,大概也就80欧左右吧
  c* c8 E" J3 c9 s; V! ~
你们都是polar算的吗?
* G/ T  ^! i5 J3 m# H) S# W

点评

恩,是的,即便用3.8的介电常数这个阻抗还是到不了90欧。 当然了,如果只有G02作为参考曾,G04不作为参考的话倒是有可能达到100欧左右  详情 回复 发表于 2015-9-11 16:12

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16#
发表于 2015-9-11 16:12 | 只看该作者
65770096 发表于 2015-9-11 15:59
" |' n1 b' _# n% E你们都是polar算的吗?

! @5 z# }) i( |0 ?8 W) E恩,是的,即便用3.8的介电常数这个阻抗还是到不了90欧。
- M- B5 f* p; |8 D7 z! l当然了,如果只有G02作为参考曾,G04不作为参考的话倒是有可能达到100欧左右) S8 h! C7 N! A- i/ K9 Z3 M( \; f
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