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楼主: jimmy
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★★★ 大家一起学PADS (一)★★★......【有问必答贴】

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406#
发表于 2011-6-28 10:08 | 只看该作者
好像俩曾值与用si 计算的值不对应

点评

是的.还要更改介质厚度  发表于 2011-6-30 16:05
头像被屏蔽

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407#
发表于 2011-6-28 15:34 | 只看该作者
提示: 作者被禁止或删除 内容自动屏蔽

该用户从未签到

408#
发表于 2011-6-30 10:52 | 只看该作者
回复 jimmy 的帖子
: y; ]  m. J9 L9 ?) j9 z, R2 w# y! f9 o* K, Y
你好,我画的图出现这样的问题,怎么解决呢?https://www.eda365.com/thread-13627-1-1.html
) P# E! _2 J& @) F' i" z9 H: u# e* y; C; n! j/ K) k1 l: m/ _
类似问题https://www.eda365.com/forum.php?mod=viewthread&tid=31122&extra=#pid454087
, @3 V! d+ L# z2 n9 h5 I  E8 \* }. J求解
% {, R! P$ M6 R6 ~4 m7 M  r3 x

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贴子里面已有答案.  发表于 2011-6-30 16:06

该用户从未签到

409#
发表于 2011-7-2 12:44 | 只看该作者
请问下楼主,我在别人PCB上保存下的decals建起老是出错,我想知道这其中的差别是?

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别人PCB的层数是不是被max layer了?  发表于 2011-7-4 11:59

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410#
发表于 2011-7-4 21:25 | 只看该作者
挖坟啦,挖坟啦! 28326856这个群貌似已经不允许加入。% l* }- e0 e3 s* I0 x; I

- k1 y8 C0 `/ j2 k6 F6 ?! L( h 加不了!!

该用户从未签到

411#
发表于 2011-7-4 21:28 | 只看该作者
PCB中,默认规则中,设为6MIL。由于有个芯片引脚间间距比较密(小于6MIL),如果采用默认的设计规则,DRC时,会显示报错。因而采用规则优先级,在COMPONENT中,对此元器件单独设置,间距设为5MIL
2 w$ K$ O' f- x* i( D    但再进行DRC时还会报错。不知道是什么原因?    注:此DRC虽然不影响最终的PCB生产,自己明白是由于引脚太密造成了,但这个问题不解决心里总不爽1 E/ S" Q3 w" r. M/ P  Z
   还请JIMMY指点下

点评

我是用6mil检查一次后,发现只有芯片这里报错.我会将规改成5mil再检查一次...如果没有问题就OK了  发表于 2011-7-5 09:58

该用户从未签到

412#
发表于 2011-7-6 10:21 | 只看该作者
本帖最后由 jimmy 于 2011-7-6 12:55 编辑
6 i& ^( G9 h5 K7 c$ ]% D: m
2 p% U' A: p3 C请教JIMMY,PADS ROUTE的用法,在PADS ROUTE里布线的话LAYOUT里没有同步啊.这是什么原因?
  f. Q, b( f5 V, Z: q" q/ Q+ E$ L& I: i

. B% [. B& U4 M! n
; j1 \, Z% H$ B9 W6 ~" z7 Xjimmy回复:
7 f2 v( P1 X% P' v
0 u3 j" v4 ]) [1 t: D. R! X
( r' D$ q0 O1 v0 ~; n3 x* n; T: r* h) i' k6 N1 [# u1 _

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413#
发表于 2011-7-6 10:27 | 只看该作者
还有就是ROUTE里加过孔怎么加啊

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shift+左键  发表于 2011-7-6 12:55

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414#
发表于 2011-7-6 17:13 | 只看该作者
本帖最后由 jimmy 于 2011-7-8 11:02 编辑
) ~$ D, u+ u5 [# C2 E% L" B8 t( o0 y, p+ c- \
请教,如何把在布线的时候切换过孔,VIA我设置了有两种,但布线的时候一直是一种,不会切换,如何切换呢???( f- v. ]0 f: j. g
1 H& S. y" J0 s6 ]

: f4 C+ [$ |0 Yjimmy回复:9 \+ ^$ M) {! a, h8 B3 a

8 b, s# h9 a1 F# Z; s* u' d7 ?键入无模命令VT,回车后,就可以进行选择了.
9 V( c' `* @% u& W6 F( `) H4 y; V6 v1 U* v

! s* d: }5 b) F

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415#
发表于 2011-7-7 08:59 | 只看该作者
请教JIMMY,PADS里要画多张原理图,有没有主次规定呢?就直接添加页,导出就可以吗??

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通过页间连接符off-page就可以了  发表于 2011-7-8 11:03

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416#
发表于 2011-7-7 11:51 | 只看该作者
请问:
* N3 J7 z% ^' k' v) K# upads2007在手动布线时,怎么看不到当前线的宽带?请高手指教!+ ~6 Z+ |* ]9 s

点评

设好相关的规则就可以了,如default,class或net规则  发表于 2011-7-8 11:04

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417#
发表于 2011-7-7 16:21 | 只看该作者
jimmy 好厉害

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418#
发表于 2011-7-7 17:53 | 只看该作者
回复 jimmy 的帖子, w& v) n: W9 O
8 Q$ I' t: }2 S/ ?6 y
请教LZ:
0 R, E4 b7 f( s# D( m; v
我的电脑里安装了PADS9.0精简版(原来有安装过PADS2005,后来不行了重装也不行,没办法只好装了PADS9.0精简版),将LAYOUT好的PCB导出POWER PCB5.0.asc文件,再用另外台电脑PADS2005导入刚才“导出POWER PCB5.0.asc文件”,却出现以下“警告和ascii.err”问题(见附件),但用另台也装了PADS9.0精简版导入却没有问题;
还有原来用PADS2005LAYOUT好的PCBPADS9.0精简版打开后,再导出POWER PCB5.0.asc文件,用另外台电脑装PADS2005导入却没有问题。不知是什么原因,烦请楼主请教 ,谢谢!

/ r6 |9 F% f' K

点评

我有点被你绕晕了,哈哈. 9.0打开或导入后会修正原来设计上的一些不符合"规范"的东西. 你最后面的导的asc应该不是之前说的第一份asc吧?  发表于 2011-7-8 11:07

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419#
发表于 2011-7-8 08:37 | 只看该作者
jimmy,
3 x3 s. h7 L# O; H1 `当地层设为CAM 平面层。选择CAM输出地时,在地层上还需要覆铜吗?为什么我看的一本书上没有介绍地层覆铜,只有在顶层和底层覆铜。知道你是高手。请指点。谢谢。
& D+ u" Y( N# t2 D

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420#
发表于 2011-7-8 11:23 | 只看该作者
请教,PADS里怎么隐藏某一个标号的飞线呢?
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