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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示 ...
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allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示一下错误

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fangxiaoyan

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发表于 2015-4-15 20:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 fangxiaoyan 于 2015-4-16 20:34 编辑 0 \: c4 Q8 y) b$ U

# {6 f; g: G+ A( S5 C3 [如题，allegro  16.6 导入网表出错，调用别人的封装，错误信息如图1.% F* O5 R1 D) L" i: c$ f

9 z) b' w4 X7 P. r  提示封装的引脚缺失，共有10个元件的封装, Y. A% C4 f' K3 }) _& G& A5 A6 T
) G$ D* H8 c. k: f
打开其中一个DRA文件，发现缺少引脚，如图2所示
9 k  H7 m) h; S* [
% @; B  F3 o, g) A3 I4 O% g6 \
+ F4 e8 L5 i3 ~$ H  q, o, S3 c这个封装文件在别人的电脑上可用，不缺引脚，而且PSM/PAD/DRA文件齐全，为啥调用过来出现这种错误？
9 {- w3 K' J9 O& p( [
3 \, G2 e- p8 G* J( U
. r2 T- L$ l: _, H# T5 w请问除了重画封装，补上引脚，有没有其他方法？
$ @8 m- d4 u. z

DST导入网表报错.png (25.14 KB, 下载次数: 3)

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DRA引脚缺失.jpg (55.36 KB, 下载次数: 8)

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fangxiaoyan

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 楼主| 发表于 2015-4-17 18:11 | 只看该作者
dzkcool 发表于 2015-4-17 09:266 i4 \4 P2 B; \/ j3 W4 W0 r
dra文件里面要有焊盘才行。( N( y- t* W! M: i% a4 y& e* {
你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...

$ E  b# q% j+ ?1 c! d7 t导出封装成功，可以看到FPC_10_0_5M  正常 ，图1.
' u( G' c% x4 b8 T  ?& k
6 Z) x& q! }$ D2 V9 y9 f回看原理图这个元件，图2，图1和图2引脚一致，, W2 T$ p3 d" U4 R( p' B

) H! y9 k& S! O8 m3 P7 P" u( B+ ~& n& j$ A0 {
但导入网表时提示[size=14.3999996185303px]FPC_10_0_5M[size=14.3999996185303px] 缺少引脚，图33 ~, b/ Y+ h) ?+ d1 L
[size=14.3999996185303px]
; F$ U; ^9 s2 s3 h
; ?6 E% Y7 i. j[size=14.3999996185303px]  N* u! L7 k3 v  J6 @! A3 `# q. t& W7 C

- c0 H8 s; n8 c8 r1 d* J8 A, H6 V% N  j[size=14.3999996185303px]编辑原理图的这个元件，并没有看'UART'脚。
/ v7 r  i& f3 H- a: Z' g7 `- o, W% I. e4 g

5 a  ^! I8 ~3 {" X) a; J0 ?+ x封装重画，原理图这个元件重画，仍然有这个错误。  }& f, \- g# H, ~' I& f+ r" ?
1 k# O4 `3 j. ^1 l
  z  U5 p' w0 u8 h/ a, q6 n) U! |
求教！
* u9 O: s6 |9 _! t) d# j

导出封装FPC.png (7.49 KB, 下载次数: 9)

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原理图FPC.png (21.46 KB, 下载次数: 3)

原理图FPC.png

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 楼主| 发表于 2015-4-21 17:32 | 只看该作者
dzkcool 发表于 2015-4-21 13:053 l% ^+ h0 y7 @+ \7 M9 q. X  [
我没做任何改动，只是导入了一下网表，没发现什么问题。
# j) V0 `6 ?- q7 V# ^1 Y: d2 Q
我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。) N2 `% @! L9 R1 K4 f0 G9 B2 i/ M

1 E9 M) X5 e$ u. D* x$ |' \跟生产网表/导入网表的设置有关么？  W- n  b2 D7 _

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dzkcool
我直接用第一方导入，没任何问题。  详情 回复 发表于 2015-4-21 17:53

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    发表于 2015-4-22 10:37 | 只看该作者
    fangxiaoyan 发表于 2015-4-22 09:43
    ) G7 K; d0 e" g: u现在是不是可以一个个排除   1.生成网表时的选项有关  2电脑的环境。pads 与allegro 可以共存啊。奇怪了 ...

    4 W# k/ M& K+ K9 {. T! G3 T估计跟1、2有关。
    4 S! y& m) [& _: v实在看不下去了，大哥，你才是楼主，不要老是称呼我是楼主, Z* s( S3 ]$ j. b* O  n
    ! Y( j9 \7 G: g7 p  x

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    fangxiaoyan
    恩，学习了。“楼主”是女子。刚毕业，做项目管理。不懂的很多，别见怪哈。  详情 回复 发表于 2015-4-22 13:45

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    fangxiaoyan

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    2#
     楼主| 发表于 2015-4-16 20:32 | 只看该作者
    没人知道么，还是问题太幼稚了？

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    3#
    发表于 2015-4-17 09:26 | 只看该作者
    dra文件里面要有焊盘才行。
    ) d  V3 A: _6 X+ K你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目录下，然后再导出封装。

    点评

    fangxiaoyan
    导出封装成功，可以看到FPC_10_0_5M 正常 ，图1. 回看原理图这个元件，图2，图1和图2引脚一致， 但导入网表时提示FPC_10_0_5M 缺少引脚，图3 编辑原理图的这个元件，并没有看'UART'脚。 封装  详情 回复 发表于 2015-4-17 18:11
    fangxiaoyan
    同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。  详情 回复 发表于 2015-4-17 10:35

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    4#
     楼主| 发表于 2015-4-17 10:35 | 只看该作者
    dzkcool 发表于 2015-4-17 09:263 w% u) |6 T# {% j* z$ L8 P! \
    dra文件里面要有焊盘才行。
    + E$ C& C( y2 }$ D# R$ I3 f你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...
    , ?" ]- L5 s: D1 _2 k
    同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。
    # F$ [) G7 w! H$ I9 i

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    6#
    发表于 2015-4-21 08:26 | 只看该作者
    原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。
    - V4 @- b6 ]: o& z( y+ o8 y如果没问题，把原理图和封装放上来看看吧。

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    fangxiaoyan
    检查完毕，没有其他元件用到这个封装  详情 回复 发表于 2015-4-21 10:15

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    7#
     楼主| 发表于 2015-4-21 10:15 | 只看该作者
    dzkcool 发表于 2015-4-21 08:26
    , l0 {0 s: V* j, s8 O* i3 c" `: @原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。
    ! ^8 d+ w' x/ N% Y7 d2 n3 T如果没问题，把原理图和封装放上来看看吧 ...

    7 E: W$ Y) J0 q+ R检查完毕，没有其他元件用到这个封装
    - Z" U/ |) W  ]( F( B8 q) d

    DEBUG_BOARD_0523P1.rar

    30.08 KB, 下载次数: 6, 下载积分: 威望 -5

    原理图

    FT232.rar

    19.47 KB, 下载次数: 5, 下载积分: 威望 -5

    BRD文件

    lib.rar

    257.69 KB, 下载次数: 5, 下载积分: 威望 -5

    库文件

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    我没做任何改动，只是导入了一下网表，没发现什么问题。  详情 回复 发表于 2015-4-21 13:05

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    fangxiaoyan 发表于 2015-4-21 10:15- W* g5 x9 T$ Y7 _3 N/ O8 d
    检查完毕，没有其他元件用到这个封装
    # ?+ e8 S& s; G
    我没做任何改动，只是导入了一下网表，没发现什么问题。
    6 i$ J4 I( V: G1 z4 z* j FT232-eda365.rar (43.18 KB, 下载次数: 2)
    # x9 y6 N/ {2 {0 d

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    fangxiaoyan
    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。 跟生产网表/导入网表的设置有关么？  详情 回复 发表于 2015-4-21 17:32

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    fangxiaoyan 发表于 2015-4-21 17:32" Y( d0 [5 a& @7 N, ^3 U5 A0 z
    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板 ...

    % {1 x$ n5 Z! ]" @! d) }我直接用第一方导入，没任何问题。  a7 D; X, k9 _/ M; E9 v2 J3 k

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    fangxiaoyan
    那找不出问题的原因了。  详情 回复 发表于 2015-4-21 19:06

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    11#
     楼主| 发表于 2015-4-21 19:06 | 只看该作者
    dzkcool 发表于 2015-4-21 17:53
    % u+ P8 ]. l/ r2 R* T我直接用第一方导入，没任何问题。
    " E5 y6 S5 o5 H, {
    那找不出问题的原因了。
    1 N  H& |+ t$ D  U  ?

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    dzkcool
    你在我导入的PCB上再重新导入一下网表呢？  详情 回复 发表于 2015-4-21 19:08

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    发表于 2015-4-21 19:08 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:06% ]+ p5 }: f# s  i
    那找不出问题的原因了。
    8 q% O/ K: W) h, E+ {1 y
    你在我导入的PCB上再重新导入一下网表呢？
    0 [( R8 C5 z6 m( }0 W; a+ Z# `

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    fangxiaoyan
    导入的选项如图1， 导入报错如图2，  详情 回复 发表于 2015-4-21 19:21
    fangxiaoyan
    需要先导出网表，再重新导入网表？  详情 回复 发表于 2015-4-21 19:15

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     楼主| 发表于 2015-4-21 19:15 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08, Q5 H+ h3 b% g/ n
    你在我导入的PCB上再重新导入一下网表呢？

    " g# ~/ p, j  k需要先导出网表，再重新导入网表？

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    dzkcool
    先从你的原理图中导出网表，再用我的brd导入网表。  详情 回复 发表于 2015-4-21 19:17

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    发表于 2015-4-21 19:17 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:15" Q/ E( O3 B% ]4 }0 |
    需要先导出网表，再重新导入网表？
    5 S, C8 ^5 q) |) z7 ]" H
    先从你的原理图中导出网表，再用我的brd导入网表。' e; D. o; k# ^) I

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    fangxiaoyan
    楼主，以第三方的方式导入你的PCB，OK.  详情 回复 发表于 2015-4-21 19:24

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    fangxiaoyan

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    15#
     楼主| 发表于 2015-4-21 19:21 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08
      R' O# M/ _! r* p' S% Q你在我导入的PCB上再重新导入一下网表呢？
      h9 d+ L- O( u6 a% n$ v1 S4 r
    导入的选项如图1，3 s/ b- ]2 b* k# i9 K# q% M

    & I/ D. T1 z; a7 z7 P8 {7 v4 Q% b导入报错如图2，8 r/ _4 z& P5 Q" f3 X

    导入配置.png (55.33 KB, 下载次数: 4)

    1

    1

    导入报错.png (23.8 KB, 下载次数: 12)

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    dzkcool
    太诡异了，我出的网表中根本就没有你截图的这个device信息。  详情 回复 发表于 2015-4-21 19:53

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