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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示 ...
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allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示一下错误

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fangxiaoyan

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发表于 2015-4-15 20:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 fangxiaoyan 于 2015-4-16 20:34 编辑 ( F/ A/ p! B% J6 S
0 Y/ @) q7 K  Y; h; a/ I
如题，allegro  16.6 导入网表出错，调用别人的封装，错误信息如图1.( f3 l4 P% q5 o& ]0 O- o! K

& x8 V/ K/ v1 \% a: S* u: C  提示封装的引脚缺失，共有10个元件的封装. K8 K! R0 O* q+ X8 D4 g1 ~# @1 t
0 X  D) y* U  I& D% X/ Q
打开其中一个DRA文件，发现缺少引脚，如图2所示8 p6 ^) a6 e4 u

3 {% G: Z" `) ~$ Y
  `! A8 k8 C2 F$ |这个封装文件在别人的电脑上可用，不缺引脚，而且PSM/PAD/DRA文件齐全，为啥调用过来出现这种错误？( m- T( Y0 c( _

2 D# d; Q7 U+ a4 ^& u, n) ]- }1 B5 W
9 m% I. L, R4 {! B请问除了重画封装，补上引脚，有没有其他方法？
1 t5 o+ l) I# k# f* Z1 }% L+ P

DST导入网表报错.png (25.14 KB, 下载次数: 8)

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DRA引脚缺失.jpg (55.36 KB, 下载次数: 13)

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 楼主| 发表于 2015-4-17 18:11 | 只看该作者
dzkcool 发表于 2015-4-17 09:26
  \+ T& U2 P8 q( xdra文件里面要有焊盘才行。% S+ s3 R6 R2 G5 `8 _
你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...
3 `$ Q$ ^/ z' c7 O
导出封装成功，可以看到FPC_10_0_5M  正常 ，图1.: V. w/ U$ J! p+ P( o5 H

. W, }0 a% s0 j7 @8 l, C回看原理图这个元件，图2，图1和图2引脚一致，
/ d$ p7 e' e. y3 Q  Z0 q/ v+ g* I9 F
0 V. }, l6 u9 J3 D
但导入网表时提示[size=14.3999996185303px]FPC_10_0_5M[size=14.3999996185303px] 缺少引脚，图36 |2 f' j! K" _1 L, T+ h8 I% S% E1 E
[size=14.3999996185303px]6 A2 X; z: I* o: u# S

% L, e' G' e1 e5 `[size=14.3999996185303px]
% O' F  v, ]9 n
8 m7 T8 n& c( Z+ T- r0 s' O[size=14.3999996185303px]编辑原理图的这个元件，并没有看'UART'脚。
0 V5 M. M. W: q9 _! I, v- t5 W& x7 E$ j  u/ G/ Z
" n1 h( |, i; p+ K6 ^) j( G3 c# u
封装重画，原理图这个元件重画，仍然有这个错误。
9 F' h3 X( @. p6 M( ]3 r& a5 m4 P: W9 ?* ^0 R( A/ r9 r) r# N  g" U

' v3 H$ |' m- J: ?求教！
3 Y& h$ \/ T. D

导出封装FPC.png (7.49 KB, 下载次数: 14)

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原理图FPC.png

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 楼主| 发表于 2015-4-21 17:32 | 只看该作者
dzkcool 发表于 2015-4-21 13:05
9 P) A! J# A* S, R' K我没做任何改动，只是导入了一下网表，没发现什么问题。

! `% g  b2 S' Q+ D& w3 Y我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。0 M  M% O& t. ]

5 N3 f$ S$ \% q跟生产网表/导入网表的设置有关么？
- D5 J& z0 Z( l( E0 o  c, ~' g3 n

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dzkcool
我直接用第一方导入，没任何问题。  详情 回复 发表于 2015-4-21 17:53

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    发表于 2015-4-22 10:37 | 只看该作者
    fangxiaoyan 发表于 2015-4-22 09:43! }# o0 y- c, @1 K/ F. U, M
    现在是不是可以一个个排除   1.生成网表时的选项有关  2电脑的环境。pads 与allegro 可以共存啊。奇怪了 ...
    8 E8 W% ?) T' C% a, _9 Z4 T( ]  V
    估计跟1、2有关。' h: @1 N& N8 a
    实在看不下去了，大哥，你才是楼主，不要老是称呼我是楼主# j& r; e) X: l9 W

    6 @+ u/ `! E& X: X0 P9 L" D: v

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    fangxiaoyan
    恩，学习了。“楼主”是女子。刚毕业，做项目管理。不懂的很多，别见怪哈。  详情 回复 发表于 2015-4-22 13:45

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    fangxiaoyan

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    2#
     楼主| 发表于 2015-4-16 20:32 | 只看该作者
    没人知道么，还是问题太幼稚了？

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    3#
    发表于 2015-4-17 09:26 | 只看该作者
    dra文件里面要有焊盘才行。
    " G: ?9 V* J5 F4 M5 t0 E你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目录下，然后再导出封装。

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    fangxiaoyan
    导出封装成功，可以看到FPC_10_0_5M 正常 ，图1. 回看原理图这个元件，图2，图1和图2引脚一致， 但导入网表时提示FPC_10_0_5M 缺少引脚，图3 编辑原理图的这个元件，并没有看'UART'脚。 封装  详情 回复 发表于 2015-4-17 18:11
    fangxiaoyan
    同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。  详情 回复 发表于 2015-4-17 10:35

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    4#
     楼主| 发表于 2015-4-17 10:35 | 只看该作者
    dzkcool 发表于 2015-4-17 09:26* z# B4 |* k, z+ k: W" Z  H% B
    dra文件里面要有焊盘才行。2 M2 P: u4 d* N" k. P! s  T; l: R
    你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...

    # X# s+ G* m6 F: r: C0 n同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。% d  v+ V* B( O% I$ ]

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    6#
    发表于 2015-4-21 08:26 | 只看该作者
    原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。
    % c3 v! ?. t; W7 \如果没问题，把原理图和封装放上来看看吧。

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    fangxiaoyan
    检查完毕，没有其他元件用到这个封装  详情 回复 发表于 2015-4-21 10:15

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    7#
     楼主| 发表于 2015-4-21 10:15 | 只看该作者
    dzkcool 发表于 2015-4-21 08:268 Z/ r9 l* B0 f0 g' S
    原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。
    2 ~4 ^  F4 P) R' j! Y如果没问题，把原理图和封装放上来看看吧 ...

    9 B& q" X9 e' X) z3 x2 H" t# f; \& `检查完毕，没有其他元件用到这个封装
    " b3 i& n# W9 ?8 L, ?

    DEBUG_BOARD_0523P1.rar

    30.08 KB, 下载次数: 6, 下载积分: 威望 -5

    原理图

    FT232.rar

    19.47 KB, 下载次数: 5, 下载积分: 威望 -5

    BRD文件

    lib.rar

    257.69 KB, 下载次数: 5, 下载积分: 威望 -5

    库文件

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    我没做任何改动，只是导入了一下网表，没发现什么问题。  详情 回复 发表于 2015-4-21 13:05

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    fangxiaoyan 发表于 2015-4-21 10:15
    & z' S7 O' D/ Y2 v9 M7 L, L" t检查完毕，没有其他元件用到这个封装

    2 c1 L# V: v9 l7 s我没做任何改动，只是导入了一下网表，没发现什么问题。( X6 P: C  {" ~4 s: u6 N
    FT232-eda365.rar (43.18 KB, 下载次数: 2)
    5 _! c  I! M% z

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    fangxiaoyan
    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。 跟生产网表/导入网表的设置有关么？  详情 回复 发表于 2015-4-21 17:32

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    发表于 2015-4-21 17:53 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 17:32
    9 s! _, ^! I9 k5 |我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板 ...
    ) U5 k. ~' `  \# k! ^9 W+ \9 n: p
    我直接用第一方导入，没任何问题。& G+ ?* {# D% y4 y( }; h9 H

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    fangxiaoyan
    那找不出问题的原因了。  详情 回复 发表于 2015-4-21 19:06

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     楼主| 发表于 2015-4-21 19:06 | 只看该作者
    dzkcool 发表于 2015-4-21 17:53" x3 k, _9 M# o6 A2 F) m8 e- O, N1 @
    我直接用第一方导入，没任何问题。
    $ W/ k% a0 i9 i
    那找不出问题的原因了。
    ) `9 S* k  t. y3 {

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    dzkcool
    你在我导入的PCB上再重新导入一下网表呢？  详情 回复 发表于 2015-4-21 19:08

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    发表于 2015-4-21 19:08 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:06; e/ m" i/ U- _8 y2 A3 N" e
    那找不出问题的原因了。

    # e( E' }0 [; b) W你在我导入的PCB上再重新导入一下网表呢？
    8 L9 W9 V& d% z0 W

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    fangxiaoyan
    导入的选项如图1， 导入报错如图2，  详情 回复 发表于 2015-4-21 19:21
    fangxiaoyan
    需要先导出网表，再重新导入网表？  详情 回复 发表于 2015-4-21 19:15

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    13#
     楼主| 发表于 2015-4-21 19:15 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08
    & G% z1 e' y! N* ~- v& G4 o你在我导入的PCB上再重新导入一下网表呢？

    $ V4 U  [7 ~& C需要先导出网表，再重新导入网表？

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    dzkcool
    先从你的原理图中导出网表，再用我的brd导入网表。  详情 回复 发表于 2015-4-21 19:17

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    发表于 2015-4-21 19:17 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:150 t" D+ u: Z' g# d) B7 M  ]0 l
    需要先导出网表，再重新导入网表？

    # T& z" E& n4 g& p9 C$ t先从你的原理图中导出网表，再用我的brd导入网表。$ ~& i5 j) I) F0 Y0 c

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    fangxiaoyan
    楼主，以第三方的方式导入你的PCB，OK.  详情 回复 发表于 2015-4-21 19:24

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    fangxiaoyan

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     楼主| 发表于 2015-4-21 19:21 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08. n5 v' a: {3 J, j4 u3 P, t) X
    你在我导入的PCB上再重新导入一下网表呢？

    ' G# w! \& U4 q( y# }1 `$ K# O导入的选项如图1，3 F5 ]5 E. N* C: p- l6 }

    / {+ I4 p0 s2 C3 F8 z7 D* v0 G  f/ X导入报错如图2，* g; w$ Z& q$ X9 v- Y" }0 \

    导入配置.png (55.33 KB, 下载次数: 9)

    1

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    导入报错.png (23.8 KB, 下载次数: 18)

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    dzkcool
    太诡异了，我出的网表中根本就没有你截图的这个device信息。  详情 回复 发表于 2015-4-21 19:53

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