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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示 ...
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allegro 16.6 导入网表,PSM/PAD/DRA文件齐全，仍然提示一下错误

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fangxiaoyan

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发表于 2015-4-15 20:49 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 fangxiaoyan 于 2015-4-16 20:34 编辑 + ?/ l( H6 N5 T" }

  G; T, @9 `( a( v: A9 r如题，allegro  16.6 导入网表出错，调用别人的封装，错误信息如图1.' b$ q$ I- m+ @0 Y& x; K/ }, _

+ `+ G8 @* p- l; r% {7 \  提示封装的引脚缺失，共有10个元件的封装5 p3 ?* B- m& s/ R
- Q" ^$ L) X2 ?. q8 d
打开其中一个DRA文件，发现缺少引脚，如图2所示
+ X$ U7 S* a+ V7 M1 c- u- q2 [1 L# Q$ l3 E6 Q
8 `2 ]4 N6 G9 P5 e7 Z) z5 H
这个封装文件在别人的电脑上可用，不缺引脚，而且PSM/PAD/DRA文件齐全，为啥调用过来出现这种错误？2 k% Z. b: p7 m  P' ~( J1 |
* |# [1 v# ?1 F9 S( }

; I$ `; x) j0 }& e请问除了重画封装，补上引脚，有没有其他方法？0 C; B/ S% j6 p6 ]. S2 B( z  F

DST导入网表报错.png (25.14 KB, 下载次数: 5)

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DRA引脚缺失.jpg (55.36 KB, 下载次数: 10)

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fangxiaoyan

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 楼主| 发表于 2015-4-17 18:11 | 只看该作者
dzkcool 发表于 2015-4-17 09:26
) I( L( K5 p8 d  h6 y; ~& Xdra文件里面要有焊盘才行。
8 Y8 Q& Z5 V0 o! w% R, ?# e你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...

3 ~7 I: Q5 t( E" H9 }导出封装成功，可以看到FPC_10_0_5M  正常 ，图1.$ d# K/ i- a' g

* S7 M6 y, N8 y6 S回看原理图这个元件，图2，图1和图2引脚一致，! C" o2 y6 G9 c6 X! e. _: g& k% C- ^

$ h* q, f5 B6 V6 p: }  k
3 m  d4 g; C+ k$ B. Y但导入网表时提示[size=14.3999996185303px]FPC_10_0_5M[size=14.3999996185303px] 缺少引脚，图32 W4 u  l$ T6 t
[size=14.3999996185303px]* v. l! B6 z, g: b8 m6 [
* m; E7 v$ u( [6 R% {
[size=14.3999996185303px]2 d; H1 Q' s% A$ T

' z" V8 f3 r* O[size=14.3999996185303px]编辑原理图的这个元件，并没有看'UART'脚。0 `; G- Z' y( \+ B& Y

4 |. M  Z  Z( b
- Z/ ]9 Y6 O1 [/ f  w封装重画，原理图这个元件重画，仍然有这个错误。
3 l5 T2 n5 P) R: O9 Z) `* c
7 f. Z5 L+ B' `1 R1 e) R% K5 b" f$ M' e8 y- V4 V( j
求教！
/ _7 _5 [0 Y! N% C0 I( J

导出封装FPC.png (7.49 KB, 下载次数: 11)

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原理图FPC.png

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 楼主| 发表于 2015-4-21 17:32 | 只看该作者
dzkcool 发表于 2015-4-21 13:05
5 f% _% {  i  J. W  o2 `我没做任何改动，只是导入了一下网表，没发现什么问题。

% B, {, H+ K$ A, S5 F& M; `我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。  h; r0 Z: q) b' h; O' c0 D  z* Q
& z+ e! p( @! ~7 m+ J- Q" ~
跟生产网表/导入网表的设置有关么？' x3 x5 @9 d) x* ^' ?, {; P

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dzkcool
我直接用第一方导入，没任何问题。  详情 回复 发表于 2015-4-21 17:53

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    [LV.8]以坛为家I
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    发表于 2015-4-22 10:37 | 只看该作者
    fangxiaoyan 发表于 2015-4-22 09:43
    3 y2 y0 b/ E6 Z现在是不是可以一个个排除   1.生成网表时的选项有关  2电脑的环境。pads 与allegro 可以共存啊。奇怪了 ...

    - M( B" g# k' \7 A* ]0 h2 a+ a估计跟1、2有关。
    , n6 f/ q  p& X# N; S实在看不下去了，大哥，你才是楼主，不要老是称呼我是楼主/ @, G! S( H$ ]3 E' [9 h
    9 Z( _1 @; W1 Z7 f: [

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    fangxiaoyan
    恩，学习了。“楼主”是女子。刚毕业，做项目管理。不懂的很多，别见怪哈。  详情 回复 发表于 2015-4-22 13:45

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    fangxiaoyan

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    2#
     楼主| 发表于 2015-4-16 20:32 | 只看该作者
    没人知道么，还是问题太幼稚了？

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    [LV.8]以坛为家I
    3#
    发表于 2015-4-17 09:26 | 只看该作者
    dra文件里面要有焊盘才行。7 E& x* I( ~. V; ~. Z
    你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目录下，然后再导出封装。

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    fangxiaoyan
    导出封装成功，可以看到FPC_10_0_5M 正常 ，图1. 回看原理图这个元件，图2，图1和图2引脚一致， 但导入网表时提示FPC_10_0_5M 缺少引脚，图3 编辑原理图的这个元件，并没有看'UART'脚。 封装  详情 回复 发表于 2015-4-17 18:11
    fangxiaoyan
    同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。  详情 回复 发表于 2015-4-17 10:35

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    4#
     楼主| 发表于 2015-4-17 10:35 | 只看该作者
    dzkcool 发表于 2015-4-17 09:26
    0 H+ ?# U' p. P3 R4 t6 W/ vdra文件里面要有焊盘才行。, h1 ?( ~  }+ V1 h
    你从别人的板子上导出封装之前，把封装库路径(尤其是PadPath)设置到板子所在目 ...
    5 s& ^" N) E* W% {& i+ }$ _
    同事直接发的封装文件。现在打算重新从同事的板子导出，再试下。: J7 L# L# G& p1 ]$ L: G

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    [LV.8]以坛为家I
    6#
    发表于 2015-4-21 08:26 | 只看该作者
    原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。6 |& m( x9 {1 G+ G7 B0 z( e
    如果没问题，把原理图和封装放上来看看吧。

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    fangxiaoyan
    检查完毕，没有其他元件用到这个封装  详情 回复 发表于 2015-4-21 10:15

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    7#
     楼主| 发表于 2015-4-21 10:15 | 只看该作者
    dzkcool 发表于 2015-4-21 08:26
    . t  A, d1 |/ r; B* w原理图上有其他元件用到FPC_10_0_5M这个封装吗？每个都要看下。1 {& P" e8 u* e
    如果没问题，把原理图和封装放上来看看吧 ...

    6 z3 ^$ ~2 G9 R# @; C/ z' R检查完毕，没有其他元件用到这个封装
    / j6 d1 ]8 ]: X% g# m5 F

    DEBUG_BOARD_0523P1.rar

    30.08 KB, 下载次数: 6, 下载积分: 威望 -5

    原理图

    FT232.rar

    19.47 KB, 下载次数: 5, 下载积分: 威望 -5

    BRD文件

    lib.rar

    257.69 KB, 下载次数: 5, 下载积分: 威望 -5

    库文件

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    我没做任何改动，只是导入了一下网表，没发现什么问题。  详情 回复 发表于 2015-4-21 13:05

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    发表于 2015-4-21 13:05 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 10:15
    1 n& I/ z- o2 y  u( E7 F检查完毕，没有其他元件用到这个封装

    * `% {/ \: j8 [$ \4 E我没做任何改动，只是导入了一下网表，没发现什么问题。7 }! P  t' N# K. O0 D4 c
    FT232-eda365.rar (43.18 KB, 下载次数: 2) & [% s1 e. j' S1 G  a& g3 o3 O

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    fangxiaoyan
    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板框内，其他的元件可以放置。 跟生产网表/导入网表的设置有关么？  详情 回复 发表于 2015-4-21 17:32

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    发表于 2015-4-21 17:53 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 17:32" ^* F, }4 n/ l+ s
    我这边生成网表无错，导入的时候提示上述ERROR 。以OTHER的方式导入，ERROR中涉及的3个PART不能放置到板 ...
    . ]% Z& d7 s7 E" D  F1 k1 E
    我直接用第一方导入，没任何问题。) W  @  D. N4 [/ M; B

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    fangxiaoyan
    那找不出问题的原因了。  详情 回复 发表于 2015-4-21 19:06

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     楼主| 发表于 2015-4-21 19:06 | 只看该作者
    dzkcool 发表于 2015-4-21 17:534 Y7 F) V9 E: s8 ~
    我直接用第一方导入，没任何问题。

    2 l, o: O+ L9 n: L% Q那找不出问题的原因了。
    - W) n* _& D' r% e

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    dzkcool
    你在我导入的PCB上再重新导入一下网表呢？  详情 回复 发表于 2015-4-21 19:08

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    dzkcool
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    发表于 2015-4-21 19:08 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:06
    , {9 t. F5 X# Y# Q那找不出问题的原因了。

    , F; g& E5 N( v3 S. t你在我导入的PCB上再重新导入一下网表呢？
    7 O3 T1 Y* h0 x; h* }) e

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    fangxiaoyan
    导入的选项如图1， 导入报错如图2，  详情 回复 发表于 2015-4-21 19:21
    fangxiaoyan
    需要先导出网表，再重新导入网表？  详情 回复 发表于 2015-4-21 19:15

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    13#
     楼主| 发表于 2015-4-21 19:15 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08
    ; O* S, Y$ ?3 u2 j9 x; ]8 K$ Z2 \你在我导入的PCB上再重新导入一下网表呢？
    $ G" Y  T: J; K$ M# e( D
    需要先导出网表，再重新导入网表？

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    dzkcool
    先从你的原理图中导出网表，再用我的brd导入网表。  详情 回复 发表于 2015-4-21 19:17

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    发表于 2015-4-21 19:17 | 只看该作者
    fangxiaoyan 发表于 2015-4-21 19:15
    5 R/ O; O+ S5 D, W需要先导出网表，再重新导入网表？
    4 @) z) x( R# P0 @1 Q6 u& p
    先从你的原理图中导出网表，再用我的brd导入网表。0 V1 l9 n( U, u' c# g' k+ y1 B4 B

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    fangxiaoyan
    楼主，以第三方的方式导入你的PCB，OK.  详情 回复 发表于 2015-4-21 19:24

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    fangxiaoyan

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    15#
     楼主| 发表于 2015-4-21 19:21 | 只看该作者
    dzkcool 发表于 2015-4-21 19:08, e  }0 }3 V6 r3 s+ f3 n
    你在我导入的PCB上再重新导入一下网表呢？

    ) E8 g( f/ V. @, o导入的选项如图1，. ^) z  F1 V9 W+ x" |* l1 ?

    ' I" n. z  k0 |导入报错如图2，7 ?2 ]; Z( m2 D( v9 g/ E

    导入配置.png (55.33 KB, 下载次数: 6)

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    导入报错.png (23.8 KB, 下载次数: 15)

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    dzkcool
    太诡异了，我出的网表中根本就没有你截图的这个device信息。  详情 回复 发表于 2015-4-21 19:53

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