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Cadence Allegro论坛今日: 4 |主题: 34025|排名: 3

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等长线的问题	wxc287939659 2009-8-13 15:42	4 1142	hehehe 2009-8-17 10:34
Reference跟Part Reference都不一样！！！	derek26 2009-8-17 10:05	1 811	derek26 2009-8-17 10:14
CROSS SECTION SYMBOL 怎么做的？	hdjun 2009-8-8 16:40	1 844	liulinjievvv 2009-8-15 20:09
design entry cis打不开	avery 2009-8-13 14:26	2 1404	killerljj 2009-8-15 19:08
请教各位，在走线比较多的情况下，你们怎么布线	wxc287939659 2009-8-11 13:55	1 843	yh521py 2009-8-15 14:53
关于封装库的建法的一点疑问?[已解决]	jasonlu 2009-4-13 00:25	8 1418	aaaqaz2004 2009-8-14 20:55
电源分割	lwh123468 2009-8-11 22:10	4 1051	浪子 2009-8-14 00:50
铜铺在route keepin外面了	liulinjievvv 2009-8-13 21:22	1 1416	袁荣盛 2009-8-13 22:18
请大家帮忙鉴别一下主芯片厂家	憨仔 2009-8-13 21:36	0 818	憨仔 2009-8-13 21:36
表层如何和内层的电源层连接	n042208 2009-8-13 09:47	2 732	n042208 2009-8-13 20:37
新手发问，关于电源层的分割	laoniao 2009-3-26 20:41	3 964	flysky 2009-8-13 19:25
Allegor 15.7中Design Entry CIS的问题	zxg1113 2007-11-23 16:23	5 2479	avery 2009-8-13 14:30
16.2的capture CIS 老实异常退出	pengb07 2009-6-29 00:22	8 2007	whb3103536 2009-8-13 09:07
画好的pcb要在pcb内部开一个矩形的槽怎么做好了	mahui625 2009-8-11 11:21	4 1286	mahui625 2009-8-12 17:44
SPB16.0 求助	wowo1215 2009-8-12 17:31	0 743	wowo1215 2009-8-12 17:31
allegro15.7 GIF基础教程 1人参与	deargds 2009-7-31 11:37	10 1273	mindy159 2009-8-12 16:41
allegro里面允许有两个板框吗？	tuzhiquan 2009-7-29 11:11	1 920	lolen 2009-8-12 16:15
如何将LINE变成SHAPE	hrdd2001 2009-7-30 10:36	2 3201	lolen 2009-8-12 16:14
请教：CIS的UPD文件！	zwy1986 2009-8-12 13:49	0 873	zwy1986 2009-8-12 13:49
Unconnect pin 和Unconnect net 问题	hdjun 2009-8-11 23:55	2 1818	hdjun 2009-8-12 10:11
怎么改nets的名字？	nothisname 2009-8-11 19:27	1 1100	nothisname 2009-8-12 00:06
DRC怎么总是显示out of date	hdjun 2009-8-10 21:51	2 5154	hdjun 2009-8-11 23:38
怎么修改覆铜和导线的距离	kxw102 2009-8-11 16:31	2 3552	kxw102 2009-8-11 20:16
分割画板出现的问题	huluobotiao 2009-8-11 10:01	1 877	huluobotiao 2009-8-11 16:26
xnet 名字怎样把握？	liulinjievvv 2009-8-7 22:31	4 1194	adwordslai 2009-8-11 16:22