[仿真讨论] 500MHz 12bit ADC 采样问题

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发表于 2014-3-12 20:21 | 只看该作者 |只看大图回帖奖励

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电路只用2片ADC采样，原理图一致，但是目前一片ADC输出采样时钟占空比不是50%，有时窄，有时宽；

对问题ADC单独工作时输出时钟问题同样存在，而且割断ＡＤＣ与ＦＰＧＡ走线，ＡＤＣ输出侧波形仍然没有改变，求指点排查思路？

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