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Quartus II 编译出现以下错误,请高手指点!!!

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1#
发表于 2013-12-20 08:23 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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Clock_Generator.rar (397.36 KB, 下载次数: 12)
/ {, l7 v$ R7 J1 d) e: ^4 o8 D2 s7 s* d" E

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2#
发表于 2013-12-20 08:33 来自手机 | 只看该作者
手机看不图,顶一下

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3#
发表于 2013-12-20 08:35 | 只看该作者
不可以在两个进程内,对同一信号进行赋值

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4#
 楼主| 发表于 2013-12-20 08:41 | 只看该作者
LHDDSHL 发表于 2013-12-20 08:35
+ E% o7 Y+ j- I  p4 `不可以在两个进程内,对同一信号进行赋值

: K: \$ e0 r$ T4 a9 m/ \& y高手能否帮我把工程改下,我刚入门,实在改不通

该用户从未签到

6#
发表于 2014-1-22 05:16 | 只看该作者
You have module Clock_Generator.v 3 t1 V3 T  ~! O% P. t
with port                      input [31:0] key_value# c/ T- j, Y1 a
and you set a instance of * C: v/ E  K+ N# b- U4 v, P* z
key_scan_jitter key_scan_jitter_inst
" I: U& \3 l; Q1 O% t        (
; u# i- N. o2 U5 e8 S; [: N                .clk(clk),7 h2 w  e" ~" z( _
                .rst_n(rst_n),
3 O2 \( T7 i5 o( Q2 _+ p8 m! Y& v                .key_data(key_data),$ H$ G& ^" l8 L4 J$ G0 ?4 M- t
                .key_flag(key_flag),
( L' k- I: F  |% \( i! {  W9 O                .key_value(key_value)5 E' |2 U. S+ w9 i5 @) {/ {; W
        );8 T) o- `7 O& K  y$ k: A0 k
In module key_scan_jitter.v8 z  I4 D% H$ ^: h! Q' @
you have                          output[31:0] key_value
. [5 q7 _/ u' Y3 F* K
% _: R/ }: @' H1 H& O3 H+ L4 tSo module have to source of key_value:
: a' c: A6 r% R5 @1. From input port (may be 32 pins of chip)8 z  {, ~8 w/ \5 {
2. From internal instance  key_scan_jitter
, [: Y2 v" O6 C* ~7 w6 y
0 L- u( E6 g$ h" |% RAltera can-t to do short circuit in your module.& G1 Y2 g8 l5 @$ @

该用户从未签到

7#
发表于 2014-1-22 10:09 | 只看该作者
顶层文件里,key_value的定义错了,不应该是input,是wire型,因为它是key_scan_jitter的输出。
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