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在allegro hdl 15.7环境中，我在点击tools--packager utilities--electrical rules check 后出现下列情况，是怎么回事？请大家给看看7 v$ n: {. S! |4 Z% X& @- a O
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ERC-DX 15.50-p001 May 23 2006
* e+ v- k% P FCopyright (C) 1994 Cadence Design Systems7 H; o, v. {* T% T* @
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ERC-DX run on Aug 11 16:39:27 2008& @& a2 J5 M/ A4 O, }
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发表于 2008-8-11 16:45
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