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求教大侠相对时延1ps=多少mil?

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1#
发表于 2013-4-18 17:01 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我们做ddr之类的等长时,通常有个相对时延和传输时延,资料里面常说时延控制在+-2ps, +-10ps这样,真心求教怎么换算成mil?同时求教什么情况下要控制传输时延?

点评

1ps = 200mil 在intel 设置指南里说到,在 PCI CLK 里  发表于 2013-5-5 01:46

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2#
 楼主| 发表于 2013-4-18 17:08 | 只看该作者
我自己用ALLGRO约束管理器里面的900mil的线传输延时135.6ps 折算一下 差不多是6.637mil不知道能不能这么计算

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3#
 楼主| 发表于 2013-4-18 17:14 | 只看该作者
Implement fine length matching and insert multiple ground vias where signal traces jump layers. It is : N% u/ s+ [; t7 M" c2 q9 n
better to use the delay matching option in ALLEGRO and one must include z-axis delay.   Typically, P ' j4 W* k0 V' n
and N nets of differential pairs should be matched with a tolerance of +/- 2ps and the tolerance for all
- ]7 z; T  F( nother matched nets can be +/- 10 ps or more based on the timing margin computation.
! V  P( L& g5 z, Z! V' Q& L( S那么上面这段话里面差分对两根线控制在+/-2ps 之内的意思折算一下是不是说控制在+/-10mil就可以了(平时我都是控制+/-5mil)其它的控制在+/-10PS之内 换算成+/-60mil(平时常控制在+-50mil)

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4#
 楼主| 发表于 2013-4-18 17:15 | 只看该作者
真心求教欢迎拍砖 同时共享一份资料

DDR2_DDR3_SDRAM的PCB布线规则指导.pdf

550 KB, 下载次数: 232, 下载积分: 威望 -5

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5#
发表于 2013-4-18 17:22 | 只看该作者
拿走了

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6#
 楼主| 发表于 2013-4-18 17:24 | 只看该作者
297469214 发表于 2013-4-18 17:22 - j8 T3 a& M, G% Z2 k
拿走了
9 Z3 k  |, y: ^
我表示英文不是很过关 只看懂了一部分,大侠看到好的见解分享分享
  • TA的每日心情
    奋斗
    2022-5-24 15:51
  • 签到天数: 1 天

    [LV.1]初来乍到

    7#
    发表于 2013-4-18 21:22 | 只看该作者
    按  1inch/170ps   来换算就行啊.......

    评分

    参与人数 1贡献 +2 收起 理由
    zhangjunxuan21 + 2

    查看全部评分

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    8#
     楼主| 发表于 2013-4-18 22:54 | 只看该作者
    星星点灯 发表于 2013-4-18 21:22 & D) Q7 q2 Q! ?$ L4 j
    按  1inch/170ps   来换算就行啊.......

    , ]2 M, z! D$ {% ~0 v! Z2 d0 u! T/ S那就是5.882mil/1ps了 1inch是等于1000mil吧  谢谢大侠指点

    该用户从未签到

    9#
    发表于 2013-4-19 08:51 | 只看该作者
    模糊算法是5MIL

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    10#
     楼主| 发表于 2013-4-19 08:58 | 只看该作者
    wolf343105 发表于 2013-4-19 08:51
    " {' r3 x9 M/ E, |; K& G  X8 C* Z( f模糊算法是5MIL

    0 D. R) ?) f1 K! L+ w: l( a9 R8 h0 T嗯。。。谢谢分享经验值。。。  同时求教一下什么情况下要控制传输时延?

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    11#
    发表于 2013-4-19 15:23 | 只看该作者
    ps级的延时基本很难控制了,不光跟线的长度有关系,还跟整个布局,地平面都有关系

    该用户从未签到

    12#
     楼主| 发表于 2013-4-19 16:06 | 只看该作者
    inspiron1501 发表于 2013-4-19 15:23
    5 r8 [$ W: c% R7 U# z( fps级的延时基本很难控制了,不光跟线的长度有关系,还跟整个布局,地平面都有关系

    + {$ a" W7 ?  R( V谢谢大侠的关注 不过我想表达的不是控制ps级的 是有时候看资料里面会写传输延时控制在1英寸的走线长度,我想问一下这个为何啊 什么样的情况下要控制走线的长度啊

    该用户从未签到

    13#
    发表于 2013-4-19 16:11 | 只看该作者
    走线长度控制跟芯片对信号的要求有关,贴别是ram这类对时钟和数据上升下降沿要求比较严的器件,一般都有一个最大长度要求。

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    14#
    发表于 2013-4-19 23:29 | 只看该作者
    這個算法應該有問題 , 因為訊號速度與材料的介質係數有關.& S4 f7 S# F8 p& i$ @+ m3 [
    訊號速度=光速 / ( 介質係數開根號 )

    该用户从未签到

    15#
     楼主| 发表于 2013-5-3 15:13 | 只看该作者
    procomm1722 发表于 2013-4-19 23:29
    - t1 ]& P! X, z! D, K這個算法應該有問題 , 因為訊號速度與材料的介質係數有關.
    ; y# }: ?* I# R% e訊號速度=光速 / ( 介質係數開根號 )

    ) m8 [0 m8 {0 L' S1 Q$ g多谢大侠关注解惑,万分感激,只是目前我还没研究那么深,我暂时只是想知道一个比较靠谱的经验值,在设计中做个参考,如果有比较严谨的要求的时候,再根据大侠提供的公式好好算算。。。
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