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16.3版allegro长度设置

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发表于 2013-4-17 18:24 | 只看该作者回帖奖励

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ddr的clk走线需要经过两个电阻到cpu.怎么附模型啊？请详解

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发表于 2013-4-17 19:42 | 只看该作者

XNET啊

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楼主| 发表于 2013-4-18 08:38 | 只看该作者

kevin890505 发表于 2013-4-17 19:42
( g1 }+ |' a6 O/ G: [4 E$ hXNET啊

怎么弄啊，可以跟我说说吗

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