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1.原理图常见错误: [table][/table] (1)ERC报告管脚没有接入信号:
1 u- a6 b/ t H! j5 } a.创建封装时给管脚定义了I/O属性;
5 a6 t1 I# I* q b.创建元件或放置元件时修改了不一致的grid属性,管脚与线没有连上;
' g, y; {& H1 H c.创建元件时pin方向反向,必须非pinname端连线。; \3 A! v# r; W* q \1 p& h
(2)元件跑到图纸界外:没有在元件库图表纸中心创建元件。% I! |/ K* Z- {/ j* E4 k
(3)创建的工程文件网络表只能部分调入pcb:生成netlist时没有选择为global。
3 P. o' C; z9 z# V+ O& m: n/ G (4)当使用自己创建的多部分组成的元件时,千万不要使用annotate.6 w1 K" [' E C1 [& ]$ i% r4 F$ a
2.PCB中常见错误:; u( ?, a. P6 l3 D# I$ a
(1)网络载入时报告NODE没有找到:/ ]) n! g0 z$ ^/ D5 ^, D
a.原理图中的元件使用了pcb库中没有的封装;
% S3 o# F& E5 T6 y U' I b.原理图中的元件使用了pcb库中名称不一致的封装;
6 ?' v2 W2 _+ {$ E c.原理图中的元件使用了pcb库中pinnumber不一致的封装。如三极管:sch中pinnumber为e,b,c,而pcb中为1,2,3。
% n; D4 [; V- z (2)打印时总是不能打印到一页纸上:
. P: x/ ]/ G$ T, C( ]" i1 v a.创建pcb库时没有在原点;0 p: C0 P1 L0 |4 h, ]
b.多次移动和旋转了元件,pcb板界外有隐藏的字符。选择显示所有隐藏的字符,缩小pcb,然后移动字符到边界内。; r5 E0 _& I* m
(3)DRC报告网络被分成几个部分:8 X+ ~! S K5 E9 J: J r. R
表示这个网络没有连通,看报告文件,使用选择CONNECTEDCOPPER查找。( i" c, m% T' q
另外提醒朋友尽量使用WIN2000,减少蓝屏的机会;多几次导出文件,做成新的DDB文件,减少文件尺寸和protel僵死的机会。如果作较复杂得设计,尽量不要使用自动布线。7 k8 L" \3 O2 d$ [" B! N6 S2 g! P
在PCB设计中,布线是完成产品设计的重要步骤,可以说前面的准备工作都是为它而做的,在整个PCB中,以布线的设计过程限定最高,技巧最细、工作量最大。PCB布线有单面布线、双面布线及多层布线。
4 t" x% n4 V% G C 布线的方式也有两种:自动布线及交互式布线,在自动布线之前,可以用交互式预先对要求比较严格的线进行布线,输入端与输出端的边线应避免相邻平行,以免产生反射干扰。' `2 m# y, K: {' j" g2 l+ d& \
必要时应加地线隔离,两相邻层的布线要互相垂直,平行容易产生寄生耦合。 |
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