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EDA365电子论坛网»电子社区 › EDA工具&PCB设计 › Cadence Allegro论坛 › Allegro17.4DDR设置FLY-BY拓扑结构，地址控制线规则设置
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Allegro17.4DDR设置FLY-BY拓扑结构，地址控制线规则设置

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hammer_F

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1#
 楼主| 发表于 2025-1-15 18:50 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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ddr的地址控制线设置完之后长度延时这里都显示绿色TARGET，设置目标走线也没用，绕等长也没有提示长度的小框 + O$ D0 N7 ]; S, w; M( s

点评

aarom
"單線"設定錯誤.  发表于 2025-1-16 05:43
aarom
設錯了, "Local" 是自己不跟其他線比對的"線長度", 而你的誤差也設太大了.  发表于 2025-1-16 05:42

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hammer_F

该用户从未签到
3#
 楼主| 发表于 2025-1-16 09:09 | 只看该作者
解决了，改为global就行了

点评

aarom
自己體驗是好事.  发表于 2025-1-16 15:03

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陛下万年
  • TA的每日心情
    开心
    2025-7-25 15:38

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    [LV.6]常住居民II
    4#
    发表于 2025-1-16 09:25 | 只看该作者
    1111111111111111111111111

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