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硬件设计系统弄两个LDO有什么不良影响吗?

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  • TA的每日心情
    奋斗
    2020-7-17 15:39
  • 签到天数: 13 天

    [LV.3]偶尔看看II

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    1#
     楼主| 发表于 2024-11-30 18:27 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    我有一个硬件设计系统,里面有mcu,电压采样,温度采样还有其他器件。我弄两个LDO,两个LDO共地连接,一个LDO给MCU供电,另一个LDO给其他部件供电,这样会有什么后果?两个LDO都是5V电。& v7 k# M+ L7 k5 _

    点评

    谢谢分享!: 5.0
    谢谢分享!: 5
    弄兩個不會有什麼影響,你搞二十個估計老闆就會有感覺了!>_<|||  发表于 2024-12-9 22:30

    该用户从未签到

    3#
    发表于 2024-12-2 09:47 | 只看该作者
    非特殊情况(对MCU和外部器件上电时序非常严格)下,没不良后果,唯一后果是增加了成本。反而在PCB布线空间允许的情况下,用两个LDO供电对电源芯片的稳定性有好处。
  • TA的每日心情
    奋斗
    2025-7-15 15:32
  • 签到天数: 77 天

    [LV.6]常住居民II

    4#
    发表于 2024-12-2 10:02 | 只看该作者
    一点问题没有。。。
  • TA的每日心情
    开心
    2024-9-14 15:26
  • 签到天数: 9 天

    [LV.3]偶尔看看II

    5#
    发表于 2024-12-2 10:13 | 只看该作者
    没有问题。* b  t5 x8 c7 u, r
    一般情况下,如果LDO的输出电流足够,可以给MCU和其他器件同时供电也可以,用磁珠隔开。
  • TA的每日心情
    开心
    2025-2-13 15:35
  • 签到天数: 169 天

    [LV.7]常住居民III

    6#
    发表于 2024-12-2 11:22 | 只看该作者
    问题可能是有一点的,两个LDO上电时序上可能有差别,要求高的系统不一定行
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