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CADENCE 画原理图后DRC错误,请指教!

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1#
发表于 2012-7-2 10:18 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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初学CNDENCE这个软件,画完原理图后,DRC检查出现这个问题,如下图:
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' ^9 o1 F0 ~/ p* Y3 g( v
L1117的输出端 和mcu的 20脚出点的DRC错误,请问这是什么意思啊,连接看着也没错啊!

该用户从未签到

2#
 楼主| 发表于 2012-7-2 10:20 | 只看该作者
另问一下,L1117的第一脚 (GND),能不能字体横过来!这样字体竖着,看着有点不舒服!
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