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遇到一个关于铺铜的问题,求助一下。

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1#
发表于 2012-6-7 10:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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昨天在画板子的时候,突然发现我在整板铺地的时候,复制拷贝铜皮以后,双击复制的铜皮设置铜皮的层,设置好以后重新铺铜。但是出现一个问题,就是重新铺的铜皮不会避让,会在以前原有铺好的铜皮里面也会铺进地网络,搞的我莫名其妙的,以前整板铺铜我也是这样的,都不会出现这样的问题。有没有人能帮忙解答下啊?

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2#
发表于 2012-6-7 12:04 | 只看该作者
你的意思我不太清楚
( C( x; M" v" P2 T+ D) ]1 N! e! ?0 J+ V3 A
复制的铜皮一般里面的网络都是NO NET,要重新设置NET,你看看你复制的铜的网络有没有改成GND
$ t0 r1 B3 p* ~' _) [5 D9 i. r7 D8 \% \) B

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3#
 楼主| 发表于 2012-6-7 12:57 | 只看该作者
黑驴蹄子 发表于 2012-6-7 12:04 3 ^+ y2 E% _+ R- g# X$ b
你的意思我不太清楚
7 n( P6 b; S0 D9 ]6 |( P, B
$ q3 y8 N: W) Z' a3 T9 t2 v复制的铜皮一般里面的网络都是NO NET,要重新设置NET,你看看你复制的铜的网络有没有 ...
: ^  K* J6 Z! Q7 A) P% T2 W8 j2 M
已经改过了,我的意思就是说,比如我的TOP和BOTTOM层需要整板铺地,我先手动在BOTTOM画一个铺铜区域,然后我把这块铺铜复制一次,在粘贴,现在BOTTOM层就有两层铜皮,其中复制的那层铜皮是没有网络属性的。我选中复制的那一层,将铜皮的网络设置为DGND,然后在层选项那里选择TOP层,这样的话就不用在手工去TOP画铜皮了。以前遇到不同层相同形状的铜皮我都是这样做的,可是昨天突然遇到这个问题,就是这样复制的铜皮在铺DGND网络的时候它会和以前我处理电源的铺好的铜皮不避让,有的更是直接铺在以前的电源铜皮里面,重叠在一起。

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4#
发表于 2012-6-7 13:19 | 只看该作者
77991338 发表于 2012-6-7 12:57
0 l+ v( U7 D4 F4 ]已经改过了,我的意思就是说,比如我的TOP和BOTTOM层需要整板铺地,我先手动在BOTTOM画一个铺铜区域,然后 ...
+ ?& [! B* R: j( I
既然你原来处理的电源地网络和你复制的铜是想通的而网络,那他们是会叠到一起的, B2 h4 r' }0 I4 q1 B0 q
  B7 G* a6 P% h1 Q6 s7 C; v, Q
如果你不想他覆盖住你原来的铜皮,你双击你复制的铜皮,选下这个试试/ \. L# ~% i$ |. P" R
) h9 |# [& i6 q! k* ?& L4 q

; c% G# d/ d7 G9 f* o2 [' i# Q$ n' O* R# J. ~  G6 X, }/ y( n6 |3 I

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5#
 楼主| 发表于 2012-6-7 13:45 | 只看该作者
黑驴蹄子 发表于 2012-6-7 13:19 4 u* [, k$ h' x. A/ A$ e! \
既然你原来处理的电源地网络和你复制的铜是想通的而网络,那他们是会叠到一起的5 e/ r( {( s, }* g5 d

& u& N$ l. M# _如果你不想他覆盖住你 ...

0 _) Z; y: D' l3 s% E不是的呢,现在是我那样铺铜,DGND网络也会和TOP层以前铺好的其它的网络铺铜叠在一起,比如VCC,3.3v什么的。

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6#
发表于 2012-6-7 14:33 | 只看该作者
77991338 发表于 2012-6-7 13:45
! Z5 Y& B) e) k# `. Z$ s8 C不是的呢,现在是我那样铺铜,DGND网络也会和TOP层以前铺好的其它的网络铺铜叠在一起,比如VCC,3.3v什么的 ...

% h( _2 [. m: ^' ~0 c我经常这样复制铜皮的,也不会出现这种问题的,在排除软件问题的前提下,你查查下面几点:1 l: W$ }3 d! j) d- A# S
. w- [! b' l# |- B  V3 [4 J8 W
1,你看看PREFERENCE里面的ONLINE DRC,开了没
; k  v8 h/ O0 `2 C! _( {: J  }' W' M( i5 y3 ]; }5 L
2,还有你的规则里的间距规则设置情况
- S$ n6 e) v# f% f$ B' _9 f2 a7 B2 Q+ I  [" _' W, D0 G
3,规则中允许短路的规则设置情况
5 V  F/ r/ x; I  N1 t0 k6 Q8 P7 V6 e+ _
4,确保你复制的是POY,而不是FILL啊
  V: B/ I* W0 V5 V5 n& H
$ a! {+ S& F3 b: p0 m/ b+ C! E5,我也想不出来了.......{:soso_e127:}
" N  C& `; i4 l, d' D
" W- p$ f& |9 q' R* L你再试试,不行的话给我截个图看看呢

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7#
发表于 2012-6-7 14:33 | 只看该作者
77991338 发表于 2012-6-7 13:45
  f' j5 |' ?  ?3 t不是的呢,现在是我那样铺铜,DGND网络也会和TOP层以前铺好的其它的网络铺铜叠在一起,比如VCC,3.3v什么的 ...

% C7 Y$ P3 D7 W: O3 m

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8#
 楼主| 发表于 2012-6-7 15:58 | 只看该作者
黑驴蹄子 发表于 2012-6-7 14:33
7 P8 g2 D8 ?2 m9 f* e. g6 l; O3 K我经常这样复制铜皮的,也不会出现这种问题的,在排除软件问题的前提下,你查查下面几点:: N5 R  }. ~; }1 V  A0 t
! t1 L$ Z; h2 i: f1 d
1,你看看P ...

7 I2 A# W* _0 D我在画板子的过程中 在线DRC我是从来不开的,太麻烦了;间距规则的话我也仔细看过了,我一般都会对poly设置15mil的间距的;至于允许短路这个情况应该不可能,因为我这个情况就是在同一个项目中发现的,我项目初始就把规则全部设定完毕,后期我是很少去修改的;我在画板子的时候很少会用到fill的,一般都是poly。我也在这郁闷呢,本来还好端端的,刚开始的时候这样复制过好几次铜皮都没事,后来PCB评审的时候有些地方需要修改,我就删了铜皮,修改完毕后继续这样复制就不行了。

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9#
 楼主| 发表于 2012-6-7 15:59 | 只看该作者
黑驴蹄子 发表于 2012-6-7 14:33
5 M7 k0 F5 @5 Q2 j# u
这几项电器性检查是肯定会全部勾选的,好吧,我上图。

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10#
发表于 2012-6-7 16:02 | 只看该作者
77991338 发表于 2012-6-7 15:58 : K, |& G3 w5 n1 y
我在画板子的过程中 在线DRC我是从来不开的,太麻烦了;间距规则的话我也仔细看过了,我一般都会对poly设 ...

- K* a; ~" a4 r. s/ A; n& \, a+ d* `可能是软件出问题了吧,毕竟大家都是盗版,你可记得上次我问你那个自动结束走线的功能,我的ADW09可以,我装了ADS09和AD10都不可以,你说可郁闷啊,AD用多了之后会发现BUG也还是挺多的
6 _" L2 F" ~. p* E) x! [' W, x! E% A% Z, o  A, [: r. ?
你用AD时间也挺长了我知道,看看你的覆铜设置之类有没有什么问题,不行重启下软件之类的试试,要不应该没什么地方设置的了

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11#
 楼主| 发表于 2012-6-7 16:06 | 只看该作者
黑驴蹄子 发表于 2012-6-7 16:02 % c( w* B0 |: M
可能是软件出问题了吧,毕竟大家都是盗版,你可记得上次我问你那个自动结束走线的功能,我的ADW09可以,我 ...

  ^( i) R2 |( L/ M有可能呢,估计也是软件出线问题了,我自己在好好捣鼓捣鼓吧,盗版货就是贰啊。谢谢你了。

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12#
发表于 2012-6-14 07:51 | 只看该作者
我也遇到这个问题,改完板子之后,铺地,除了电源没连起来,所有的网络都成了一块* c) |  u5 C0 m
对比同时打开的其他板子,规则设置没问题,重新铺过几次,还是解决不了,该怎么办呢
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