【原创】Allegro的pcb设计流程!

dingtianlidi · 发表于 2007-11-23 09:27

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本帖最后由紫菁于 2017-9-14 11:40 编辑

这个是自已制作的，没有什么水评，就是贴几个图和字而已，有什么错误的地方提出来啊！！！

游客，如果您要查看本帖隐藏内容请回复

zdzh111 · 发表于 2017-6-15 14:28

好东东

violit · 发表于 2018-11-1 17:03

学习学习

星雨叶 · 发表于 2018-10-29 09:02

allegro小菜发表于 2014-1-14 11:49
( Y' P; M% A z- t. S) J楼主啊！问你个问题！我根据你的步骤一步一步走！就是导入网表的时候没你那个(.tel 文件)晕死我了他是不元 ...

tel是第三方网表，要先用网表转换工具将其他软件导出来的网表转换一下

SHADOW · 发表于 2007-11-23 09:57

看了，真详细阿！支持原创！

[ 本帖最后由 SHADOW 于 2007-11-23 11:31 编辑 ]

只看该作者 · 发表于 2007-11-23 10:10

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Allen · 发表于 2007-11-23 10:55

严重支持原创内容，新手必读啊！

superlish · 发表于 2007-11-23 10:57

支持

apcfy · 发表于 2007-11-23 11:12

收下了，多谢

GHOST · 发表于 2007-11-23 13:08

顶你大爷的兄弟你真乃一牛人也

GHOST · 发表于 2007-11-23 13:57

兄弟俺按你老的意思去弄了下
有2个问题：1、图纸的设置问题
2、就是路径问题这个俺老整不明白

dingtianlidi · 发表于 2007-11-23 20:12

1、图纸的设置问题？？？？不知你说的是不是图纸设置大小的问题，

那么这个在这里设置，那个width和hight指的是，当你打开格点的时候能显示格点的区域大小．也就是你能布局布线的最大宽度和高度．我们一般不是说你的电路板外围（outline)多大就只设置多大，要留有一定的空间，也不能设置太大了，当放大和缩小比较麻烦，费时又费力．一般的电路板设置宽高为40000（mil），那个leftX和ldftＹ是指最左下角的那个点离原点的位置，大多数为负值，很少为零，设为-10000差不多了，我贴的这个图是不作参考．不面那个move　origin用来移动原点的，如果你想把当前坐标（100 ,-50）处设为原点，你就可以在x,y的方框里输入这个坐标值．
２那个路径的问题,

点击Config_paths会出现这个图片,再点击devpath这个按钮,

出现这个对话框,这几个按钮自已去搞懂,选择你要的当前的库,再点击Design_path有两个路径要设置分别是padpath和psmpath,设置同上.

GHOST · 发表于 2007-11-24 19:19

无语！！！！！！！

:L :L :L :L :L :L :L :L :L :L :L

:funk: :funk:

szkalwa · 发表于 2007-11-25 11:13

不错!!!

SHADOW · 发表于 2007-11-26 15:11

楼主真厉害，呵呵！支持

只看该作者 · 发表于 2007-11-30 09:48

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只看该作者 · 发表于 2007-11-30 10:49

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只看该作者 · 发表于 2007-11-30 10:57

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changxk0375 该用户已被删除	3^# 发表于 2007-11-23 10:10 \| 只看该作者提示: 作者被禁止或删除内容自动屏蔽
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zqy610710 该用户已被删除	14^# 发表于 2007-11-30 10:49 \| 只看该作者提示: 作者被禁止或删除内容自动屏蔽
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