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与FPGA的HDL语言的层次概念?

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发表于 2023-1-6 10:13 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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FPGA的HDL语言的层次概念?
* ]4 r- ^& s# K, U1 }% {* i

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2#
发表于 2023-1-6 10:48 | 只看该作者
本帖最后由 lili_qq 于 2023-1-6 10:59 编辑 % _( V! X) O* o& p
2 R9 d; U  S3 G% u) X. q
HDL语言是分层次的、类型的,最常用的层次概念有系统与标准级、功能模块级,行为级,寄存器传输级和门级。

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3#
发表于 2023-1-6 11:25 | 只看该作者
   系统级,算法级,RTL级(行为级),门级,开关级  

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4#
发表于 2023-1-6 13:31 | 只看该作者
自顶向下:
0 ]) `4 Q" T9 _! E首先定义顶层功能块,进而分析需要哪些构成顶层模块的必要的自模块,然后对子模块进行分解,直到达到无法进一步分解的底层功能块。
+ ?4 a, q" r/ F8 Q% X自底向上:7 w6 N, _; G8 z) `9 q
首先对现有的功能块进行分析,然后使用这些模块来搭建一些规模较大的模块,如此继续直至顶层模块。
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