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verilog FPGA初始化复位

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  • TA的每日心情
    开心
    2022-1-29 15:04
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    [LV.1]初来乍到

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    1#
    发表于 2022-11-17 14:06 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    x
    verilog不作仿真用,- U6 U2 s8 L" D' ]  D& W9 i
    现在一般的FPGA上电会自动复位所有寄存器到0吗?我看说明书上说初始化配置储存器,那内部定义的寄存器是什么状态呢?
    7 U2 z  S# N: ~  l, b' z; F" z6 n- q. M7 C) y# Q" ~" K/ k
    如果有个寄存器A和输入RSTn. 要怎么写才能让上电后RSTn自动复位一次,给A <= 2'b11) B/ Y1 e0 i0 `: j9 |! b. S7 r8 O
    always @( posedge CLK or negedge RSTn )- ?: E9 T! R. ]$ N" w$ {0 T
    if(!RSTn) A <= 2'b11;* w8 H1 O( }* N+ x; ~) H+ R4 f
    7 S9 P6 t  _- ]  X
  • TA的每日心情
    开心
    2022-1-29 15:04
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    [LV.1]初来乍到

    2#
    发表于 2022-11-17 14:59 | 只看该作者
    仿真一般用modelsim来着。板子通电一般是从默认值开始的,不是复位,而是寄存器就不存数据,断电就清零。因为用的是一般是ram
    ( d  _9 B, `1 V5 l9 S3 m+ `ram这个元器件是用mos管做的,没电就不会执行刷新,就没有数据了。& f4 b; Q. e1 _. [1 ~/ o
    让rst作为行为模块第一行,0时刻执行就好啊$ |( W: y: @6 p2 j8 {8 V# @1 A
    initial
    7 W, m% {5 _7 j* jbegin# w6 x+ e6 c( e; n. _$ a/ K4 f
    rst=1'b0;
    3 w) j# h" k" ]4 @# y9 dalways //然后需要执行循环语句就好6 E* F. m4 K/ u: ^5 \; G
    end

    点评

    那initial执行一次的话不是一直让rst=0吗,那板子不会每个时钟脉冲都一直不停的复位?  详情 回复 发表于 2022-11-17 15:09
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    2022-1-29 15:04
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    [LV.1]初来乍到

    3#
     楼主| 发表于 2022-11-17 15:09 | 只看该作者
    purpose_857 发表于 2022-11-17 14:59
    0 G6 G: h. S! }仿真一般用modelsim来着。板子通电一般是从默认值开始的,不是复位,而是寄存器就不存数据,断电就清零。因 ...
    4 q0 N$ _+ u, l8 @/ ?* R; \# o
    那initial执行一次的话不是一直让rst=0吗,那板子不会每个时钟脉冲都一直不停的复位?, r. W. u. Z3 t6 h! e* U; o0 O. y
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    2022-1-29 15:04
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    [LV.1]初来乍到

    4#
    发表于 2022-11-17 15:15 | 只看该作者
    不是啊。复位一次。
    : D3 T- F& t$ x5 [1 ?; N  `- ?5 v- V! I如果将这句放在always行为里面就会每次循环就复位一次
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