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使用 AHDL 语言编写的程序有疑问!

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1#
发表于 2022-11-17 09:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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使用 AHDL 语言编写的程序. 在 Quartus II 1. 0 下编译, 使用的是 20K400EBC652-3的片子. 将编译产生的 pof 文件下载到 EPROM 里, 但是在程序没有多大修改的情况下(仅仅改变一些测试管脚), 程序运行结果不一样. 具体表现在 DSP 芯片启动 FPGA 里的一根控制线不稳.3 p: C9 P0 r6 H; d; B0 R

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2#
发表于 2022-11-17 11:17 | 只看该作者
逻辑功能仿真结果如何?在修改前后有没有改变?假如说功能仿真是对的, 请确认设计Timing 是否满足要求, 尤其是 IO 的 Timing 要求是否达到. 在可能的情况下进行后仿真, 其仿真结果能够确保你的逻辑在PCB板上正常地工作. 假如仿真结果与Timing要求都没有问题, 其逻辑一定能在板子上正常地工作.

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3#
发表于 2022-11-17 13:15 | 只看该作者
AHDL文件的格式包括三个部分:0 F2 q' n  d7 J* x
    Documentation:注释
6 \. |3 s. `5 E' ?  K2 Y    I/O定义,包括mode和type
6 U1 c1 f( |8 q- ^    - Mode:定义一个端口是输入/输出抑或两者兼备2 T% {; A* P& H$ ^6 o
    - Type:定义bits的数量
. n& s. x( T4 M5 k8 \; \( M    Functional description: 定义电路的逻辑
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