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[Cadence Sigrity] SystemSI-Parallel bus analysis(DDRx)仿真模型on die上的参数问题

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1#
发表于 2012-2-17 11:55 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 shg_zhou 于 2012-2-17 12:23 编辑 7 N" h( R, Y. H0 ~# J4 K% g

' E7 P% l' l# Z: R0 |, S* C2 dOn die上寄生参数的模型从何而来,其具体的Top是怎样的?
. b' E4 H9 I# B# E% o, K( a8 i* [$ x) T  `
如下图: Short resistor ; PDS resistor ; PDS capacitor等;" }' k, a/ |. \* t: a; \7 x; \9 l

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shihan + 2

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该用户从未签到

2#
发表于 2012-2-17 12:02 | 只看该作者
The PDS RC values are just between the power and ground terminals of the IOCells (drivers/receivers). The “short” resistor is the resistance of the signal paths through the die, which is essentially the RDL (re-distribution layer) parasitics for each signal. User can get these parameters from the chip design team.
, Q& B5 c. \; C. H, n$ v
  • TA的每日心情
    开心
    2022-5-20 15:33
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    [LV.1]初来乍到

    3#
    发表于 2012-2-18 11:52 | 只看该作者
    研究中感兴趣的项目啊!
    $ v3 p2 p% F6 c! C* P7 y谢谢Sigrity工具

    该用户从未签到

    4#
    发表于 2012-11-27 22:14 | 只看该作者
    from the IBIS model

    该用户从未签到

    5#
    发表于 2013-10-28 19:37 | 只看该作者
    直接看IBIS model里面每个pin脚对应的rlc+ ?' W8 x5 |) M
    手动添加。
    & U+ Q/ j' C5 v4 U# k# l

    该用户从未签到

    6#
    发表于 2018-11-7 15:23 | 只看该作者
    xuexixuexi
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