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我用的FPGA的时钟源和ODDR2的IP核可以用在cpld中吗?

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发表于 2022-10-14 16:33 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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我用的FPGA的时钟源和ODDR2的IP核可以用在cpld中吗?
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2#
发表于 2022-10-14 17:01 | 只看该作者
时钟从专用引脚进FPGA,有专门的走线直接进GCLK驱动,如果不走专用引脚进,也可以进,但是要经过其他走线资源,增加延时。一般建议走专用引脚,这样延时小,而且延时固定,这个在高速系统里很重要。
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3#
发表于 2022-10-14 17:24 | 只看该作者
ip核都是有器件类型的限制的,一般不可以。
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