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EDA365电子论坛网»电子社区 › 研发技术版块 › FPGA|CPLD论坛 › xilinx cpld 输入有上拉电阻吗？
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xilinx cpld 输入有上拉电阻吗？

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choose521

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1#
发表于 2022-8-2 13:11 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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xilinx cpld 输入有上拉电阻吗？/ g. k; \# y4 s, @( Y

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oewqe

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2#
发表于 2022-8-2 13:51 | 只看该作者
应该有个 弱上拉。 在 UCF 文件管脚定义里面加个 PULL UP 即可。- O8 R& R6 ~' _  A$ u
但最好是在单板外面加。
2 h) u* o1 [- U0 k; @. v% n

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mqerew

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3#
发表于 2022-8-2 14:25 | 只看该作者
同问，求结果' H& ~+ W3 _/ S5 ~7 p

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ESCAPE

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4#
发表于 2022-8-2 14:54 | 只看该作者
再看看别人是怎么说的

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