allegro DRC shape -hole 间距问题

y1014730 · 发表于 2022-5-8 14:08

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如图所示，规则里面的 shape - hole 的间距问题为什么shape - hole 不按照规则进行约束，变成了 8.1多MIL ，有没有大神能解决的。谢谢了

aarom · 发表于 2022-5-9 01:48

提示: 作者被禁止或删除内容自动屏蔽

aarom · 发表于 2022-5-8 15:15

提示: 作者被禁止或删除内容自动屏蔽

y1014730 · 发表于 2022-5-8 19:10

aarom 发表于 2022-5-8 15:15
. Q: T+ [- ]2 ^, E$ g是依THRU VIA 間距而非 hole間距, THRU VIA 單邊pad是至少4mill + 加上設計間距 ...

这个就是我内层不接线的地方不要pan,只留钻孔就可以了，我设置的是铜皮距离钻孔是6.5MIL，但是在PCB上并不执行这个规则，我是想问下，是什么原因导致我设置的是6.5MIL，但是间距却变成了8多，而设置的CLINE到钻孔的间距7MIL 这个地方却可以按照这个规则执行。是不是我阿里狗设置的有什么地方不一样

ldezgr · 发表于 2022-5-9 08:46

看看大佬们怎么说

y1014730 · 发表于 2022-5-9 15:24

aarom 发表于 2022-5-9 01:48
; f; e$ D* Y9 m重點還有一個, 在設定User Preferences 某個功能不能打開, 不然會依有pad時避開距離. ( Y2 o/ j9 _: ~& d0 {8 B2 F- \
" g. n- a! D. M( |
User Preferenc ...

谢谢大佬晚上回家试试看谢谢了

敢敢喔 · 发表于 2022-5-10 13:52

谢谢楼主的分享~

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