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分ballmap的规则是什么

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    1#
    发表于 2022-3-24 16:21 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    怎么分ballmap;GND  VCC,还有模拟信号和数字信号的电源  地应该怎么分配
    : d8 B$ \, H# ~$ K! B: ~9 m- [8 H

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    发表于 2022-3-25 12:41 | 只看该作者
    冰睡着的水 发表于 2022-3-25 09:18" r2 [0 l4 s6 \: L) u+ A
    34x34=1156个ball  功能引脚有600个,剩下的都是GND(包括数字地,模拟地)
    " J9 Y6 K, L/ f  Q" p封装里有个ADC芯片和DAC芯片, ...

    ! u0 B& C  A. t8 V# F/ C- k. V34X34 应该是FCGBA的封装吧,四个角落不要放ball,如果要放也只能放GND的ball;信号ball分布在最外面8拍排内部;GND和VDD ball十字交叉排列;ADC和DAC下面最好是GND
    2 M- a/ `1 O2 t  T* n1 s6 @

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    2#
    发表于 2022-3-24 17:48 | 只看该作者
    地一定要分开,最好用单独的层
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    3#
     楼主| 发表于 2022-3-24 18:17 | 只看该作者
    Sleep_xz 发表于 2022-3-24 17:48
    8 B& R3 _. t4 z" Z' D1 D地一定要分开,最好用单独的层

    % v0 S) s+ c1 v( f不是基板叠层,我说的ballmap按照什么规则分,比如信号线在外圈,地在中间这样的规则

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    5#
    发表于 2022-3-24 22:55 | 只看该作者
    多少个ball?GND数量有多少?多少个模拟IP??
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    6#
     楼主| 发表于 2022-3-25 09:18 | 只看该作者
    姽婳连篇 发表于 2022-3-24 22:55( x5 e! ^$ G: [1 T. E# W
    多少个ball?GND数量有多少?多少个模拟IP??
    ( C5 U( A/ v7 Y
    34x34=1156个ball  功能引脚有600个,剩下的都是GND(包括数字地,模拟地)
    / D3 Y% X  i' V4 ~封装里有个ADC芯片和DAC芯片,是不是这两个芯片正下面放对应的数字地(电源)、模拟地(电源)会好一些
    & K% p8 Q9 P" E. X电源、地、IO信号的ball怎么分布最好?) l$ ^: j5 i8 c% ?- T' Z4 }8 k7 M  U

    点评

    34X34 应该是FCGBA的封装吧,四个角落不要放ball,如果要放也只能放GND的ball;信号ball分布在最外面8拍排内部;GND和VDD ball十字交叉排列;ADC和DAC下面最好是GND  详情 回复 发表于 2022-3-25 12:41
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    8#
     楼主| 发表于 2022-3-25 13:44 | 只看该作者
    姽婳连篇 发表于 2022-3-25 12:41
    ! X3 ]" e" N: B34X34 应该是FCGBA的封装吧,四个角落不要放ball,如果要放也只能放GND的ball;信号ball分布在最外面8拍 ...

    0 Z+ m+ D$ N  O* x9 E, l+ ~谢谢谢谢   一下清晰了很多
    0 t" Q2 B# K! H还有个几个疑问:1、为什么四个角上不能有球,我参考原来的确实四个角上各去掉了三个球,所以想知道下原因。2、中间是GND和VCC的十字排布,也包括模拟、数字的地/电源吗(模拟、数字的电源/地总共可能就40个)  3、还有你说的ADC  DAC下放GND,是各自的模拟/数字GND,还是总的GND?! e1 v6 _* ~7 \- W8 P/ F4 u

    : t6 y/ ~. t! [% Y) N

    点评

    1.四角是因为封装应力问题,肯定会有断线,如果设计Signal Trace很细只有16~18um,很容易就断了 2.一般各个IP的VSS在封装中合并为一个GND吧?  详情 回复 发表于 2022-3-29 17:35

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    9#
    发表于 2022-3-29 17:35 | 只看该作者
    冰睡着的水 发表于 2022-3-25 13:448 C5 P  B! @/ q
    谢谢谢谢   一下清晰了很多
    : o3 _2 ~# }1 o; {* V还有个几个疑问:1、为什么四个角上不能有球,我参考原来的确实四个角上各去 ...
    2 S. u; o$ y* L$ d' n5 a- a
    1.四角是因为封装应力问题,肯定会有断线,如果设计Signal Trace很细只有16~18um,很容易就断了. s: q6 A7 t' Q  s) _
    2.一般各个IP的VSS在封装中合并为一个GND吧?! ?0 k* k$ D5 }0 w1 [  o$ U
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