找回密码
 注册
关于网站域名变更的通知
查看: 697|回复: 5
打印 上一主题 下一主题

SIP之堆叠技术

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2021-9-26 14:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
芯片堆叠技术在SiP中应用的非常普遍,通过芯片堆叠可以有效降低SiP基板的面积,缩小封装体积。' h+ s$ i" C9 w: c" d0 r/ z
  
% V8 y& U# @9 n4 C! G0 P, l1 N  芯片堆叠的主要形式有四种:( ~# t( K1 g2 U
  金字塔型堆叠& g  H3 o# P; L+ J: R& W
  悬臂型堆叠* B% n$ A. s. |( F! C
  并排型堆叠1 H1 y% U  \8 b6 N0 [
  硅通孔TSV型堆叠) Z* c; X! \6 J9 c4 \6 X1 o5 \
  为什么芯片可以进行堆叠呢?这里面我们讲的主要是未经过封装的裸芯片。曾经有用户问我,封装好的芯片可不可以进行堆叠呢?一般来说是不可以的,因为封装好的芯片引脚在下表面直接焊接到基板上,而裸芯片的引脚一般在芯片上表面,通过键合的方式连接到基板。正是由于裸芯片引脚在上方,和基板的连接方式比较灵活,才有了芯片堆叠的可行性,参看下图
. }/ C8 [' ]. A/ I/ N3 ]  0 G  E7 m, p4 B" {: a# \! j; X
  金字塔型堆叠/ J& W" n' S3 f& A: s# [0 V+ [" F
  金字塔型堆叠是指裸芯片按照至下向上从大到小的方式进行堆叠,形状像金字塔一样,故名金字塔型堆叠,这种堆叠对层数没有明确的限制,需要注意的是堆叠的高度会受封装体的厚度限制,以及要考虑到堆叠中芯片的散热问题。金字塔型堆叠参看下图。6 s) W, m! @: N0 Z8 G
  ' z% b. `' @  j7 D. T( T
  悬臂型堆叠; t7 B$ }8 D2 t/ n% M
  悬臂型堆叠是指裸芯片大小相等,甚至上面的芯片更大的堆叠方式,通常需要在芯片之间插入介质,用于垫高上层芯片,便于下层的键合线出线。这种堆叠对层数也没有明确的限制,同样需要注意的是堆叠的高度会受封装体的厚度限制,以及要考虑到堆叠中芯片的散热问题。悬臂型堆叠参看下图。+ f$ ~+ A+ I8 P  x9 Q
  
9 P3 K: r7 |9 ?( @  并排型堆叠
. `) l  k! n) J3 I  并排堆叠是指在一颗大的裸芯片上方堆叠多个小的裸芯片,因为上方小的裸芯片内侧无法直接键合到SiP封装基板,所以通常在大的裸芯片上方插入一块硅转接板,小的裸芯片并排堆叠在硅转接板上,通过键合线连接到硅转接板,硅转接板上会进行布线,打孔,将信号连接到硅转接板边沿,然后再通过键合线连接到SiP封装基板。并排型堆叠参看下图。! @- Y/ T6 v( [1 i& O; M9 l
  
; E$ ^- p% N  ]2 K$ ?* |  硅通孔TSV型堆叠) F6 B5 x- L7 Y9 u2 n
  硅通孔TSV型堆叠一般是指将相同的芯片通过硅通孔TSV进行电气连接,这种技术对工艺要求较高,需要对芯片内部的电路和结构有充分的了解,因为毕竟要在芯片上打孔,一不小心就会损坏内部电路。这种堆叠方式在存储领域应用比较广泛,通过同类存储芯片的堆叠提高存储容量。目前也有将不同类芯片通过TSV连接,这类芯片需要专门设计才可以进行堆叠。TSV型堆叠参看下图。
8 z3 X, l% X* j+ i( _  a  
0 ^) F- `8 t6 S( ]# K  以上介绍的是SiP设计中四种最基本的芯片堆叠方式。& Y$ {  N* ~: ?8 O( _* c8 f0 k
  在实际应用的时候,这几种堆叠方式可以组合起来形成更为复杂的堆叠。另外,还有通过将键合芯片和倒装焊芯片进行堆叠,通过柔性电路折叠的方式对芯片进行堆叠,以及通过POP形式的堆叠等几种,这些芯片堆叠方式在SiP设计中也比较常见。
: M" N$ N% s; s8 m: ^% P

该用户从未签到

2#
发表于 2021-9-26 14:54 | 只看该作者
芯片堆叠可以有效降低SiP基板的面积,缩小封装体积

该用户从未签到

3#
发表于 2021-9-26 17:24 | 只看该作者
通常在大的裸芯片上方插入一块硅转接板,小的裸芯片并排堆叠在硅转接板上,通过键合线连接到硅转接板
  • TA的每日心情
    奋斗
    2020-10-13 15:19
  • 签到天数: 26 天

    [LV.4]偶尔看看III

    5#
    发表于 2021-9-27 10:10 | 只看该作者
    学习了解一下,谢谢分享。
  • TA的每日心情
    开心
    2022-3-29 15:37
  • 签到天数: 1 天

    [LV.1]初来乍到

    6#
    发表于 2022-3-23 10:57 | 只看该作者
    芯片堆叠可以有效降低SiP基板的面积,缩小封装体积
    您需要登录后才可以回帖 登录 | 注册

    本版积分规则

    关闭

    推荐内容上一条 /1 下一条

    EDA365公众号

    关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

    GMT+8, 2025-9-10 19:38 , Processed in 0.125000 second(s), 23 queries , Gzip On.

    深圳市墨知创新科技有限公司

    地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

    快速回复 返回顶部 返回列表