ARM的体系架构

xiaoming11

1.ARM简介     
ARM是Advanced RISC Machines的缩写，它是一家微处理器行业的知名企业，该企业设计了大量高性能、廉价、耗能低的RISC （精简指令集）处理器。公司的特点是只设计芯片，而不生产。它将技术授权给世界上许多著名的半导体、软件和OEM厂商，并提供服务。
& H& R# l" |* H7 J# s, u, b+ y* O
* r( j9 b; H- W7 X9 Q+ l8 C


1.1 ARM（Advanced RISC Machines）的几种含义:
0 [: M; J! X/ A0 ~5 @; W1、ARM是一种RISC MPU/mcu的体系结构，如同x86架构是一种CISC体系结构一样。另外，还有MIPS架构、PowerPC架构等等。

' I, d1 }% E8 O: M; H# w) G' I! N
2、ARM是Advanced RISC Machine Limited公司的简称。
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/ X9 {: t: n, x) `4 f& Y4 ~" ]5 u
: @. ~$ Y7 M2 j" J. L7 I3、ARM是Advanced RISC Machine Limited公司的产品，该产品以IP Core（Intellectual Property Core，知识产权核）的形式提供的。
) P; H/ W7 _  g+ |
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4、ARM还用以泛指许多半导体厂商买了这种设计后生产出来的“ARM处理器”系列的芯片及其衍生产品。
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0 ?- b3 T2 A2 u0 R: q
, i6 {1 f) [, J& E半导体厂商固然可以光购买ARM公司的设计而直接生产ARM处理器芯片，但是更好的方法是以ARM处理器为核心，在同一块芯片上配上自己开发的外围模块，形成面向特定应用和市场的专用芯片，甚至“片上系统（System on a Chip，SoC）”。这样，作为专用处理器/控制器芯片的生产商既可以减少开发中的风险，又可以大大缩短开发周期，降低成本。所以，“ARM处理器”一般是作为“内核”存在于一些专用处理器/控制器的内部，因而又常常叫做“ARM核”。特别地，如果一个处理器核不带浮点运算功能，有时候就对此特别加以强调，称之为“整形核”。


1..2  ARM微处理器的特点
（1）ARM指令都是32位定长的
8 }* Y+ ]1 Z: \5 f( V6 d
. [4 T9 x# @% A- _) k! S. q
（2）寄存器数量丰富（37个寄存器）
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9 G# s+ d2 m, C- G; w& O( p
（3）普通的Load/Store指令


5 j9 ?( r6 E& S) `（4）多寄存器的Load/Store指令

7 @5 I) Z5 c6 T& _4 J
2 R- ]* ?/ }) J% P! |（5）指令的条件执行

3 m; V8 }  k% ]; E/ r& Y
（6）单时钟周期中的单条指令完成数据移位操作和ALU操作
) S% L- A* ?9 ?$ ~7 f- B; C( ?5 W
5 |( N' i6 O2 k6 C& o- w4 ^. r
- [7 G/ H  }" u) Z（7）通过变种和协处理器来扩展ARM处理器的功能

1 H4 r4 ^9 N4 a4 {7 k/ B' a
4 b- `  o0 G. j' }  J* E（8）扩展了16位的Thumb指令来提高代码密度
0 o$ R- @. D: I* F2 B0 I
+ \6 C5 X) x2 l+ [9 I
: h& n' @& ~$ D* y# qARM作为RISC微处理器与CISC微处理器技术对比如下：
$ s" n% a0 y1 F2 i$ H

# e: k& n% i6 u2 U6 r4 m

1.3 ARM微处理器系列
8 B! f9 \5 w" C* @, ?! C

1.3.1 Classic ARM Processors (经典 ARM 处理器)
     • ARM11™ 系列 - 基于 ARMv6 架构的高性能处理器
0 `4 p* d% R2 a5 ^5 A9 T! D     • ARM9™ 系列 - 基于 ARMv5 架构的常用处理器
     • ARM7™ 系列- 面向通用应用的经典处理器
       ARM 经典处理器适用于那些希望在新应用中使用经过市场验证的技术的组织。这些处理器提供了许多的功能、卓越的能效和范围广泛的操作性能，适用于成本敏感型解决方案。这些处理器每年都有数十亿的发货量，因此可确保设计者获得最广泛的生态系统和资源，从而最大限度地减少集成过程中出现的问题并缩短上市时间。

& N- @) c/ _: d, d. {: I
$ F' p5 [0 X& Z1.3.2  Embedded Cortex Processors (ARM Cortex 嵌入式处理器)
9 u- V5 S, j( L    • Cortex-R 系列 - 面向实时应用的卓越性能
    • Cortex-M 系列 - 面向具有确定性的微控制器应用的成本敏感型解决方案
# x) y' a) H! m# B& \/ m    Cortex 嵌入式处理器旨在为各种不同的市场提供服务。

0 a4 [! o7 ]: P4 \
    Cortex-M 系列处理器主要是针对微控制器领域开发的，在该领域中，既需进行快速且具有高确定性的中断管理，又需将门数和可能功耗控制在最低。

# P- N9 |9 q! i- R& F0 j7 W
    而 Cortex-R 系列处理器的开发则面向深层嵌入式实时应用，对低功耗、良好的中断行为、卓越性能以及与现有平台的高兼容性这些需求进行了平衡考虑。


8 q) v3 P) _7 G& A5 w • Cortex-A 系列
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' D( S- I3 S. @) F7 U, O. A; S% Y

+ A& s' ?/ ^: e# ?) S. f
+ g. k) C; x: }# U2 _" n) u/ r( {


) Q! h, m9 R1 L! }$ u+ X' s- zARM编程模型
6 `: E5 x7 b9 e4 U  j3 Z) K1. ARM数据类型
（1）字（Word）：在ARM体系结构中，字的长度为32位。
+ N+ N' A8 t" @; H7 U3 \7 f

（2）半字（Half-Word）：在ARM体系结构中，半字的长度为16位。

' K. q2 y3 t3 K& E
) D: L4 M) A3 D+ d' ~  S（3）字节（Byte）：在ARM体系结构中，字节的长度为8位。
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" \  x. c4 B, }" v
2. ARM处理器存储格式
5 C& A; ?# M+ e+ ?/ [) ~* A: I9 r  x# FARM体系结构将存储器看作是从0地址开始的字节的线性组合。作为32位的微处理器，ARM体系结构所支持的最大寻址空间为4GB。

9 q, R7 R' f9 H' j9 k* q: N
7 {5 l& S; w6 T6 sARM体系结构可以用两种方法存储字数据，分别为大端模式和小端模式。

  {. x9 a; D( V
- [1 W7 e2 g' ]: R+ B( ^- G+ ]' K大端模式（高地高低）：字的高字节存储在低地址字节单元中，字的低字节存储在高地址字节单元中。

) k( n& |; a( E- i
2 F: @' m% U! k4 A7 D. b# w: I, w小端模式（高高低低）：字的高字节存储在高地址字节单元中，字的低字节存储在低地址字节单元中。

: g/ A" ]6 t& G, o- J* j2 S
3. ARM处理器工作状态
从编程的角度来看，ARM微处理器的工作状态一般ARM和Thumb有两种，并可在两种状态之间切换。

' a, U% e0 T% P" E* p0 W$ a9 h
$ L4 [4 |; d# ~( K（1）ARM状态：此时处理器执行32位的字对齐ARM指令，绝大部分工作在此状态。


: ^5 Z7 c6 H  U% f（2）Thumb状态：此时处理器执行16位的半字对齐的Thumb指令。
8 T- e8 X- f  {7 l$ n% t4 g
+ j6 d1 b3 \& `0 M0 t' {6 {# O
; r0 t1 ?5 d( W  D3 l2 `4. ARM处理器工作模式
$ ]+ Y" U% N6 o( c* h（1）用户模式（usr，User Mode）：ARM处理器正常的程序执行状态。

- j# B5 [0 d  l0 k( R# @4 b+ I1 e
0 |' G, S, D3 M# r: B" \（2）快速中断模式（fiq，Fast Interrupt Request Mode）：用于高速数据传输或通道处理。当触发快速中断时进入此模式。
7 y; f# d1 b& c3 s' @
, [" h+ {7 T8 J
（3）外部中断模式（irq，Interrupt Request Mode）：用于通用的中断处理。当触发外部中断时进入此模式。
" K' |8 q/ `* ]

( S  }9 a0 I; ]（4）管理模式（svc，Supervisor Mode）：操作系统使用的保护模式。在系统复位或执行软件中断指令SWI时进入。
0 N$ c9 D4 i; g# I/ d" A
4 q$ Q2 _% Z+ F9 o3 y6 ~/ ^
（5）数据访问中止模式（abt，Abort Mode）：当数据或指令预取中止时进入该模式，可用于虚拟存储及存储保护。

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（6）系统模式（sys，System Mode）：运行具有特权的操作系统任务。
* }- \- y2 |' R- `' ^' g7 P7 g

（7）未定义指令中止模式（und，Undefined Mode）：当未定义的指令执行时进入该模式，可用于支持硬件协处理器的软件仿真。
! i+ R( G  q8 @$ T
; n2 u1 h0 G) \5 G
除了用户模式之外，其余六种模式都是特权模式。除了用户模式和系统模式之外，其余五种模式都是异常模式。

! v: \1 n  B8 L/ k: B* F( L* j$ [
在特权模式下程序可以访问所有的系统资源。非特权模式和特权模式之间的区别在于有些操作只能在特权模式下才被允许，例如直接改变模式和中断使能等。而且为了保证数据安全，一般MMU会对地址空间进行划分，只有特权模式才能访问所有的地址空间。而用户模式如果需要访问硬件，必须切换到特权模式下，才允许访问硬件。


5. ARM处理器寄存器组织
0 s* ?9 j1 h# V4 A! MARM共有37个32位寄存器，其中31个为通用寄存器，6个为状态寄存器，包括R0-R15，R8_fiq-R14_fiq，R13_svc,R14_svc,R13_abt,R14_abt,R13_irq,R14_irq,R13_und,R14_und,CPSR,SPSR_fiq,SPSR_svc,SPSR_abt,SPSR_irq，SPSR_und。如图。


通用寄存器包括R0-R15，可以分为3类：
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（1）未分组寄存器R0-R7


; m! s, j; f, G: p1 M在所有运行模式下，未分组寄存器都指向同一个物理寄存器，他们未被系统用作特殊的用途。因此在中断或异常处理进行异常模式转换时，由于不同的处理器运行模式均使用相同的物理寄存器，所以可能造成寄存器中数据的破坏。
6 S4 v1 d" I3 V) _( r
% I' H% |6 [! p8 `6 }1 Z7 ?$ A
（2）分组寄存器R8-R14
" M7 Q$ w. o/ p
  r8 w3 Z" O3 }$ n& a
对于分组寄存器，他们每次所访问的物理寄存器都与当前的处理器运行模式相关。具体如上图。


" U, l5 X3 e& @1 K( h  X: |5 vR13常用作存放堆栈指针，用户也可以使用其他寄存器存放堆栈指针，但在Thumb指令集下，某些指令强制要求使用R13存放堆栈指针。
. `: F% _* l) d$ Y) M, c
' l) c( \. t8 [( ]! ~: T
8 U' k( U5 \" ]2 E8 ZR14称为链接寄存器（LR，Link Register），当执行子程序时，R14可得到R15（PC）的备份，执行完子程序后，又将R14的值复制回PC，即使用R14保存返回地址。

; L5 z3 d0 L4 u& B/ s* w5 O* w
. l* e# C0 x* u（3）程序计数器PC（R15）


; i0 K( D2 }: J- `+ g寄存器R15用作程序计数器（PC），在ARM状态下，位[1:0]为0，位[31:2]用于保存PC；在Thumb状态下,位[0]为0，位[31:1]用于保存PC。


由于ARM体系结构采用了多级流水线技术，对于ARM指令集而言，PC总是指向当前指令的下两条指令的地址，即PC的值为当前指令的地址值加8个字节。
, X4 B- N1 I0 ?9 g/ u4 h
1 Q$ r9 E* l& V2 W. X% s
6. 程序状态寄存器CPSR和SPSR
; T) D& r  U; m- m9 b. o8 tCPSR（Current Program Status Register，当前程序状态寄存器），CPSR可在任何运行模式下被访问，它包括条件标志位、中断禁止位、当前处理器模式标志位以及其他一些相关的控制和状态位。
3 L4 g9 G3 T6 ]; \& R  k

每一种运行模式下都有一个专用的物理状态寄存器，称为SPSR（Saved Program Status Register，备份的程序状态寄存器），当异常发生时，SPSR用于保存当前CPSR的值，从异常退出时则可由SPSR来恢复CPSR。


# t  Y- x9 |! _* u; [& @7 p# v由于用户模式和系统模式不属于异常模式，这两种状态下没有SPSR，因此在这两种状态下访问SPSR，结果是未知的。
9 u8 h/ w8 m9 o/ _" G8 n

CPSR保存数据的结构：
) G' ~2 X5 M1 H4 k

1）N（Negative）：当用两个补码表示的带符号数进行运算时，N=1表示结果为负，N=0表示结果为正数或零
" o1 M; \9 y3 \4 m; h
5 G+ }% @" h/ D
' L& S2 c4 a! s* H2）Z（Zero）：Z=1表示运算结果为0，Z=0表示运算结果非零

* J, l! n( U& i
! G7 {3 x7 j: t0 x+ e4 t3）C（Carry）：有4种方法可以设置C的值：
& A8 C4 \& v7 @  S  s

% D6 v# H' B2 w; I% T（1）加法指令（包括比较指令CMP）

; Y/ A" c3 n5 W# S% R
（2）当运算产生进位时（无符号数溢出），C=1，否则C=0
5 _! p0 l9 f' {2 Q, S9 n

（3）减法运算（包括比较指令CMP）
) u; V! B2 M+ l, M( s# s& m

（4）当运算产生了借位（无符号数溢出），C=0，否则C=1
; F  j1 G* ^' X; v
% d+ e: d8 A1 x: ]0 F8 f
5 }% `- _9 `# g/ r' n对于包含移位操作的非加/减运算指令，C为移出值的最后一位。对于其他的非加/减运算指令，C的值通常不变。
- v3 l, a  {% b* G' I
1 q; }0 g7 M: P/ o
4）V（OveRFlow）：有2种方法设置V的值：


" X! g1 z0 ^1 W* x* T3 w（1）对于加/减法运算指令，当操作数和运算结果为二进制的补码表示的带符号数时，V=1表示符号位溢出。
- l2 o0 `* m1 Z# L: t

$ r) j0 e' h. D* H8 c- e4 Z) B% W（2）对于其他的非加减法运算指令，V的值通常不变。
7 ?3 p  E( I- {( I
, ^3 u! M4 i' U, z3 L7 Y5 E
5）I（Interrupt Request）：I=1表示禁止响应irq，I=0表示允许响应
% F0 r  J7 u# l
4 K' w( ^, e0 Z0 m# d3 B* q
6）F（Fast Interrupt Request）：F=1表示禁止响应fiq，F=0表示允许响应
2 k" K, S2 A" e/ a7 n) z) x

7）T（Thumb）：T=0表示当前状态位ARM状态，T=1表示为Thumb状态


8）M4-M0：表示当前处理器的工作模式，如图：
; m- v- r( K& E3 D+ T

7. 工作模式的切换
（1）执行软中断（SWI）或复位命令（Reset）指令。如果在用户模式下执行SWI指令，CPU就进入管理（Supervisor）模式。当然，在其他模式下执行SWI，也会进入该模式，不过一般操作系统不会这么做，因为除了用户模式属于非特权模式，其他模式都属于特权模式。执行SWI指令一般是为了访问系统资源，而在特权模式下可以访问所有的系统资源。SWI指令一般用来为操作系统提供API接口。
4 w/ p, X* U- h1 Q2 Y2 e3 L+ p6 x
. P% ^! Q! d" v- E% d! z. H
) U( [/ n/ Z8 h4 D2 @, |（2）有外部中断发生。如果发生了外部中断，CPU就会进入IRQ或FIQ模式。
$ I6 o1 w% \1 M3 T

; b, B. S3 F$ b% \+ Y（3）CPU执行过程中产生异常。最典型的异常是由于MMU保护所引起的内存访问异常，此时CPU会切换到Abort模式。如果是无效指令，则会进入Undefined模式。

6 l3 }. f% ]2 r9 _3 s
& d6 E* B, ?( i" h（4）有一种模式是CPU无法自动进入的，这种模式就是System模式，要进入System模式必须由程序员编写指令来实现。要进入System模式只需改变CPSR的模式位为System模式对应的模式位即可。进入System模式一般是为了利用System模式和用户模式下的寄存器相同的特点，因此一般情况下，操作系统在通过SWI进入Supervisor模式后，做一些操作后，就进入System模式。
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: Y" D/ |4 N% L( u（5）在任何特权模式下，都可以通过修改CPSR的MODE域来进入其他模式。不过需要注意的是由于修改的CPSR是该模式下的影子CPSR，即SPSR，因此并不是实际的CPSR，所以一般的做法是修改影子CPSR，然后执行一个MOVS指令来恢复执行某个断点并切换到新模式。

$ w3 x4 c$ @% O

jspij1

进入System模式要通过编写指令来实现

muzitongxue

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showmaker

ARM体系结构可以用两种方法存储字数据

ceohls

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