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FPGA设计中 Verilog HDL实现基本的图像滤波处理仿真

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发表于 2021-8-5 15:35 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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FPGA设计中 Verilog HDL实现基本的图像滤波处理仿真.pdf (772.95 KB, 下载次数: 0) 3 O! C" K2 e/ b6 C( F6 {
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发表于 2021-8-5 17:20 | 只看该作者
A=importdata('E:\matlab\Vivado\mem2image.txt');' A! o2 t5 H$ ^7 g
: N& f0 Y7 E; l) r
A=A./255;
% k& \: o; j, P& @( [) @% e
0 g+ V# s+ d8 {& G1 d; Mimshow(A);
! m5 \5 h8 U/ y. r8 h4 A0 h0 p& l; q7 K  t* P9 n
注意这里的A是double类型的,直接进行imshow会全白,要转化到0-1:A=A./255,或者把double类型转化为整形
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