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[Ansys仿真] 仿真DDR传输线的S参数

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  • TA的每日心情
    开心
    2021-11-26 15:02
  • 签到天数: 65 天

    [LV.6]常住居民II

    跳转到指定楼层
    1#
    发表于 2021-7-7 12:59 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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    x
    S11、S12是在端口阻抗取50Ω时较好,但是串扰又是在取100欧姆时的结果较好,这个有点搞不明白,S11、S12的结果和串扰的结果是不是需要在不同端口阻抗的情况下仿真得到?此处自动@各路大神

    该用户从未签到

    2#
    发表于 2021-7-7 13:58 | 只看该作者
    需要在不同端口阻抗的情况下仿真0 X* ~/ Y, c; R$ c% Z

    点评

    就是说S11、S12和串扰分别是在端口阻抗为50欧姆和100欧姆的情况下仿真得到的吗  详情 回复 发表于 2021-7-7 15:48
  • TA的每日心情
    开心
    2022-1-20 15:27
  • 签到天数: 49 天

    [LV.5]常住居民I

    3#
    发表于 2021-7-7 15:03 | 只看该作者
    学习中,等大佬们回复
  • TA的每日心情
    开心
    2021-11-26 15:02
  • 签到天数: 65 天

    [LV.6]常住居民II

    4#
     楼主| 发表于 2021-7-7 15:48 | 只看该作者
    serenade 发表于 2021-7-7 13:58& d1 h5 C8 ^* \5 t1 X, H
    需要在不同端口阻抗的情况下仿真

    # B% y: V7 f  M5 F. n就是说S11、S12和串扰分别是在端口阻抗为50欧姆和100欧姆的情况下仿真得到的吗/ y+ k, {0 U6 D# G+ x0 e
  • TA的每日心情
    慵懒
    2021-4-2 15:00
  • 签到天数: 1 天

    [LV.1]初来乍到

    5#
    发表于 2021-7-13 14:15 | 只看该作者
    芯片引脚在作为发射端和接收端时阻抗是不一样的,接收端一般都是高阻抗,要到ANSYS electronics desdtop里面做详细的串扰就使用实际阻抗连接,如果是在SIwave里面仿S参数,那就按layout阻抗设计去设port阻抗。一般DDR都是50,如果有多芯片拓扑网络比较长,会要求阻抗低一些。

    该用户从未签到

    6#
    发表于 2021-7-15 13:05 | 只看该作者
    6666666666666
  • TA的每日心情

    2025-6-28 15:03
  • 签到天数: 737 天

    [LV.9]以坛为家II

    7#
    发表于 2021-7-16 09:12 | 只看该作者
    dddddddddddddddd
  • TA的每日心情

    2024-11-18 15:56
  • 签到天数: 82 天

    [LV.6]常住居民II

    8#
    发表于 2021-7-18 19:36 | 只看该作者
    学习中,等大佬们回复
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