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[毕业设计] Pareto支配的MPRM电路面积与可靠性优化

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发表于 2021-6-24 09:10 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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摘 要: 针对 MPRMMixedPolarity ReedMuller) 电路的面积与可靠性折中优化问题, 在逻辑级建立面积估算模# e/ ^' s2 n- |  ?4 t  `; ^' x
型以及电路 SERSoft Error Rate) 解析评价模型, 并采用 Pareto 支配概念对 MPRM 电路进行面积与可靠性多目标优化
1 S! y6 S5 K$ b  V5 f通过对 MPRM 电路的 XOR 部分进行树形异或门分解, 并考虑多个输出之间异或门的共享, 建立面积估算模型采用4 a' R8 [4 v# n: n9 ~
信号概率和故障传播方法, 并考虑电路中的逻辑屏蔽因素以及信号相关性, 建立电路 SER 解析评价模型根据所提出
' g& ?' w% r4 \) l/ D/ R" `  m的面积和 SER 评价模型, 采用极性向量的格雷码序穷举搜索 MPRM 的极性空间得到 MPRM 电路面积与可靠性的 Pa+ E5 H, Q! S5 n- j
reto 最优解集, 并使用效率因子技术指标选取最终解. MCNC 基准电路的实验结果表明, 与面积最小 MPRM 电路相比,9 y& h0 Y; ~+ R7 E2 b5 c
所选取的 MPRM 电路可以在较小面积开销的前提下获得较高电路可靠性
2 }# ?& G% n; M1 f4 u6 E. ?0 V关键词: MPRM 电路; 可靠性优化; 面积优化; SER 解析评价模型; Pareto 支配; 多目标优化
5 }% G9 \; w7 e+ I9 n6 u" X; K6 l
9 [4 s1 S5 G. s: j) \" S 基于Pareto支配的MPRM电路面积与可靠性优化.pdf (597.02 KB, 下载次数: 0) # g$ h! n1 k# I: T

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发表于 2021-6-24 10:33 | 只看该作者
Pareto支配的MPRM电路面积与可靠性优化 ,收藏了。
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