数字逻辑门之上拉电阻设计教程，赶快收藏起来吧！

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数字逻辑门可用于连接到外部电路或设备，但必须注意确保其输入或输出正确运行并提供预期的开关条件。
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6 Y. O. ~5 o, d' m现代数字逻辑门，IC和微控制器包含许多称为“引脚”的输入以及一个或多个输出，这些输入和输出需要正确设置（高电平或低电平），数字电路才能正常工作。
我们知道逻辑门是任何数字逻辑电路中最基本的组成部分，并且通过使用“与”门，“或”门和“非”门这三个基本门的组合，我们可以构建相当复杂的组合电路。但是这些电路是数字的，只能具有两个逻辑状态之一，称为逻辑“ 0”状态或逻辑“ 1”状态。
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这些逻辑状态由两个不同的电压电平表示，低于一个电平的任何电压都被视为逻辑“ 0”，而高于另一个电平的任何电压都被视为逻辑“ 1”。因此，例如，如果两个电压电平分别为0V和+ 5V，则0V代表逻辑“ 0”，而+ 5V代表逻辑“ 1”。
如果数字逻辑门或电路的输入不在可感知为逻辑“ 0”或逻辑“ 1”输入的范围内，则数字电路可能会误触发，因为门或电路未将其触发。识别正确的输入值，因为“高”可能不够高或“低”可能不够低。
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例如，考虑左侧的数字电路。两个开关“ a”和“ b”代表通用逻辑门的输入。当开关“ a”闭合（ON）时，输入“ A”接地（0v）或逻辑电平“ 0”（LOW）；同样，当开关“ b”闭合（ON）时，输入“ B”也被连接到地面，逻辑电平“ 0”（低），这是我们要求的正确条件。

但是，当打开“ a”开关（OFF）时，施加到输入“ A”（高或低）的电压值是多少？我们假设它将是+ 5V（HIGH），因为开关“ a”已开路，因此输入“ A”没有接地短路，但事实并非如此。现在，由于输入已有效地从定义的HIGH或LOW条件断开连接，因此它有可能在0V至+ 5V（Vcc）之间“浮动”，从而允许输入在任何电压电平下自偏置，无论它代表HIGH还是HIGH。低状态。
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这种不确定的情况可能导致开关断开时，“ A”处的数字输入保持在逻辑电平“ 0”（低），而当我们实际上需要逻辑“ 1”（高）时，会导致逻辑门错误地进行开关。输出为“ Q”。同样，一旦到达那里，这个浮动且微弱的输入信号就可以轻易地改变其值，即使它受到来自其相邻输入的干扰或噪声的影响也很小，甚至可能导致其进入振荡状态，从而使门实际上无法使用。关于输入“ B”的切换，同样的情况也适用。
然后，为防止数字电路的意外切换，应将任何未连接的输入（称为“浮动输入”）与适用于该电路的逻辑“ 1”或逻辑“ 0”绑定在一起。我们可以通过通常使用的上拉电阻和下拉电阻为输入引脚提供定义的默认状态，即使开关断开，闭合或没有任何连接，我们都可以轻松实现此目的。
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& i# ?2 \9 N) J: q构建数字电子电路时，通常在单个IC封装中会留有一些备用门或锁存器，否则电路的设计会导致并非所有多输入门的输入都被使用。这些未使用的逻辑输入可通过高值电阻连接至Vcc电压（称为上拉）或通过低值电阻连接至0V（GND）（称为下拉），从而连接在一起或连接至固定电压。这些未使用的输入绝对不能随意浮动。

0 Z4 ^" O0 ]2 K# J* I- M上拉电阻确保数字逻辑门和电路的输入不会自偏置和浮动的最常见方法是将未使用的引脚直接接地（0V）以得到恒定的低“ 0”输入（或门或或非门） ）或直接连接到Vcc（+ 5V），以获得恒定的高“ 1”输入（与门和与非门）。好的，让我们从上方再次看一下我们的两个开关输入。

这次，为了阻止两个输入端A和B在相应开关“ a”和“ b”断开（OFF）时“浮动”，两个输入端连接到+ 5V电源。
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6 t4 F# e! N; H; Y; R您可能会认为这样做会很好，因为当开关“ a”打开（OFF），输入连接到Vcc（+ 5V），并且当开关闭合（ON），输入像以前一样接地时，输入“ A”或“ B”始终处于默认状态，而与开关的位置无关。

/ x9 Y# J4 g3 o- E' @8 D. C3 M但是，这是一个糟糕的情况，因为当两个开关中的任何一个都闭合（ON）时，+ 5V电源和地之间都会存在直接短路，从而导致过多的电流流过熔断保险丝或损坏未导通的电路。好消息。解决该问题的一种方法是使用上拉电阻，如图所示，该上拉电阻连接在输入引脚和+ 5V电源轨之间。
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) j8 x7 H2 z8 @' q+ ^通过使用这两个上拉电阻，每个输入一个，当开关“ A”或“ B”断开（OFF）时，输入通过上拉电阻有效地连接到+ 5V电源轨。结果是，由于只有很少的输入电流流入逻辑门的输入，因此上拉电阻上的压降很小，因此几乎所有+ 5V的电源电压都施加到了输入引脚，从而产生了高电平，逻辑“ 1”条件。

当开关“ A”或“ B”闭合时，（ON）输入会短路接地（LOW），从而在输入端产生逻辑“ 0”状态。但是，这一次我们没有将电源轨短路，因为上拉电阻仅通过闭合的开关流到地面的电流很小（由欧姆定律确定）。
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通过以这种方式使用上拉电阻，输入始终具有默认逻辑状态，根据开关的位置为高或低的“ 1”或“ 0”，从而实现门的正确输出功能在“ Q”处，因此可以防止输入浮动或自偏置，从而为我们提供了所需的准确开关条件。
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尽管Vcc和输入（或输出）之间的连接是使用上拉电阻的首选方法，但由于我们如何计算确保输入正确运行所需的电阻值而引起了一个问题。
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& G2 q& w( ^3 l& n计算上拉电阻值所有数字逻辑门，电路和微控制器不仅受到其工作电压的限制，而且还受到每个输入引脚的电流吸收和拉出能力的限制。数字逻辑电路使用通常由两个不同电压表示的两个二进制状态进行操作：逻辑“ 1”的高电压V H和逻辑“ 0”的低电压VL。但是，在这两个电压状态的每一个中，都有一定范围的电压，这些电压定义了这两个二进制状态的上，下电压。

因此，例如，对于TTL 74LSxxx系列数字逻辑门，显示了代表逻辑电平“ 1”和逻辑电平“ 0”的电压范围。

6 v( t+ l: A4 Q$ C其中：V IH（min）  = 2.0V是保证被识别为逻辑“ 1”（高）输入的最小输入电压，而V IL（max）  = 0.8V是保证被识别为逻辑的最大输入电压“ 0”（低）输入。
换句话说，在0和0.8V之间的TTL 74LSxxx输入信号被认为是“低”，而在2.0和5.0V之间的输入信号被认为是“高”。介于0.8到2.0伏之间的任何电压都不会被识别为逻辑“ 1”或逻辑“ 0”。

当逻辑门连接在一起时，电流在一个逻辑门的输出与另一逻辑门的输入之间流动。基本TTL逻辑门输入所需的电流量取决于输入是逻辑“ 0”（低）还是逻辑“ 1”（高），因为这会为逻辑“ 0”产生电流源动作，并且逻辑“ 1”的灌电流动作。
当逻辑门的输入为高电平时，电流流入TTL输入，因为该输入基本上充当直接接地的路径。该输入电流I IH（max）为正值，因为它“流入”栅极，并且对于大多数TTL 74LSxxx输入，其值为20μA。

同样，当逻辑门的输入为LOW时，电流从TTL输入流出，因为该输入基本上充当直接连接至Vcc的路径。该输入电流I IL（max）为负值，因为它“流出”门，并且对于大多数TTL 74LSxxx输入，其值为-400μA（-0.4mA）。
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请注意，TTL逻辑系列之间的高电压和低电压和电流值不同，而对于CMOS逻辑系列来说，其值要低得多。此外，微控制器，PIC，Arduino，Raspberry Pie等的输入电压和电流要求也将有所不同，因此请先查阅其数据手册。

( N/ R: x$ a" D! U通过了解上述信息，我们可以将单个TTL 74LS系列逻辑门所需的最大上拉电阻值计算为：
1 S# u  m% F0 r! s  g单栅极上拉电阻值

' B3 P4 I3 s. C$ A1 F然后使用欧姆定律，单个TTL 74LS系列逻辑门降低3伏所需的最大上拉电阻将为150kΩ。尽管该计算值可以工作，但由于电阻两端的压降最大，而输入电流最小，因此没有误差的余地。

2 k' k0 W- \" D理想情况下，我们希望逻辑“ 1”尽可能接近Vcc，以保证100％的门通过上拉电阻输入为HIGH（逻辑1）。如果电阻的容差或电源电压不是计算得出的，减小该上拉电阻的电阻值将为我们提供更大的误差容限。但是，我们不希望电阻值太低，因为这会增加流入栅极的电流，从而增加功耗。

因此，如果我们假设电阻两端的压降仅为1伏（1.0V），而在4伏时给出的输入电压是该电压的两倍，那么快速计算将得出单个上拉电阻值为50kΩ。进一步降低电阻值，将产生较小的电压降，但会增加电流。然后我们可以看到，尽管可能存在最大允许电阻值，但上拉电阻的电阻值通常并不那么关键，可接受的电阻值范围在10k到100k欧姆之间。
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- e+ w) z9 K  g6 N, f8 D上面的简单示例为我们提供了偏置单个TTL门所需的上拉电阻的最大值。但是我们也可以使用相同的电阻将多个输入偏置到逻辑“ 1”值。例如，假设我们已经构建了一个数字电路，并且有十个未使用的逻辑门输入。作为单个标准TTL 74LS门，输入电流I I （max）为20μA（也称为1扇入），那么十个TTL逻辑门将需要的总电流为：10 x20μA=200μA，代表一个扇入10。
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因此，为十个未使用的输入供电所需的上拉电阻的最大电阻值将计算如下：
& k6 m! v; t. Y' l4 g多栅极上拉电阻值

/ S- {7 T5 E& ~# ^$ U此处的扇入为10，但如果将“ n”个TTL输入连接在一起，则流经电阻的电流将是“ n”乘以I H（max）。同样，该15kΩ电阻可能是精确计算出的值，但没有误差的余地，因此将电压降降低到1伏（或您想要的任何值）时，电阻值仅为5kΩ。
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2 v; @9 @3 F; {( k7 n上拉电阻示例1两个TTL 74LS00 NAND门以及一个单刀双掷开关将用于制作一个简单的置位双稳态触发器。计算：1）。如果代表逻辑高电平输入的电压在开关断开时保持在4.5伏，则最大上拉电阻值； 2）。开关闭合时流过电阻的电流（假设零接触电阻）。还要画电路。

* X8 [5 P8 Y$ o# @6 V6 J; K给出的数据：Vcc = 5V，V IH  = 4.5V，IH（max）  =20μA
7 ^9 p$ V5 X! `1 F1）。上拉电阻值，R MAX

2）。电阻电流I R

置位复位双稳态电路

下拉电阻上拉电阻与上一个上拉电阻的工作方式相同，只不过这次逻辑门输入接地，逻辑电平为“ 0”（低电平），或者通过机械开关操作可能变为高电平。 。这种下拉电阻器配置对于锁存器，计数器和触发器等数字电路特别有用，这些数字电路在开关暂时闭合以引起状态变化时需要正向一次触发。
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尽管它们似乎与上拉电阻器的工作方式相同，但无源下拉电阻器的电阻值对于TTL逻辑门而言比与类似的CMOS门相比更为关键。这是因为TTL输入处于LOW状态时会从其输入中获取更多电流。
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$ X5 \& j2 M' N从上方我们可以看到，代表TTL 74LSxxx系列逻辑门的逻辑“ 0”（低）的最大电压电平在0至0.8伏之间（V IL（MAX）  = 0.8V）。同样在LOW时，栅极将电流供应到400μA的值（I IL  =400μA）。因此，单个TTL逻辑门的最大下拉电阻值计算如下：
单栅极下拉电阻值

然后，最大下拉电阻值计算为2kΩ。同样，与上拉电阻的计算一样，由于压降最大，因此该2kΩ电阻值没有误差的余地。因此，如果电阻太大，则下拉电阻两端的电压降可能会导致栅极输入电压超出正常的LOW电压范围，因此，为了确保正确开关，最好将输入电压设为0.5伏或更低。

  ^2 u3 Z3 T5 I# u因此，如果我们假设电阻两端的压降仅为0.4伏，那么快速计算将得出一个1kΩ的下拉电阻值。进一步降低电阻值，将产生较小的压降，从而使输入进一步接地（低）。数据手册中的400μA或0.4mA（I IL）值是最小的LOW电流值，但可能更高。
9 _3 n4 m" s/ B% b- {. r, u同样，将输入连接在一起会导致流经电阻的电流更大。例如，扇入10将导致10 x400μA= 4.0mA，需要100Ω的下拉电阻。

但是您可能会想，当直接接地（0V）会产生所需的LOW时，为什么要完全使用下拉电阻？在没有下拉电阻的情况下，直接接地可以在大多数情况下正常工作，但是由于栅极输入端永久接地，因此使用电阻器可以限制从输入端流出的电流，从而降低功耗，同时仍保持低功耗。逻辑“ 0”条件。

集电极开路输出到目前为止，我们已经看到可以使用上拉电阻或下拉电阻来控制逻辑门的电压电平。但是我们也可以在栅极输出端使用上拉电阻，以允许连接不同的栅极技术，例如将TTL连接到CMOS或用于需要更高电流和电压的传输线驱动应用。

4 d. ^0 k* K+ S  O+ T' H' J为了克服这个问题，制造了一些逻辑门，并在门的集电极内部打开了输出电路，这意味着逻辑门实际上并没有驱动输出高电平，而只是驱动低电平，因为外部上拉电阻器会这样做。其中一个示例是TTL 74LS01，四路2输入与非门，具有集电极开路输出，与标准TTL 74LS00的四路2输入与非门相反。

+ Z( R+ H! G1 Y  O' i集电极开路（OC）或CMOS的漏极开路输出通常用于缓冲器/反相器/驱动器IC（TTL 74LS06、74LS07），与普通逻辑门相比，具有更大的输出电流和/或电压能力。例如，用于驱动较大的负载，例如LED指示灯，小型继电器或直流电动机。无论哪种方式，上拉电阻的原理和使用都与输入几乎相同。
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具有集电极开路输出的逻辑门，微控制器和其他此类数字电路无法将其输出拉高，因为没有内部通往电源电压（Vcc）的路径。这种情况意味着它们的输出在LOW时接地或在HIGH时悬空，因此需要从下拉晶体管的集电极开路端子到Vcc电源连接一个外部上拉电阻（Rp）。
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2 i' X% F6 F( I8 u% a在连接上拉电阻的情况下，输出仍与常规逻辑门相同，因为当输出晶体管截止（打开）时，输出为HIGH，而当晶体管导通（闭合）时，输出为低。因此，晶体管导通以将输出拉至低电平。

# \) s" D* E& u, o/ d! R# t上拉电阻的大小取决于所连接的负载以及晶体管截止时电阻两端的压降。当输出为低电平时，晶体管必须能够通过上拉电阻吸收负载电流。同样，当输出为高电平时，流经上拉电阻的电流必须足够高，以连接到其上的任何元件。

正如我们之前在输入中看到的那样，数字逻辑门的输出使用两个二进制状态运行，这些状态由两个不同的电压表示：逻辑“ 1”的高电压V H和逻辑“ 0”的低电压VL。在这两个电压状态的每个状态中，都有一定范围的电压定义了它们的上，下电压。
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, J+ i" u" i" ]V OH（min）是保证被识别为逻辑“ 1”（高）输出的最小输出电压，对于TTL，此输出电压为2.7伏。V OL（max）是保证被识别为逻辑“ 0”（低）输出的最大输出电压，对于TTL，该输出电压为0.5伏。换句话说，TTL 74LSxxx在0到0.5V之间的输出电压被认为是“低”，而在2.7到5.0V之间的输出电压被认为是“高”。
因此，当使用集电极开路逻辑门时，所需的上拉电阻器的值由以下公式确定：
集电极上拉电阻值

' k3 F9 b1 h, i7 F/ b5 M7 v对于7401集电极开路NAND的值给出为：Vcc = 5V，V OL  = 0.5V，I OL（max）  = 8mA。请注意，计算合适的上拉电阻Rp非常重要，因为流经该电阻的电流不得超过I OL（max）。
. ~5 \5 b3 m- `2 D, J
6 N  |/ q6 V7 H8 p+ m1 s我们之前说过，集电极开路逻辑门非常适合驱动需要较高电压和电流水平的负载，例如LED指示器。TTL 74LS06十六进制反相器缓冲器/驱动器的I OL（max）额定值为40 mA（而不是74LS01的8mA），而V OH（max）额定值为30 V，而不是通常的5 V（但IC本身必须使用5V电源）。然后74LS06将使我们能够驱动高达40mA的负载。

上拉电阻示例2需要一个74LS06六角逆变器驱动器来控制来自12伏电源的单个红色LED指示灯。如果LED在1.7V压降下需要15mA电流，并且当HEX逆变器的全开状态下的V OL为0.1伏时，请计算驱动LED所需的限流电阻值。

我们可以以类似的方式使用集电极开路驱动器来驱动小型机电继电器，灯或直流电动机，因为这些设备通常需要5V或12V或更高的电压，才能以大约10至20 mA的电流正常工作。
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' j( P3 a; V  e  d% r" e5 g( E/ iTTL门的两个或多个集电极开路输出可直接连接在一起，并通过单个外部上拉电阻连接。结果是，当组合的行为就像门与“与”门相连时，输出有效地进行了“与”运算。这种配置称为有线与逻辑。
2 J# _  D; R( k$ v8 ^上拉电阻汇总我们在本教程中看到了有关无源上拉和下拉电阻的信息，这些电阻在保持开路状态时，数字逻辑门的输入可能会自偏置或浮动到他们选择的任何逻辑电平，并且可以追踪许多开关错误回到未连接的和悬空的输入引脚。
上拉电阻将未使用的输入引脚（与门和与非门）连接至直流电源电压（Vcc），以保持给定输入为高电平。下拉电阻将未使用的输入引脚（“或”或“或非”门）连接到地面（0V），以保持给定的输入低电平。上拉电阻的电阻值通常不是那么关键，但必须将输入引脚电压保持在V IH以上。通常使用10kΩ上拉电阻，但阻值范围可从1k到100k欧姆。

4 }4 l9 Q0 L7 b+ X/ Y- W由于低输入电压电平V IL（max）和较高的I IL电流，下拉电阻的要求更为严格。最常用的是100Ω下拉电阻，但其电阻值范围从50到1k欧姆。
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具有集电极开路（对于TTL逻辑而言）输出或数字漏极开路（对于CMOS逻辑而言）输出的数字逻辑门需要连接至其输出引脚与直流电源之间的外部上拉电阻使逻辑门执行预期的逻辑功能。
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使用集电极开路/漏极开路的优势在于它们能够切换更高的电压和电流，或者能够提供有线“与”运算。一些集电极开路栅极（例如74LS06）能够驱动更大的负载，因为它们的输出可以通过外部上拉电阻连接到高达30伏的电源。

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很好的数字逻辑门之上拉电阻设计教程，先收藏了。期待楼主的下次分享。