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EDA365电子论坛网»电子社区 › 研发技术版块 › 信号完整性SI/PI仿真 › 板级阻抗分析出来，如图，低频是开路阻抗，怎么解决啊
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[Cadence Sigrity] 板级阻抗分析出来，如图，低频是开路阻抗，怎么解决啊

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webXZ

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1#
发表于 2021-1-15 14:53 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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板级阻抗分析出来，如图，低频是开路阻抗，怎么解决啊
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dzkcool
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    2024-2-21 15:59

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    [LV.8]以坛为家I
    2#
    发表于 2021-1-15 15:06 | 只看该作者
    VRM的问题，要短路掉

    点评

    webXZ
    怎么短路呢？我看网上说加一个毫欧级的电阻，怎么加啊  详情 回复 发表于 2021-1-18 14:44

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    webXZ

    该用户从未签到
    3#
     楼主| 发表于 2021-1-18 14:44 | 只看该作者
    dzkcool 发表于 2021-1-15 15:06, \' m, b- V1 Y# X. ]! g4 e
    VRM的问题，要短路掉
    4 j1 b) g3 S* U3 Q2 s) R5 A, g
    怎么短路呢？我看网上说加一个毫欧级的电阻，怎么加啊, m! |5 r' I6 ?( Q5 X' q& b

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    diff

    该用户从未签到
    4#
    发表于 2022-4-12 16:23 | 只看该作者
    vrm短路就不是这样了

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