找回密码
 注册
关于网站域名变更的通知
查看: 528|回复: 2
打印 上一主题 下一主题

insert_redundant_vias 把timing带坏。

[复制链接]

该用户从未签到

跳转到指定楼层
1#
发表于 2021-1-14 18:41 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

EDA365欢迎您登录!

您需要 登录 才可以下载或查看,没有帐号?注册

x
本帖最后由 rongunac 于 2021-1-14 18:46 编辑
1 T, Y' M" x$ V" u. ~; e: l" `, w! A. u0 n2 Y; C* U: m
+ A  ?  |4 R) @* g$ N) I
insert_redundant_vias 把timing带坏,请教大神,这个如何处理?非常感谢!
3 y! w7 F7 n- h1 S- W/ h: o+ O9 s8 |1 e6 ~* m6 E0 n% P4 V
目前想到的解决办法,把effort降低为low。3 {6 o% m' ?3 \( \4 m' ~6 A
% B9 K7 p! s# D( a$ O& D, i  }
定义热dundant via 的rule,没搞懂,它的lect上写的优先级VB>VG>V。VB和VG指的什么via呢?
1 _  W. b# `! u. {( ?. ~& N) U  v
还有加上double via后ICC中和PT的结果有很大的一个误差,如何让他们的结果统一一下呢?

3.png (35.86 KB, 下载次数: 1)

3.png

2.png (52.55 KB, 下载次数: 1)

2.png

1.png (151.47 KB, 下载次数: 1)

1.png

该用户从未签到

2#
发表于 2021-1-14 19:23 | 只看该作者
优先级VB>VG>V

该用户从未签到

3#
发表于 2021-1-15 11:06 | 只看该作者
有对应的设置,阻止critical path 上面加。
( y; t2 x0 W! e' |; |加后在route_opt。
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

推荐内容上一条 /1 下一条

EDA365公众号

关于我们|手机版|EDA365电子论坛网 ( 粤ICP备18020198号-1 )

GMT+8, 2025-8-21 08:24 , Processed in 0.109375 second(s), 26 queries , Gzip On.

深圳市墨知创新科技有限公司

地址:深圳市南山区科技生态园2栋A座805 电话:19926409050

快速回复 返回顶部 返回列表