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[Cadence Sigrity] 【Sigrity仿真中加载IBIS问题】

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  • TA的每日心情
    开心
    2020-12-22 15:09
  • 签到天数: 24 天

    [LV.4]偶尔看看III

    跳转到指定楼层
    1#
    发表于 2020-11-13 09:42 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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    大佬们,CPU厂商给出的IBIS文件加载到SystemSI仿真时提示has no【Pin Mapping】section,是不是IBIS不完整?
  • TA的每日心情
    开心
    2020-12-22 15:09
  • 签到天数: 24 天

    [LV.4]偶尔看看III

    2#
     楼主| 发表于 2020-11-13 09:43 | 只看该作者
    % ?+ p( c3 v  _& v
  • TA的每日心情
    开心
    2020-12-22 15:09
  • 签到天数: 24 天

    [LV.4]偶尔看看III

    3#
     楼主| 发表于 2020-11-13 09:46 | 只看该作者

    $ _2 ~7 q/ A5 v! I2 D) I- \! m1 }) g9 M/ q/ F9 E# X
    之前仿真用的IBIS这两个里面都有描述,但是这次这个CPU厂商给出的IBIS没有任何BUS Definition,Pin Mapping只有gnd,vdd,PAD,是不是不对啊……
    - j' c3 d0 ~4 f8 A, I+ @
  • TA的每日心情
    开心
    2020-12-22 15:09
  • 签到天数: 24 天

    [LV.4]偶尔看看III

    4#
     楼主| 发表于 2020-11-13 10:25 | 只看该作者
    IBIS文件内容,Component项里只有三行定义,PAD,gnd,vdd,没有具体信号的定义和总线定义,是否是IBIS不全?9 v* l9 p4 i' L0 z9 n
  • TA的每日心情
    开心
    2024-2-21 15:59
  • 签到天数: 313 天

    [LV.8]以坛为家I

    5#
    发表于 2020-11-17 09:10 | 只看该作者
    要自己对每类信号定义Pin Mapping,建议用SPEED2000的DDR仿真功能进行快速定义,具体方法可以参考电巢学堂《信号完整性仿真实训营》课时 37 : DDR内存条仿真实战—仿真实操,只要做到模型设置即可,用软件生成的新模型去仿真。

    该用户从未签到

    6#
    发表于 2020-12-11 14:25 | 只看该作者
    刘明留个名
  • TA的每日心情
    慵懒
    2025-7-16 15:01
  • 签到天数: 633 天

    [LV.9]以坛为家II

    7#
    发表于 2020-12-26 14:17 | 只看该作者
    建造好模型,做好设置即可
  • TA的每日心情
    擦汗
    2024-12-17 15:08
  • 签到天数: 23 天

    [LV.4]偶尔看看III

    8#
    发表于 2021-6-25 13:41 | 只看该作者
    PIN对应需要自己设置,还是挺繁琐的。
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