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[毕业设计] 新型集成电路简化嵌入式POL DC/DC转换器设计

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发表于 2020-9-4 14:35 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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1、背景7 i1 F9 w$ U: S% l, c; @' Q
太多数嵌人式系统都是由48V 背板供电的。这个电压通常萎降至较低的12V或5V中间电压,以向系统内的电路板支架供电。然而,这些电路板上的大多数分支电路或集成电路所要求的供电电压范眩为0.8V至3.3V,供电电流范围为数十毫安至数十安培。结果,需要负载点〔 POL )DC/DC转换器将12V 或SV电压降低至这些分支电路或集成电路所需的电压和电流值。因为这些系统的空间和冷却能力是很有限的,所以任何POL转换器都要既小巧又高效,这是极端重要的。此外,很多微处理器和数字信号处理器DSP)都需要内核电源和一-个输入〉输出〔LO)电源,这些电源在启动时必须排序。设计师们必须考虑在加电和断电操作时内核和LO电压源的相对电压和时序,以符合制造商规定的性能规格。如果没有正确的电源排序,就可能出现闭锁或过高的电流消耗,这可能导致微处理器LO端口或存储器、可编程逻辑器件(PLD).现场可编程门阵列(FPCA〕或数据转换器等支持器件的LO端口损坏。为了确保内核电压正确偏置之前不驱动LO负载,内核电源和LO电源绀踪是必需的。8 y/ D/ O* w/ R/ Q# f7 D
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