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[Cadence Sigrity] PCIE GEN4和PGEN5 MB端的插损是多少呢?

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发表于 2020-8-6 19:01 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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PCIE GEN4和PGEN5 MB端的插损是多少呢?,谁各一个值参考下,只看到整个链路的?
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    2024-2-21 15:59
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    [LV.8]以坛为家I

    2#
    发表于 2020-8-7 07:33 | 只看该作者
    MB端包括芯片和连接器,PCIE GEN4:-20dB;GEN5:-27dB

    点评

    補充圖片~  详情 回复 发表于 2020-8-12 10:08
    專業~  发表于 2020-8-12 10:04
    请问,主板端指的是啥,CPU加主板线路?  详情 回复 发表于 2020-8-7 09:00
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    [LV.1]初来乍到

    3#
    发表于 2020-8-7 09:00 | 只看该作者
    dzkcool 发表于 2020-8-7 07:33
    / O; h* U1 z2 Y" M$ z+ SMB端包括芯片和连接器,PCIE GEN4:-20dB;GEN5:-27dB
    ( o* Q0 s; t+ }4 e7 R( X
    请问,主板端指的是啥,CPU加主板线路?* A' v5 s, y8 f5 a! l* P0 G

    点评

    杜老师这个值没包括AIC的损耗吧。芯片一般封装带来的损耗比较大的,连接器损耗估计在3DB以内,除开连接器和芯片 主板MB PCIE4.0的损耗大概在12DB以内 这个值估计正确么  详情 回复 发表于 2020-8-7 10:31

    该用户从未签到

    4#
     楼主| 发表于 2020-8-7 10:31 | 只看该作者
    小王同学 发表于 2020-8-7 09:00& o" ^6 L; N* t. V- c! U) Y
    请问,主板端指的是啥,CPU加主板线路?

    $ z) `6 n/ o4 s/ N& m杜老师这个值没包括AIC的损耗吧。芯片一般封装带来的损耗比较大的,连接器损耗估计在3DB以内,除开连接器和芯片 主板MB PCIE4.0的损耗大概在12DB以内 这个值估计正确么  D: D* `6 j3 c9 t; _2 N
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    [LV.9]以坛为家II

    5#
    发表于 2020-8-12 10:08 | 只看该作者
    dzkcool 发表于 2020-8-7 07:33
    7 C3 f* r4 i8 W/ w- N% iMB端包括芯片和连接器,PCIE GEN4:-20dB;GEN5:-27dB
    8 ?' j8 }; ~* g
    補充圖片~1 v- D6 l* ^: X9 r1 b
    8 Z4 Z3 p# K, }5 y

    $ }4 t7 L6 T+ F) t( _

    4.JPG (39.09 KB, 下载次数: 0)

    PCIe4.0

    PCIe4.0

    5.JPG (37.58 KB, 下载次数: 6)

    PCIe5.0

    PCIe5.0

    点评

    感谢,请问楼主这份文档可以分享嘛  详情 回复 发表于 2020-8-25 10:45

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    6#
     楼主| 发表于 2020-8-25 10:45 | 只看该作者
    briantseng 发表于 2020-8-12 10:08- c% j$ I$ c+ M
    補充圖片~

    7 v. |5 g' I+ Z' W1 w5 N$ U" }! e, v感谢,请问楼主这份文档可以分享嘛

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    7#
    发表于 2021-10-19 09:08 | 只看该作者
    请问楼主这份文档可以分享嘛
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